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1、学院 姓名 学号 任课老师 考场教室_选课号/座位号 密封线以内答题无效第 1 页 共 8 页电子科技大学 2012-2013 学年第 1 学期期 中 考试 A 卷课程名称：微处理器系统结构与嵌入式系统设计 考试形式：一本书开卷 考试日期：2012 年 11 月 11 日 考试时长：120 分钟平行班课程成绩构成：平时 10 %， 期中 15 %， 实验 15 %， 期末 60 %本试卷试题由 3 部分构成，共 7 页。题号 一 二 三（1） 三（2） 三（3） 三（4） 三（5） 合计得分注意：请将第一、二题答案填入指定位置。一、 单选题答案（共 40 分，共 40 题，每题 1 分）二、
2、填空题答案（共 30 分，共 30 空，每空 1 分）1. 可编程处理器 片上存储器 硬件加速功能单元 (或 I/O 接口) （可交换顺序）2. 每秒百万条指令 指令的平均执行周期数 3. 系统级并行技术 指令级并行技术 线程级并行技术 电路级并行技术 （可交换顺序） 4. 机器语言 5. 程序控制 中断控制 I/O 处理机 DMA DMA（或 I/O 处理机） （前 4 空可交换顺序）6. 2k * 9 bit （或 211*9 bit） 7. 88 8. 统一编址 （或 存储器映象编址） 9. 合理地控制和管理系统中主设备的总线请求，以避免总线冲突 1 2 3 4 5 6 7 8 9 10
3、 11 12 13 14 15 16 17 18 19 20D C B A B C D B B B D C A B C B C D D D21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40D D B B A B D D B A D C C B C A D C D C得 分得 分学院 姓名 学号 任课老师 考场教室_选课号/座位号 密封线以内答题无效第 2 页 共 8 页10. 1 11. 线选法 部分译码法 全译码法 （可交换顺序）12. 16 8 2 13. 程序员角度看到的计算机结构 计算机各部件的逻辑结构及连接方式 体系
4、结构 14. 先入先出 一、单项选择题（每空 1 分，共 40 分） 1. 8 位二进制补码操作数“10010011”等值扩展为 16 位后，其机器数为：（D）A、0111111110010011 B、0000000010010011C、1000000010010011 D、11111111100100112. 下列无符号数中最大的数是：（C）A、 （03F5） 16 B （100,0001,0101） 2 C、 （2590） 10 D （1764） 83. 无符号二进制数右移一位，则数值：（B）A、增大一倍 B、减小一倍 C、增大 10 倍 D、不变4. 计算机系统的主要组成部件应包括：（A
5、）A、微处理器、存储器和 I/O B、微处理器、运算器和存储器C、控制器、运算器和寄存器 D、微处理器、运算器和寄存器5. 计算机通常用 MB（兆字节）作为主存容量的计量单位，这里 1MB 等于（B）字节。A、2 10 B、2 20 C、2 30 D、10 66. 某个寄存器中存放的数值为操作数的存储单元地址，这种寻址方式称为：（C）A、立即寻址 B、寄存器移位寻址 C、寄存器间接寻址 D、寄存器直接寻址7. 程序计数器 PC 通常用于存放：（D）A、数据 B、指令 C、正在执行的指令地址 D、待取指的指令地址 8. 若要使寄存器 A 中的低 4 位不变，高 4 位清零，使用指令：（B） （O
6、R：或运算 ，AND 与运算）。A、OR A,0F0H B、AND A,0FH C、OR A,0FH D、AND A,0F0H9. 微程序控制器中，机器指令与微指令的关系是：（B）A、每一条机器指令由一条微指令来执行学院 姓名 学号 任课老师 考场教室_选课号/座位号 密封线以内答题无效第 3 页 共 8 页B、每一条机器指令由一段微指令编写的微程序来解释执行C、每一条机器指令组成的程序可由一条微指令来执行D、一条微指令由若干条机器指令组成10. 计算机将要执行的程序段（包括代码和数据）应安排在计算机的（B）部件中。A、硬盘 B、内存 C、寄存器 D、端口11. 以下对于 RISC 机器来说正
7、确的是：（D）A、指令编码不等长 B、寻址方式多 C、不能访问存储器 D、运算类指令只使用寄存器12. 以下主存设计中属于计算机系统结构考虑的是：（C）A、采用 MOS 还是 TTL B、采用单体还是多体交叉 C、容量和编址方式 D、工作时钟频率13. 冯诺依曼计算机的基本特点是：（A） 。A、单指令单数据流 B、多指令单数据流 C、单指令多数据流 D、多指令多数据流14. 下面对“堆栈”最好的解释是：（ B ） 。A、按字操作访问的内存固定区域 B、按后进先出原则组织的内存区域C、用于存放临时数据的内存固定区域 D、按向上增长方式组织的内存区域15. 在微处理器的体系结构中，下列哪个功能部件
8、不属于数据通路的组成部分：（C）A、ALU B、寄存器组 C、控制器 D、内总线16. 通常所说的 32 位机指的是：（B）A、地址总线是 32 位的 B、数据总线是 32 位的C、控制总线是 32 位的 D、I/O 口线是 32 位的17. 指令之间存在的相关性可能会引起流水线的停顿，从而影响流水线的性能和效率。下列不属于指令相关的为：（C）A、数据相关 B、结构相关 C、名字相关 D、控制相关18. 对于 RISC 机设计应遵循的原则，下列说法不正确的是：（D）A、指令结构简单 B、提供足够的寄存器C、指令由硬件直接执行 D、减少复杂度，尽量不使用流水线19. 程序控制类指令的功能之一是：
9、（D）A、完成算术、逻辑运算 B、完成主存和 CPU 之间的数据传送学院 姓名 学号 任课老师 考场教室_选课号/座位号 密封线以内答题无效第 4 页 共 8 页C、完成 CPU 和 I/O 设备之间的数据传送 D、改变程序执行的顺序20. 在嵌入式软件系统中，以下模块不属于操作系统层的是：（ D ） 。A、文件系统 B、OS 内核 C、键盘驱动 D、嵌入式 GUI21. 片内 AMBA 总线中， APB 桥是（D）A、一种 I/O 接口 B、AHB 高性能系统的中枢C、一种总线仲裁器 D、APB 总线中的唯一主设备22. 中断控制方式的优点是：（D） 。A 无须 CPU 干预 B软件编程容易
10、 C硬件连接简单 D提高 CPU 的利用率23. 指令系统中采用不同寻址方式的目的主要是：（ B ） 。A、实现存储程序和程序控制 B、缩短指令长度，扩大寻址空间，提高编程灵活性 C、可以直接访问外存 D、提供扩展操作码的可能并降低指令译码难度24. 动态 RAM 的特点是：（B）A速度高于静态 RAM B集成度高于静态 RAMC一般用作高速缓存 Cache D不需要刷新电路25. 当 CPU 响应中断时，通常对正在执行的指令的处理方法是（A） 。A.执行完当前指令之后响应中断 B.停止执行当前指令C.中断执行当前指令 D.放弃执行当前指令26. 下列关于闪速存储器（Flash Memory）
11、说法错误的是（B） 。A抗震能力比硬盘强 B掉电以后信息消失C可以整块芯片电擦除和部分电擦除 D可反复使用27. 下面关于总线的叙述中，错误的是（D） 。A、总线位宽指的是单位时间内能同时传送的最大数据位数B、总线标准是指总线传送信息时应遵守的一些协议与规范C、PCI 总线支持突发成组传送D、串行总线带宽小于并行总线的带宽28. 下列各项中，不是同步总线协定特点的是( D )。A、不需要应答信号 B、各部件的存取时间比较接近C、总线长度较短 D、总线周期长度可变学院 姓名 学号 任课老师 考场教室_选课号/座位号 密封线以内答题无效第 5 页 共 8 页29. 计算机系统中，中断向量通常是指（
12、B） 。A、 中断发生的先后顺序 B、中断服务程序的入口地址C、 中断的优先级 D、中断的类型编号30. CPU 访问 I/O 设备，实际上是访问（A） 。A、端口 B、接口 C、总线 D、信号线31. 微处理器地址总线宽度为 32 位，则其内部数据总线的宽度（D） 。A、16 位 B、32 位 C、64 位 D、与地址总线没有必然联系32. 计算机系统中的四级存储器，其存取速度从高到低的顺序是（C） 。A、主存储器，Cache，寄存器，辅存 B、快存，主存储器，寄存器，辅存C、寄存器，Cache，主存储器，辅存 D、寄存器，主存储器，Cache，辅存33. 分页管理存储系统中，通过地址映射表
13、来完成虚拟地址到物理地址转换的部件是：（C） 。A、寄存器 B、ALU C、MMU D、.接口34. 为了提高系统总线的驱动能力可采用（ B ）A、采样保持器 B、三态缓冲器 C、地址译码器 D、多路转换器35. 若下列字符码中有奇偶校验位，但没有数据错误，那么采用偶校验的字符码是（C） 。A、11001011 B、11010110 C、11010001 D、1100000136. 下列因素中，与 Cache 的命中率无关的是（A） 。A、主存存取时间 B、块的大小 C、Cache 组织方式 D、Cache 容量37. 存储器内容不会因电源的关闭而消失的存储器类型是（D） 。A、DRAM B、SRAM C、SDRAM D、EEROM38. 在主机与外围设备进行数据交换时，为解决两者之间的同步与协调、数据格式转换等问题，必须要引入（C） 。A、数据缓冲器 B、IO 总线 C、I/O 接口 D、串/并转换器39. 除了 I/O 设备本身的性能外，影响嵌入式系统 I/O 数据传输速度的主要因素是：（D） 。A、Cache 性能 B、CPU 字长 C、主存容量 D、总线传输速率40. 16*4 位的 ROM 芯片，需要多少个地址输入端：（C） 。A、2 B、3 C、4 D、8二 填空题（共 30 分，每空 1 分）学院 姓名 学号 任课老师 考场教室_选课号/座位号
