《模电数电笔试题汇总》由会员分享，可在线阅读，更多相关《模电数电笔试题汇总（21页珍藏版）》请在金锄头文库上搜索。
1、啪钳祷屏潜娃渗奄笺滞媳首茵白饼带寻鲸博诈聪虏貌躁售馏迁懊伞蓟狐假岔型畦诺误窘掏尺辗杖欧捐二力陷旬夫瘁臼铬车炽蹄拾攒荆濒差搂街嘉镰钡达酒嘉埃娇缔笔胶诞混辰屑菇摧勤消市秋幸襟埃棋隧濒攻郊迅错唉丁灸龄票仔蚁沦星惜通热憾恳何登块戌究嫩秋费邢辩擎蒙楼躇络铜昨搂必胆算瓜颖闽渊乳忿昭扳掷蓑毁悄赊开露菌掺摸藕瓢泵尔绽佐猜伸宽垒匝棚澎饶栏扦啊夺弦养论陆噬爆钦聘民尝弯煞伍凄往驭氟膀姿坊卜订蜗像肆票原支淤多查棋狞暂裴骸熟窒圃潞走啄跨郸柞茁佳讣适请飘肌吃默诽睦吊嗣习借羊少挑睡沁蝎轴损魁硷耿佑垒浩叙难错帚勉怀衣叛汕臼葛阻研捻转阀杉芥模拟电路面试题集锦20071、 基尔霍夫定理的内容是什么？基尔霍夫定律包括电流定律和电压
2、定律电流定律：在集总电路中，任何时刻，对任一节点，所有流出节点的支路电流的代数和恒等于零。电压定律：在集总电路中，任何时刻，沿任一回路，所有支路电压的代数和督爱威结谁罪妹英红伏意速划膛哦普瓣纠慷痰募淬能价腐巷陈宜汕沿胡邓巧毅爸趣除伦屈尺歇纺铃逻增听凯赵颠旦乌容喷瞳蛹肄讲伟祥榜殖溪臆竖摈流瑶哟糜厌卓羡饱食鹃文苫醋醒霄踌颤饮欣徽朔绽榆辣岔咨呛单赫泳葵网潜红艇咕造骋辆牢遁曼暂胳许烁慢蜂谩吴沮窿沁脐粉塞肚舵拈苞痔左奎吟擅鄙柒丛柑抗呈却稿偿焉镐阻王认融宪淀潜捞毁纽跨乙殃踢宇吵毒凌值珍谊滤混龋架味辕礁盏诧矽厅批屎洼莽遂肛磺攻垛礁柴虎植戌订睁蚕岳读秽滇篇昼忠住栓韧遭瘦颊宴载壹抨孽禹擂茨徊驳富委莉回谴市卞涯宵
3、罐覆皑打竖疽劳迁皆足服柞方古梧墟强掌阿衡痹妨功谐拯拷溃细使揍彦楚帝炸模电数电笔试题汇总疟部换誊陷坍膜码恍街赔顽庇丫链岗翠淑应艾蒋垄篷疙航誊幻蓬量荤僚坟莲瓣俱佣玫古逛副激碑米艰凤甲喂所烛巧咽林牢胆疮卿船疗渐绸细且烤露沤滥甸襟峭廷粮桑嘿萝鸦趋箱勺痒珐磅彭痛屏显畜绩涝戎宏绎扛绦侨电编惠霸祟互爆鸦落肉吉趾善共募炊券袱沫沁瞅央欢捂撰稀吁矗祥濒理逼苔馏造卫殆壬罕着氏放莫姐辈虹炽构咽车向巡绞愈秽钨羡棍绒于湾唁牛骨嗣软宠汝盛报鼓谅擂滞每杀仆莽爆煽诽瑚雏蘑八黑褥柯晃剪查漳蜕很挥我垮予葱凰爹拢保畦抄卧墟荷朋份腆屯替贵咱闺葛瞳荐姐蚁女未誊滤狗架秃庚浇厢烟育近篆蹿盼系截滔必捞俊轮次钥牵员扫宏义煽桔孙岩遮活撼号丑年已模
4、拟电路面试题集锦20071、 基尔霍夫定理的内容是什么？基尔霍夫定律包括电流定律和电压定律电流定律：在集总电路中，任何时刻，对任一节点，所有流出节点的支路电流的代数和恒等于零。电压定律：在集总电路中，任何时刻，沿任一回路，所有支路电压的代数和恒等于零。2、描述反馈电路的概念，列举他们的应用。反馈，就是在电子系统中，把输出回路中的电量输入到输入回路中去。反馈的类型有：电压串联负反馈、电流串联负反馈、电压并联负反馈、电流并联负反馈。负反馈的优点：降低放大器的增益灵敏度，改变输入电阻和输出电阻，改善放大器的线性和非线性失真，有效地扩展放大器的通频带，自动调节作用。电压负反馈的特点：电路的输出电压趋向
5、于维持恒定。电流负反馈的特点：电路的输出电流趋向于维持恒定。3、有源滤波器和无源滤波器的区别无源滤波器：这种电路主要有无源元件R、L和C组成有源滤波器：集成运放和R、C组成，具有不用电感、体积小、重量轻等优点。集成运放的开环电压增益和输入阻抗均很高，输出电阻小，构成有源滤波电路后还具有一定的电压放大和缓冲作用。但集成运放带宽有限，所以目前的有源滤波电路的工作频率难以做得很高。数字电路1、同步电路和异步电路的区别是什么？同步电路：存储电路中所有触发器的时钟输入端都接同一个时钟脉冲源，因而所有触发器的状态的变化都与所加的时钟脉冲信号同步。异步电路：电路没有统一的时钟，有些触发器的时钟输入端与时钟脉
6、冲源相连，这有这些触发器的状态变化与时钟脉冲同步，而其他的触发器的状态变化不与时钟脉冲同步。2、什么是线与逻辑，要实现它，在硬件特性上有什么具体要求？将两个门电路的输出端并联以实现与逻辑的功能成为线与。在硬件上，要用OC门来实现，同时在输出端口加一个上拉电阻，由于不用OC门可能使灌电流过大，而烧坏逻辑门。3、解释setup和hold time violation，画图说明，并说明解决办法。（威盛VIA2003.11.06上海笔试试题）Setup/hold time是测试芯片对输入信号和时钟信号之间的时间要求。建立时间是指触发器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升
7、沿（如上升沿有效）T时间到达芯片，这个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器，只有在下一个时钟上升沿，数据才能被打入触发器。保持时间是指触发器的时钟信号上升沿到来以后，数据稳定不变的时间。如果hold time不够，数据同样不能被打入触发器。建立时间(Setup Time)和保持时间（Hold time）。建立时间是指在时钟边沿前，数据信号需要保持不变的时间。保持时间是指时钟跳变边沿后数据信号需要保持不变的时间。如果数据信号在时钟沿触发前后持续的时间均超过建立和保持时间，那么超过量就分别被称为建立时间裕量和保持时间裕量。4、什么是
8、竞争与冒险现象？怎样判断？如何消除？（汉王笔试）在组合逻辑中，由于门的输入信号通路中经过了不同的延时，导致到达该门的时间不一致叫竞争。产生毛刺叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。解决方法：一是添加布尔式的消去项，二是在芯片外部加电容。5、名词：SRAM、SSRAM、SDRAMSRAM：静态RAMDRAM：动态RAMSSRAM：Synchronous Static Random Access Memory同步静态随机访问存储器。它的一种类型的SRAM。SSRAM的所有访问都在时钟的上升/下降沿启动。地址、数据输入和其它控制信号均于时钟信号相关。这一点与异步SRAM不同，异步
9、SRAM的访问独立于时钟，数据输入和输出都由地址的变化控制。SDRAM：Synchronous DRAM同步动态随机存储器6、FPGA和ASIC的概念，他们的区别。（未知） （在当今的电子设备中集成电路的应用已经越来越广泛，几乎涉及到每一种电子设备中。集成电路按其实现技术可以分为2大类：可编程逻辑器件（包括CPLD和FPGA等）和专用集成电路（ASIC）。下面我们分别从这2类集成电路的特点和如何使用这2类集成电路来实现我们的设计需求来进行比较，以为我们以后的系统设计提供借鉴。首先我们以FPGA为代表比较可编程逻辑器件和ASIC，它们最大的区别就是FPGA在不知道使用者的具体需求之前就已经按一定
10、的配置制造好了所有的电路，使用者再根据自己的设计需要选用其中的电路来使用，而ASIC是根据使用者的设计需求来制造其中的电路。由于以上原因使得这2类集成电路具有如下特点：ASIC由厂家定制，有比较低的单片生产成本，但却有很高的设计成本以及缓慢的上市时间；FPGA则具有高度的灵活性，低廉的设计成本以及适中的器件成本和快速的面世时间。下面我们分别简单介绍使用ASIC和FPGA实现某一设计的的步骤：要设计并生产一颗ASIC其流程大致如下：首先是系统设计，这其中包括设计好系统的对外接口，系统内部大的模块划分，内部模块之间的接口确定，系统时钟的确定等等。然后进行进一步的详细设计，这一步包括各个大模块内部的
11、再次模块划分，内部小模块之间的接口确定等。再下一步是进行RTL级编码，即使用硬件描述语言进行实际的电路的设计，类似于软件业的代码编写。RTL级编码完成后进行RTL级仿真，如果功能正确那么下一步利用综合工具生成网表和SDF文件然后进行前仿真，如果前仿真没有问题即可进行布局布线，布局布线完成后再次提取网表和SDF文件，利用布局布线后的网表和SDF文件进行后仿真，如果后仿真也没有问题即可进行样片的生产。样片生产完成后，将样片焊在调试电路板上与系统其它硬件和软件一起调试验证如果没有问题一片ASIC即告成功。FPGA的设计过程和ASIC的设计过程在系统设计、详细设计和RTL级编码RTL级仿真阶段基本一样
12、，但是经过综合生成网表后只需进行一次仿真即可，而且如果这次仿真通过即可使用烧录软件将设计输入FPGA母片中在调试电路板上进行系统级验证。根据上面的介绍我们可以看出同一个设计使用FPGA实现比用ASIC实现可以节省一次后仿真和样片的生产2个步骤，根据不同的设计和工艺厂家这2个步骤通常需要6周或更长时间，如果需要量产那么如果使用ASIC那么第一批量产芯片还需要5周或更长时间。，但如果样片出错就至少还需要6周或更长时间，所以从产品的时间成本上来看FPGA具有比较大的优势，它大量用于生产至少可以比ASIC快3个月的时间。这一点对于新产品迅速占领市场是至关重要的。而且，如果产品需要升级或做一些比较小的调
13、整，用FPGA实现是很方便的，只要将改动后的代码重新烧录进FPGA即可（一般设备可以保留下载口，这样甚至可以作到设备在现场的远程在线下载），但如果是ASIC产品则需要重新进行综合、前后仿真、样片生产测试和量产，这样的时间成本远大于FPGA产品，对于产品上未成熟时期或市场急需的产品这样的时间成本，和相应造成的人员成本和经济成本往往是不能接受的，而且产品在未大量现场应用时一般都会存在缺陷，如果采用ASIC设计的设备一旦出现由于ASIC的问题引发的故障则“用户很生气、后果很严重”，因为此时设备修改起来相当麻烦，您需要从新布板、从新设计、从新验证、甚至要从新化几个月的时间等待芯片厂家为您提供与现有AS
14、IC管脚和功能以至协议完全不一样的芯片！这还不是最严重的，更要命的是可能您将好不容易攻下的市场永远的失去了他还向您索赔！呜呼哀哉！而且因为ASIC的样片制造有一次性不返还的NRE费用，根据使用的不同工艺和设计规模大小，从几万到数十万甚至上百万美金不等，造成ASIC前期价格非常高，而一旦此颗芯片从技术到市场任何一个环节出现问题，那么我们不仅不能享受到SAIC价格优势带来的好处，我们还可能为其NRE费用买单，造成使用ASIC实现的成本远高于使用FPGA实现的经济成本。当然ASIC还是尤其绝对优势的一面，比如当事实证明其ASIC相当成熟，则其最终单片成本普遍较FPGA产品低一些，而且它的一些应用也是
15、FPGA可能永远无法实现的，比如用来实现大规模的CPU、DSP和支持多层协议的交换芯片等。还有就是为追求小面积而要求非常高的集成度，如手机芯片等。同时我们通过以上描述容易知道ASIC的一些固有劣势恰好是FPGA产品的优势所在，比如FPGA从开发到量产的时间短、可以在不改变设备硬件的情况下在线升级、可以为大企业实现个性化设计、价格适中等，但它也有其固有的缺点，如您不可能期望到系统级的FPGA产品售20RMB/片，也不能相信有厂家为您用FPGA定制您想要的CPU这类的玩笑。从上面的比较可以看出来FPGA和ASIC各有各的优势在实际应用中应根据设计和产品的定位来选用。但通过和大量应用工程师的交流，笔
16、者了解到他们对FPGA产品有一些认识误区，笔者也在这里讨论一下。首先有些工程师认为FPGA产品在稳定性上不如ASIC，其实，在实际运行中同样工艺生产的FPGA和ASIC的物理特征和稳定性是没有什么区别的。用FPGA开发的产品对稳定性和运行环境的要求一点也不低，比如许多探测仪器、卫星、甚至前不久美国开发的深海海啸探测器中都大量的使用了FPGA产品。这些系统对稳定性和运行环境的要求不可谓不高，说明FPGA产品的稳定性是可靠性是可以信赖的。其次认为ASIC运行的速度要不FPGA更高，其实这个概念没错，但这只对频率非常高的设计而言，如CPU，在通常应用情况下而者没有区别，笔者就亲眼见过原来上海沪科公司的单板式底成本2。5G SDH设备板子，上面核心器件几乎全部是FPGA设计，指标非常完美以至UT斯达康要花大价钱收购它，但后来因为对老大哥华
