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1、航空航天大学课程设计报告课程设计名称：计算机组成原理课程设计 课程设计题目：阵列乘法器的设计与实现院（系）：计算机学院专 业：计算机科学与技术班 级：学 号：姓 名：指导教师：完成日期：2014年1月10日第1章总体设计方案01.1设计原理01.2设计思路11.3设计环境2第2章详细设计方案22.1总体方案的设计与实现32.1.1总体方案的逻辑图32.1.2器件的选择与引脚锁定32.1.3编译、综合、适配42.2功能模块的设计与实现42.2.1 一位全加器的设计与实现52.2.2 4位输入端加法器的设计与实现62.2.3阵列乘法器的设计与实现9第3章硬件测试123.1编程下载123.2硬件测试
2、与结果分析12参考文献14附录（电路原理图）15第1章 总体设计方案1.1设计原理阵列乘法器采用类似人工计算的方法进行乘法运算。人工计算方法是用乘数的 每一位去乘被乘数，然后将每一位权值对应相加得出每一位的最终结果。如图 1.1所示，用乘数的每一位直接去乘被乘数得到部分积并按位列为一行，每一行 部分积末位与对应的乘数数位对齐，体现对应数位的权值。将各次部分积求和， 即将各次部分积的对应数位求和即得到最终乘积的对应数位的权值。为了进一步提高乘法的运算速度，可采用大规模的阵列乘法器来实现，阵列 乘法器的乘数与被乘数都是二进制数。可以通过乘数从最后一位起一个一个和被 乘数相与，自第二位起要依次向左移
3、一位，形成一个阵列的形式。这就可将其看 成一个全加的过程，将乘数某位与被乘数某位与完的结果加上乘数某位的下一位 与被乘数某位的下一位与完的结果再加上前一列的进位进而得出每一位的结果， 假设被乘数与乘数的位数均为4位二进制数，即m=n=4,AXB可用如下竖式算出， 如图1.1所示。X4 X3 X2 X1 =AXY4 y3 y2 Y1 =B（进位）X4Y4X3Y4X Y XY X Y X Y 4 13 12 11 1XY X Y XY X Y 4 23 22 21 2XY XY XY XY4 33 32 31 3X2Y4 X1Y4Z8Z7Z6Z5Z4Z3 Z2Z1图1.1 AXB计算竖式X4 ,X
4、3 ,X2 ,X1 ,Y4,Y3 ,Y2，l为阵列乘法器的输入端，Z1匕为阵列乘法器的输出端，该逻辑框图所要完成的功能是 实现两个四位二进制既A(X)*B(Y)的乘法运算，其计算结果为C(Z)(其中A(X)=XXXX，B(Y)二YYYY， 4 3 2 14 3 2 1C(Z)=ZZZZZZZZ而且输入和输出结果均用二进制表示)。阵列乘法器的总原 8 7 6 5 4 3 2 1理如图1.2所示。X1Z1X2Z2X3Z3X4Z4Y1Z5Y2Z6Y3Z7Y4Z8图1.2阵列器的总原理图1.2设计思路(1) 整体部分：阵列乘法器采用的是先逐位求解部分积，本课程设计要完成X与Y的乘法运算(X=X X X
5、 X ,Y=Y Y Y Y )，采用自上而下的设计方法，顶层设计 4 3 2 14 3 2 1采用8输入和8输出的一个自设置芯片，芯片部封装16个模块，构成4x4的乘法阵列，如图1.3所示，阵列的每一行送入乘数Y的每一位数位，而各行错开形0Y351342成的每一斜列则送入被乘数的每一数位。图1.3阵列乘法器4X4阵列进位，出部分积入0Yi进位入0 X1 , 0 X2 X3 / 08Y167&全加XiY20部分积出Y4(2) 单元部分：设计整体框图中的每一个细胞模块实现的功能是计算部分积 和向高位的进位。(3) 仿真部分：将整个电路连接好以后即可进行仿真，用以验证设计是否 正确。主要需要仿真的部
6、分有：一位全加器、4输入加法器以与整体电路图。（4）采用硬件描述语言进行电路设计并实现给定的功能，设计的原理图经 编译、调试后形成*.bit文件并下载到XCV200可编程逻辑芯片中，经硬件测试 验证设计的正确性。阵列乘法器是由十六个模块组成，每一个模块构包括一个与门和一位全加 器。具体的各个模块的设计在模块设计中一一呈现。1.3设计环境（1）硬件坏境：伟福COP2000型计算机组成原理实验仪、XCV200实验板、 微机。具体容如下：COP2000实验仪：COP2000计算机组成原理实验系统由实验平台、开关电源、 软件三大部分组成实验平台上有寄存器组R0-R3、运算单元、累加器A、暂存器 B、直
7、通/左移/右移单元、地址寄存器、程序计数器、堆栈、中断源、输X输出 单元、存储器单元、微地址寄存器、指令寄存器、微程序控制器、组合逻辑控制 器、扩展座、总线插孔区、微动开关/指示灯、逻辑笔、脉冲源、20个按键、字 符式 LCD、RS232 口。XCV200实验板：在COP2000实验仪中的FPGA实验板主要用于设计性实验 和课程设计实验，它的核心器件是20万门XCV200的FPGA芯片。用FPGA实验 板可设计8位16位和32位模型机（2）软件坏境：Xilinx foundation f3.1设计软件、COP2000仿真软件。 Xilinx foundation f3.1是Xilinx公司的可
8、编程期间开发工具，该平台功能强 大，主要用于百万逻辑门设计。该系统由设计入口工具、设计实现工具、设计验 证工具三大部分组成COP2000集成开发环境是为COP2000实验仪与PC机相连 进行高层次实验的配套软件，它通过实验仪的串行接口和PC机的串行接口相 连，提供汇编、反汇编、编辑、修改指令、文件传送、调试FPGA实验等功能， 该软件在Windows下运行。第2章详细设计方案2.1总体方案的设计与实现本课设采用自上而下的设计方法，其顶层方案图实现4X4位阵列乘法器的 逻辑功能，采用原理图设计输入方式完成，把16个细胞模块封装在自设置的芯 片，电路实现基于XCV200可编程逻辑芯片。在完成原理图
9、的功能设计后，把输 入/输出信号安排到XCV200指定的引脚上去，实现芯片的引脚锁定，即在每一个 IPAD与OPAD都锁定一个引脚。2.1.1总体方案的逻辑图顶层图形文件主要由四位被乘数输入端(X X X X )、四位乘数输入端(Y Y Y Y ) 4 3 2 14 3 2 1和八位乘积输出端(ZZZZZZZZ)。 8 7 6 5 4 3 2 14X4阵列乘法器总设计框图可利用Xilinx foundation f3.1模块实现顶层 图形文件的设计，顶层图形文件结构如图2.1所示。U ILOOP33LOCP34L：C=P-5LOOP36L：C=P-8LOOP39L：C=PL0tP41.1L/A
10、、加TT1硕0-S.T134ur/例HEUFIMIF.MIF.0.IIFAIIMIFfJIM.IIFAIEIsiELFELF:EIFHI/_SpadS3/_OPADSt/_EE/_SPADLCC=P-_QC=P9DLOC=P10?_QC=P1D8_QC=P1D9昼_:叫LCC=P1UAC DP ?FILE=ADD11.SCH图2.1 4X4阵列乘法器总设计框图2.1.2器件的选择与引脚锁定(1) 器件的选择硬件设计环境以伟福COP2000型计算机组成原理实验仪和XCV200实验板为 硬件平台，采用Xilinx foundation f3.1设计工具和COP2000仿真软件。(2) 引脚锁定把顶
11、层图形文件中的输入/输出信号安排到Xlinx XCV200芯片指定的引脚上去，实现芯片的引脚锁定，各信号与Xlinx XCV200芯片引脚对应关系如表2.1 所示。表2.1信号和芯片引脚对应关系阵列乘法器部信号原理图中的信号XCV200芯片引脚Y4YY4P41Y3YY3P40Y2YY2P39Y1YY1P38X4XX4P36X3XX3P35X2XX2P34X1XX1P33Z8ZZ8P125Z7ZZ7P124Z6ZZ6P109Z5ZZ5P108Z4ZZ4P107Z3ZZ3P99Z2ZZ2P93Z1ZZ1P782.1.3编译、综合、适配利用Xilinx foundation f3.1对顶层图形文件进
12、行编译、综合、优化、逻 辑分割、适配和布线，生成可供时序仿真的文件和器件下载编程文件。2.2功能模块的设计与实现4X4阵列乘法器的每一个模块都是由一个两输入与门和一个全加器组成的，设 计时将与门和全加器使用原理图输入设计方式实现阵列乘法器一个模块的功能。 下面分成三大块：由小单元器件模块到最终阵列乘法器大功能模块（其中包括： 功能表，仿真图）2.2.1 一位全加器的设计与实现2.2.1.1功能描述一位全加器指两个多位二进制数中的某一位的加法运算电路，其输入变量有 3个：被加数XN、加数YN、低一位的进位输入CIN；输出变量有2个：产生的和 FN和进位输出COUT。一位全加器的真值表如表2.1所
13、示。表2.2 一位全加器真值表XNYNCINCOUTFN0000000101010010111010001101001100011111由表可写出逻辑表达式如下：COUTN=(YN)，(CIN)(XN)，+(XN)，(CIN)，(YN)+(YN)，(CIN)，(XN)+(YN)(CIN)(XN)FN=(YN)(CIN)(XN)，+(XN)(CIN)(YN)，+(YN)(XN)(CIN)，+(YN)(CIN)(XN)化简结果如下：COUTN=(XN)(YN)+CIN(XNYN)FN二XNYNCIN2.2.1.2电路图根据逻辑表达式的化简结果可得一位全加器的逻辑图，如下图2.2所示：一位全加器可以
14、由两个与门，三个异或门与一个或门构成，XN,YN,CIN分 别表示乘数与被乘数的一位二进制数和来自低位的进位。2.2.1.3功能仿真仿真调试主要验证设计电路逻辑功能、时序的正确性，用高电平代表输入的 二进制数为1，低电平代表输入的二进制数为0，本设计中主要采用功能仿真方 法对设计的一位全加器电路进行仿真。（1）建立仿真波形文件与仿真信号选择:功能仿真时，首先建立仿真波形文件，选择仿真信号，对选定的输入信号设置参数，选定的仿真信号和设置的参数如功能表2.1所示。尸przr1-J-_r口U2.COUT 一 .1JZ .FNU2.KN -U2.YN -U2.CIN图2.3 一位全加器的功能仿真图（2）功能仿真结果与分析上图2.3是一位全加器的功能仿真波形结果，而仿真数据结果如表2.1所示， 当输入分别为000、001、010、011、100、101、110、111时，相对应的输出分 别为00、01、01、10、01、00
