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1、本科生期末试卷（四）一、选择题（每小题1分，共15分）1 运算器的核心功能部件是（ ）。A 数据总线 B ALU C 状态条件寄存器 D 通用寄存器2 某单片机字长32位，其存储容量为4MB。若按字编址，它的寻址范围是（）。A 1MB 4MBC 4MD 1MB3 某SRAM芯片，其容量为1MX8位，除电源和接地端外，控制端有E和R/W#，该芯 片的管脚引出线数目是（ ）。A 20B 28C 30D 324 双端口存储器所以能进行高速读/写操作，是因为采用（ ）。A高速芯片B新型器件 C流水技术D两套相互独立的读写电路5 单地址指令中为了完成两个数的算术运算，除地址码指明的一个操作数以外，另一
2、个数常需采用（ ）。A堆栈寻址方式 B立即寻址方式 C隐含寻址方式D间接寻址方式6 为确定下一条微指令的地址，通常采用断定方式，其基本思想是（ ）。A用程序计数器PC来产生后继微指令地址B用微程序计数器APC来产生后继微指令地址C通过微指令顺序控制字段由设计者指定或由设计者指定的判别字段控制产生后继微 指令地址D通过指令中指定一个专门字段来控制产生后继微指令地址7 微程序控制器中，机器指令与微指令的关系是（ ）。A 每一条机器指令由一条微指令来执行B 每一条机器指令由一段用微指令编成的微程序来解释执行C 一段机器指令组成的程序可由一条微指令来执行D 一条微指令由若干条机器指令组成8 CPU中跟
3、踪指令后继地址的寄存器是（）。A地址寄存器B程序计数器C指令寄存器D通用寄存器9 某寄存器中的数值为指令码，只有CPU的（）才能识别它。A 指令译码器B 判断程序C 微指令D 时序信号10 为实现多级中断，保存现场信息最有效的方法是采用（ ）。A 通用寄存器B 堆栈C 主存D 外存11 采用DMA方式传送数据时，每传送一个数据，就要占用一个（）的时间。A 指令周期B 机器周期C 存储周期D 总线周期12 将IEEE1394串行标准接口与SCSI并行标准接口进行比较，指出下面陈述中不正确 的项是（ ）。A前者数据传输率高B前者数据传送的实时性好C前者使用6芯电缆，体积小 D前者不具有热插拔能力1
4、3 下面陈述中，不属于虚存机制要解决的问题项是（ ）。A调度问题B地址映射问题C替换与更新问题D扩大物理主存的存储容量和字长14 进程从运行状态转入就绪状态的可能原因是（ ）。A被选中占有处理机时间B等待某一事件发生C等待的事件已发生D时间片已用完15 安腾处理机的一组指令中，可以并行执行的指令是（ ）。A Id8 r1=r3B add r6=r8,r9 C SUB r3=r1,r4 D add r5=r3,r7二、填空题（每小题2分，共20分）1 计算机系统的层次结构从下至上可分为五级，即微程序设计级（或逻辑电路级）、 一般机器级、操作系统级、（汇编语言）级、（ 高级语言）级。2 十进制数在
5、计算机内有两种表示形式：（字符串 ）形式和（ 压缩十进制串） 形式。前者主要用在非数值计算的应用领域，后者用于直接完成十进制数的算术运算。3 一个定点数由符号位和数值域两部分组成。按小数点位置不同，定点数有（ 纯小 数 ）和（ 纯整数）两种表示方法。4 对存储器的要求是容量大、速度快、成本低，为了解决这三方面的矛盾，计算机采 用多级存储体系结构，即（高速缓冲存储器 ）、（主存储器 ）、（ 外存储器）。5 高级的DRAM芯片增强了基本DRAM的功能，存取周期缩短至20ns以下。举出三种高级 DRAM 芯片，它们是（FPM-DRAM ）、（ CDRAM ）、（ SDRAM ）。6 一个较完善的指令
6、系统，应当有（完善性 ）、（ 有效性） 、 （规整性 ）、 （ 兼容性 ）四大类指令。7 机器指令对四种类型的数据进行操作。这四种数据类型包括（地址 ）型数据（、 数 值 ）型数据、（ 字符）型数据、（逻辑）型数据。8 CPU中保存当前正在执行的指令的寄存器是（指令寄存器IR ），指示下一条指 令地址的寄存器是（程序计数器PC ），保存算术逻辑运算结果的寄存器是（数据缓冲寄 存器DR ）和（通用寄存器 ）。9 虚存系统中，通常采用页表保护、段表保护和键保护以实现（存储区域 ）保护。10 安腾体系结构采用分支推断技术，将传统的（“if-then-else”）分支结构转变为无分支的（顺序/并行 ）
7、代码，避免了错误预测分支而付出的代价。三、简答题（每小题8分，共16分）1 PCI总线中三种桥的名称是什么？简述其功能。解：PCI总线中三种桥的名称分别是HOST总线/PCI桥（简称HOST桥）、PCI/PCI桥和 PCI/LEGACY 总线桥。桥是一个总线转换部件，可把一条总线的地址空间映射到另一条总线的地址空间上，从而使 系统中任意一个总线主设备都能看到同一份地址表。桥有信号的缓冲能力和信号电平转换功 能。它还可以完成规程转换、数据快存化、装拆数据分组等2安腾处理机采用的6种增强并行性功能的技术措施是什么？解：1显示并行指令计算技术2超长指令字技术3分支推断技术4推测技术5软件流水技术6.
8、寄存器堆栈技术四、证明题(12分)设|x| (2n-1), |y| (2n-1), |x+y| (2n-1)求证：x补 +y补二x+y补(mod 2n+1)五、计算题(10分)设存储器容量为64M字，字长为64位，模块数m=8,分别用顺序和交叉方式进行组 织。存储周期T=100ns,数据总线宽度为64位，总线传送周期=50ns。求：顺序存储器和交叉存储器的带宽各是多少？解：顺序存储器和交叉存储器连续读出m=8个字的性息总量都是Q=64bx8=512b顺序存储器和交叉存储器连续读出4个字所需的时间分别是：t2 = mT=8x100 ns=8x10 人-7st1=T+(m-1)t=100 ns+7
9、x50 ns=4.5x10 人-7s顺序存储器和交叉存储器的带宽分别是：W2=q/t2 = 512b/(8x10人-7) s=640Mb/sW1=q/t1 = 512b/(4.5x10 人-7)s=1137.8Mb/s六、分析题（12分）一种二进制RS型32位的指令结构如下:竹位 3位竹位17位0P通用寄存器其中0P为操作码字段，X为寻址模式字段，D为偏移量字段，其寻址模式定义为有 效地址E算法及说明列表如下：寻址方式寻址方式X有效地址E算法说明(1)000E=D001E=(PC)+EPC対程序计数器010E=(R2)+DR?盅变址寄存爲011E=(Rl)+DR1为基址寄存器100E=(D)1
10、11请写出6种寻址方式的名称。解：1直接寻址方式2相对寻址方式3变址寻址方式4基址寻址方式5间接寻址方式6寄存器间接寻址方式七、设计题（15分）CPU的数据通路如图1所示。运算器中R0R3为通用寄存器,DR为数据缓冲寄存器, PSW为状态字寄存器。D-cache为数据存储器，I-cache为指令存储器，PC为程序计数器（具 有加1功能），IR为指令寄存器。单线箭头信号均为微操作控制信号（电位或脉冲），如 LR0表示读出R0寄存器，SRO表示写入R0寄存器。机器指令“LDA（R3）,R0”实现的功能是：以（R3）的内容为数存单元地址，读出数 存该单元中数据至通用寄存器R0中。请画出该取数指令周期流程图，并在CPU周期框外写 出所需的微操作控制信号。（一个CPU周期有T1T4四个时钟信号，寄存器打入信号必须 注明时钟序号）S) iCPU的呦虎狙跖
