【2017年整理】第3章单元测试答案

上传人:爱****1 文档编号:948524 上传时间:2017-05-23 格式:DOC 页数:4 大小:217KB
返回 下载 相关 举报
【2017年整理】第3章单元测试答案_第1页
第1页 / 共4页
【2017年整理】第3章单元测试答案_第2页
第2页 / 共4页
【2017年整理】第3章单元测试答案_第3页
第3页 / 共4页
【2017年整理】第3章单元测试答案_第4页
第4页 / 共4页
亲,该文档总共4页,全部预览完了,如果喜欢就下载吧!
资源描述

《【2017年整理】第3章单元测试答案》由会员分享,可在线阅读,更多相关《【2017年整理】第3章单元测试答案(4页珍藏版)》请在金锄头文库上搜索。

1、第三章单元测试答案一、单选 (5 分)1. TTL 逻辑电路是以( A)为基础的集成电路 A. 三极管 B. 二极管 C.场效应管 D.晶闸管2. CMOS 逻辑电路是以( D )为基础的集成电路A. 三极管 B. NMOS 管 C. PMOS 管 D. NMOS 管和 PMOS 管3. 能实现“线与”逻辑功能的门为( B)A. TTL 三态门 B. OC 门 C. TTL 与非门 D. TTL 或非门4. 能实现总线连接方式的门为(A )A. TTL 三态门 B. OC 门 C. TTL 与非门 D. TTL 或非门5. TTL 电路的电源电压值和输出电压的高低电平值依次为( A)A. 5V

2、、3.6V、0.3V B. 10V、3.6V、0.3V C. 5V、1.4V、0.3V D. 5V、3.6V、1.4V二、判断题 (10 分)1. 在 TTL 类电路中,输入端悬空等于接高电平( A)。 A. 对 B. 错2. 在 CMOS 类电路中,对未使用的输入端可以悬空( B)。A. 对 B. 错3. 对于 TTL 与非门,只要有一个输入为低电平,输出为高电平,所以对与非门多余输入端的处理不能接低电平( A)。A. 对 B. 错4. 或非门的多余输入端不能接高电平( A)。A. 对 B. 错5. TTL 门电路输出端不能直接接电源,必须外接电阻后再接电源( A)。A. 对 B. 错6.

3、OC 门和普通 TTL 门均可实现“线与”功能( B)。A. 对 B. 错7. CMOS 门电路可以把输出端并联使用以实现“线与”逻辑( B)。A. 对 B. 错8. TTL 与非门输入端接+5V 时,逻辑上属于输入“1”( A)。A. 对 B. 错9. 三态门电路能控制数据进行单向、双向传递( A)。A. 对 B. 错10. 基本型的 TTL 门电路输出端不允许相互并联,否则将损坏器件( A)。A. 对 B. 错三、集成门电路(不论是与、或、与非等)的输入端若超过了需要,则这些多余的输入端应按哪种方式去处置才是正确的? (3 分) 答案:DA让它们开路;B让它们通过电阻接最高电平(例如电源电

4、压) ;C让它们接地,或接电源的最低电平;D让它们和使用中的输入端并接。 四、 题图是两个用 74 系列门电路驱动发光二极管的电路,要求 VI=VIH 时发光二极管 D 导通并发光 。已知发光二极管的导通电流为 10mA,试问应选用(a)、(b)中的哪一个电路?请说明理由。 (6 分) (a)(a) (b) 五、试分别写出由 TTL 门和 CMOS 门构成的如图所示逻辑图的表达式或逻辑值。(6 分)&VCCRDVI&VIDR& &ABF1 0 k 解:由 TTL 门组成上面逻辑门由于 10k 大于开门电阻 RON,所以,无论 A、B 为何值 F=0 。 (3 分)由 CMOS 门组成上面逻辑门

5、由于 CMOS 无开门电阻和关门电阻之说,所以, F=AB 。 (3 分)六、判断题图所示电路中 MOS 管的工作状态。其中 RD=10k,R G=10k。设MOS 管子的开启电压 VTN=2V。 (3 分)(a)、(b) 导通 (c) 截止 每问一分(a) (b) (c)七、已知 TTL 反相器的电压参数为VOFF=0.8V,V OHmin=3V,V TH=1.4V,V ON=1.8V,V OLmax=03V,V CC=5V,试计算其高电平噪声容限 VNH 和低电平噪声容限 VNL。 (5 分)VNH=3-1.8=1.2V (3 分) VNL=0.8-0.3=0.5V (2 分)八、欲使一个

6、逻辑门的输出 vO,能作为它的另一个门输入 vI,良好地驱动它,则其高、低电平值必须满足下述那个条件。 (2 分) DAV OHV IH 和 VOLV IL; BV OHV IH 和 VOL VIL;CV OHV IH 和 VOLV IL; DV OHV IH 和 VOLV IL九、题图所示两条门电路的电压传输特性,是在相同电源电压下(+5V)测得的,由此可看出实线为什么门电路;而虚线则又为什么门电路? (4 分)实-CMOS 非门 虚-TTL 非门十、 图所示逻辑门均为 CMOS 电路,写出各电路输出的逻辑表达式。 (8分)1 0 0 k VD D= 1 0 VABCDEF1&( a )AB

7、CDEF2 1( b )ABCDEFF3( c )&11ABCDEFF4RR( d )图 2 - 2 0 C M O S 电路逻辑图VD D= 1 0 V解:由题中给定逻辑图写出(a) (2 分)(b) (2 分)(c) (2 分) 20511 2 3434 5VO/VVI/VBAF1ED2FC3BAF4VDDRD YVDDRD YVDDRD YRG(d) (2 分) 十一、门电路组成的电路如题图所示,请写出 F1、F 2 的逻辑表达式。当输入图示信号波形时,画出 F1、F 2 端的波形。 (14 分)C=0,F1=AB ; C=1,F1=B F1=ABC+BC=AB+BC (4 分)C=0,

8、F2=A B;C=1 ,F2=B1=B F2=(AB)C+BC=m(1,2,4,5) (4 分)F1 图 (3 分)F2 图 (3 分)十二、TTL 门电路如题图所示,已知门电路参数 IIH/IIL=25A /-1.5mA,I OH/IOL=-500A/12mA 。 (6 分)() 求门电路的扇出系数 NO;() 若电路中的扇入系数 NI 为 4,则扇出系数 NO 又应为多少?答案:(1)NOH=500/2*25=10 NOL=12/1.5=8 NO=8 (3分)(1)NOH=500/4*25=5 NOL=12/1.5=8 NO=5 (3分) 十三、TTL3000 系列芯片的部分输入级电路如题

9、图所示。 (18 分)() 分别说明图中二极管 D1、D 2 的作用。() 电路的输入短路电流 IIS 为多少?() 若已知电路的 VOFF=0.8V,求电路相应的关门电阻 ROFF 值。() 令电路中 A 端为 3.6V,B 端接 500 电阻,用电压表测得 VB 的值,应为多少伏?() 若令 A 端接 0.3V,B 端仍接 500 电阻,则测得的 VB 应为多少伏?解:(1)输入端保护作用 (3 分)(2)I IS=(5-0.7)/3=1.43mA (3 分)(3)(5-0.7)R/R+3=0.8 ROFF=0.69k (4 分)(4)V B=(5-0.7)0.5/(3+0.5)=0.61

10、V (4 分)(5)V B=0.3V (4 分)十四、现有 5 个集电极开路的 TTL 门构成的线与输出系统,并带有同类门 6个作负载,如题图所示。已知VOH=2.4V,V OL=0.4V,I OH=250A,I OL=16mA,I IH=40A,I IL=1.6mA,V CC=5V试选择合适的电阻 RC 值 (12 分)&GnG1GpIILIOHG1G2G5G6G7G11RCVCC=+5IOLIIHIOHIIHIOHIILIIHIIL FF1&A1CB&ENTTLABCACB1ENTTL=1 F23k+5VA B D1 D2RLmax=1.7K (6 分)RLmin=0.72k (6 分)十四、写出图中的各个逻辑电路的输出 F1、F 2、F 3 的逻辑表达式或真值表。CF11A( a )VD DABT GF2( b )11T GF3= 1A( c )图 2 - 1 4 M O S 门电路逻辑图VD D解:图(a) 的 C=1 时,最上面的 PMOS 管和最下面的 NMOS 管都导通, AF1。C =0 时,最上面的 PMOS 管和最下面的 NMOS 管都不导通,输出 F呈现高阻态。图(b)的 A=1 时,传输门导通,MOS 管不导通, BF2。A=0 时,传输门截止,MOS 管导通,构成 CMOS 非门,此时 。图(c)的传输门始终导通, AF13。

展开阅读全文
相关资源
正为您匹配相似的精品文档
相关搜索

最新文档


当前位置:首页 > 行业资料 > 实验/测试

电脑版 |金锄头文库版权所有
经营许可证:蜀ICP备13022795号 | 川公网安备 51140202000112号