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1、 MC68HC11F1l中文翻译资料资源：1512B EEPROM2.1024 RAM3.非复用的地址线和数据线4.增强的16位定时器5.3路捕捉输入通道6.4路输出比较通道7.外加一路通道作为第4路输入或第5路输出8. 8位脉冲蓄电池9.实时中断电路10.看门狗11.增强的异步非归零(NRZ)码串行通信接口(SCI)12.增强型同步串行外设接口(SPI)13.8通道A/D转换器14.四片选信号输出,具有可编程时钟伸展 -两个I/O片选 -一个可编程片选 -一个通用片选 15.68针的PLCC和80针的QFP封装引脚说明： 1. VDD和VSS5V工作电压,旁路电容使供电更稳定2. Reset
2、 (pin50) 低电平控制信号,内部时钟监视器或看门狗都可以导致复位,外部则通过外部RC电路产生一个大于两个时钟周期的上电电平来产生3. E-Clock Output(E-pin34) 输出时钟信号,从E输出的信号作为一个时钟基准,频率是EXTAL脚输入的1/4.一个内部进程发生时,E脚将输出低电平.当为高电平时,数据正在被访问.当MCU牌停止模式时所有的时钟都会被停止.单芯片模式下,关闭E脚以减少低频干扰. 4. crystal Driver and External Clock Input (XTAL,EXTAL)这两个引脚提供了无论是晶振或CMOS兼容的时钟去控制内部的时钟发生电路，无
3、论是晶振或CMOS兼容的时钟都可以使用。由此产生的的时钟频率是输入的1/4.在有外部时钟接到EXTAL脚时,XTAL通常是悬空的.然而,用10K到100K的负载电阻连接到地可以减小低频干扰噪声.XTAL的输出通常用来驱动一个晶振,XTAL输出可以作为一个高阻抗的缓冲,也可以用于驱动另一个EXTAL输入的M68HC11设备.参考图2-65. Four Times E-Clock Frequency Output提供额外的4倍时钟周期,可直接驱动另一个M68HC11的EXTAL引脚.(参考 图2-7)4XOUT在上电复位后可以使用,在清寄存OPT2的CLK4X位时被禁止. 6. 中断请求(IRQ)
4、 通过IRQ向CPU生产一个异步中断请求,无论是固下降沿或低电平触发的,都对寄存器OPTION中的IRQE置位.IRQ默认配置为低电平触发.当IRQ被用于一个线或的情况下,通常连接一个4.7K的上拉电阻到VDD.参考SECTION 5 RESETS AND INTERRUPTS.7. 非屏蔽中断(XIRQ)XIRQ在复位初始化后提供一种非屏蔽中断请求手段,在复位时,任务何中断屏蔽都会导致条件码寄存器(CCR)的X位被置位,直到软件修改.因为XIRQ是级别敏感的,它可以通过一个上拉电阻到VDD连接到一个多远元的线或网络,XIRQ通常用于电源漏电检测中断.无论何时,当XIRQ或IRQ用于多个IRQ
5、中断源的时候(IRQ必需配置成级别敏感),第个中断源必需用一个开漏的驱驱来驱动中断输入,从而避免在输出的时候连接上.应该有一个单一的上拉电阻在MCU的中断输入引脚 (通常为4.7K),必需有一套机制,使中断源的中断线保持低电平,直到MCU接受了并回复应该中断请求.,如果一个或多个中断源在向MCU申请中断服务请求后依然挂起,中断线将会仍然被保持低电平,一旦CCR的掩膜位被清后(通常是在中断返回后),MCU将会再次被中断.8. MODA and MODB (MODA/LIR AND MODB/Vstby)复位期间,MODA和MODB被设置成4种操作模式中的一种.操作模式被设定后,LIR脚提供一个开
6、漏输出以表明指令正在执行.LIR脚只用于线与操作(只有拉低).在每条指令执行时出现一系列的时钟周期.LIR信号在执行每一个指令的第一个时钟周期时被打断.这个输出为程序调试的时候提供.Vstby用于为RAM输入备用电源,MCU由VDD供电,除非Vstby和VDD间的电压差值大于0.7V.当这个电压差超过0.7V时,768字节的内部RAM和复位逻辑的一部份由Vstby供电,而不是VDD.9. Vrh 和Vrl 这些引脚用于为模数转换器提供参考电压.使用旁路电容可以减小这些信号的噪声.任何在Vrh和Vrl引脚上的噪声都会直接影响A/D的精度.当为逻辑电平0时表明正在进行写操作,任何外部设备都不应该1
7、0. R/W用于扩展和测试模式,R/W表明了外部数据总线的传输方向.当为逻辑电平1时表明,正在进行读操作.,任何外部设备都不能驱动总线为数据总线.时钟可以用于在读总线周期的后半周使外部设备驱动数据到总线上.R/W可以用于控制数据的传输方向.R/W为低时,数据被写到外部数据总线.连续在数据总线数据写入时,R/W会仍处于低电平,例如发生双字节存储.11. Port Signals 端口信号. MC68HC11F1的54针安排了6组8位的接口:A,B,C,D,E,F,G.还有一组6位的接口D.这7组接口的功能,取决于其外围接口或者操作模式的设定.注:B,C,F的I/O功能只有在单芯片和引导模式下才可
8、用.A,C,D,G是准双向接口.B和F只作输出端口.E只作输入端口. 12. Port A Port A是有数据寄存器PORTA和数据方向寄存器DDRA的8位通用I/O口.Port A引脚与16位定时器系统共享功能.PORTA在任何时候都可以进行读操作. Inputs return the pin level; outputs return the pin driver input level.输入返回引脚状态,输出返回引脚的驱动输入状态.当进行写操作时,PORTA将会存储在内部的数据锁存器中.该驱动仅当它们被配置为输出引脚.当配置为定时器输出比较引脚时,对PORTA进行写操作不会改变引脚的状
9、态.复位后,PORTA的引脚则为通用的高阻抗输入.当相关引脚的定时器功能被禁止后,DDRA上相应的位会管理相关I/O的状态.13. PORTB PORTB是一个8位的只输出接口.在单芯片模式下,该接口是一个通用输出引脚,在扩展模式下,B接口作为地址线的高8位.B接口可在任何情况下进行读操作,读操作时将返回引脚的输入准状态.如果被写,数据则会存储到内部的锁存器中.引脚在单芯片或引导模式下使用.在扩展模式下,B接口被用作地址线的高8位输出.14. PORTC C接口是一组拥有数据寄存器PORTC和数据方向寄存器DDRC的一个8位通用的I/O口在单芯片模式下,C接口是一组通用IO口,扩展模式下,将会
10、被设置成数据总线.PORTC可以任何时候读取,输入返回引脚状态,输出返回引脚的输入状态.当PORTC被写时,数据将会储存在内部锁存器中.引脚只有在被设置成单芯片或引导模式下可用,C接口在单芯片模式或引导模式下的复位后,默认作为通用输入口扩展模式和测试模式下,这些引脚作为数据线.OPT2寄存器中的控制位CWOM会禁止C接口的P通道输出,设置CWOM将会引起C接口成为一个适合线与操作的开漏型的输出接口.在线与模式下,(PORTC的处于逻辑电平0),引脚将由N 沟道驱动为低.当一个C接口位处于逻辑低电平,相关的引脚都会处于高阻抗状态,无论是N沟道还是P沟道.通常在外部会有一个上拉电阻以便于驱动开漏设
11、备.C接口只有在MCU处于单芯片或引导模式下才能设置成线与操作. 15. PORTD接口D是一个通用的6位IO接口,有一个数据寄存器PORTD和一个数据方向寄存器DDRD.6条线可以用于通用I/O,用于串行通信接口和串行外接口.PORTD可在任何时候读取,输入返回引脚状态,输出返回引脚驱动输入状态.如果需 要对PORTD进行写操作,数据将会存储在内部锁存器中且只有在D接口设置用于通用输出.在SPCR中的DWOM控制位可以禁止D口的P沟道输出.由于N沟道不受DWOM控制,DWOM置1可将D接口变成一个适合线或操作的开漏型输出.在 线或 模式下,(PORTD各个位处于逻辑0),引脚让N沟道驱动为低
12、.当D接口中某一位处于逻辑1时,相关的引脚将处于高阻抗状态,无论是N沟道还是P沟道都将激活.通常会外部一个上拉电阻以便于驱动开漏设备.D接口可以任意工作模式下设置成 线或16. PORT EE接口是一个只输入的8位接口,同样也可以用于输入模拟量用于模数转换器.E接口引脚不用于A/D系统时可用于普通的输入口.然而, 在A/D转换期间,PORTE不能进行读操作. 17. PORT FF口为一8位只输出接口,在单芯片模式下,F的引脚是通用输出引脚,在扩展模式下,F接口作为低位的地址线输出.18. PORT GG接口是一个通用8位I/O.4 个片选信号作为G接口各位的交错功能.PORTG可任何时候读取
13、.输入返回引脚状态,输出返回引脚驱动的输入状态.当PORTG在写的时候,数据将存储在内部锁存器中.该驱动只对相应的引脚设置为输出引.OPT2中的GWOM控制位禁止G接口的P沟道驱动输出.由于N沟道的驱动不受GWOM影响,对GWOM置1可将G口变成一个适合线或操作的开漏输出接口.在线或模式中,(PORTG各位处于逻辑0),引脚被N沟道驱动器拉低.当某一个G的位处于逻辑1时,相关的位将处于高阻抗状态,无论N沟道还是P沟道都将被激活.通常会有一个上拉电阻以便于驱动开漏设备.G口在任意模式下都可以设置成线或操作模式.CPU控制寄存器.1,累加器A.B累加器A和B是用于装算术运算的操作数和结果的通用8位
14、寄存器.在一些指令中,这两个寄存器将当成一个双字节的累加器D,虽然多数年指令可以交替地使用累加器A和B.以下情况例外:ABX和ABY指令加8位累加器B的内容到16位寄存器X或Y,但没有等效的指令可以用A代替BTAP和TPA指令从累加器A传送数据到条件码寄存器,或者从条件码寄存器到累加器A,然而,没有等效的指令可以用代替A十进制调整累加器A(DDA)指令用在二进制编码(BCD)算术运算后.但没有等效的BCD指令去调整累加器B.加减法,比较指令相关的A和B(ABA,SBA,CBA)只在一个方向运行,使得确保正确的操作在正确的累加器中显得十得分重2.索引寄存器IX IX提供了一个可以加上8位偏移量的
15、16位的索引值,即一个有效地址.IX同时也可以作为一个计数器或者一个暂时的存储寄存器.3. 索引寄存器IY 16位IY寄存器在执行索引功能时类似于IX寄存器.然而,大多数指令在使用IY去申请一个额外的机器码字节和一个额外的执行周期,因为because of the way the opcode map is implemented4.栈指针SP MC68HC11的CPU有一个自动的程序堆栈.该栈可以在地址空任何处查找得到,一般情况下SP的第一次初始化是一个应用程序的第一条指令做的.栈被设置为一个自高向低增长的数据结构.每当有一个新的字节被压入栈,SP都会自动地减1 .每次有一个字节的数据弹出,SP都会自动地加1 .在任何特定的时间里,SP都会指向下一个16位栈地址.当一个子程序跳转到另一个子程序或分支的指令,该指令后JSR或BSR的地址会自动压入堆栈,由最低的字节开始.当子程序完成后,从子程序(RTS)指令执行后返回,RTS弹出栈后从栈返回地址,并且加载到程序计数器中,从返回的地址中开始执行上一次的任务.当中断被认可后,当前的指令会先执
