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1、双稳态触发器和 时序逻辑电路,时序逻辑电路与输出状态不仅与输入变量有关，而且还与系统先前的状态有关。,时序逻辑电路的特点：,包括组合逻辑电路和具有记忆功能的电路或反馈延迟电路。 输入、输出之间至少有一条反馈路径。,触发器是时序逻辑电路的基本单元，是一种具有记忆功能的逻辑电路。能够储存一位二值信号。,第一斯密特触发器节 基本双稳态触发器,双稳态触发器的特点：, 具有两个能自行保持的稳定状态； 根据不同的输入信号可以置成“1”状态或“0”状态； 在输入信号消失后，如果没有新的信号输入，能够保持原状态，直至下一个新的信号输入为止。,基本RS 触发器,0,1,1,0,不 变,*不 定,RD0，SD=1
2、 触发器复位为0态，称RD为复位端；RD1，SD=0 触发器置位为1 态，称SD为置位端。,RD、SD同为1， 触发器保持原状态； RD、SD同为0，触发器状态无法确定，此情况应避免。,与非门组成的RS触发器为负脉冲有效。,基本RS触发器的约束条件是RDSD1,逻辑符号,负脉冲有效,基本RS触发器的优点：结构简单，具有记忆功能。,基本RS触发器的缺点：输出直接受输入控制，具 有不定状态。,第二节 钟控双稳态触发器,钟控RS 触发器J K 触发器D触发器TT 触发器触发器逻辑功能的转换触发器应用,一、钟控RS 触发器,为使触发器能按要求在某一时间翻转，外加一时钟脉冲CP来控制。,1,0,不定,C
3、P=0，,CP=1，,Qn,C、D门 被封锁；,复位端RD、置位端SD负脉冲有效，不受CP控制 。,CP1时，触发器才能翻转。CP控制触发器的翻转时刻，R、S控制触发器的翻转状态。钟控RS 触发器为正脉冲有效。,逻辑符号,钟控RS触发器的约束条件是RS0,例：已知钟控RS触发器（正脉冲有效）的输入信号RD、 R、S波形如图，试画出Q的波形。,Q,1,2,3,4,R,S,RD,例：由钟控RS触发器组成的T触发器如图所示，可完成计数功能，试分析其逻辑功能。,解：,RQ,可见，CP脉冲来一个，触发器翻转一次，即T触发器可记录CP脉冲个数。,要求CP脉冲宽度要小于触发器翻转所需时间，否则在一个CP作用
4、期间，触发器可能翻转多次，即“空翻”。,钟控RS触发器的CP对触发器的控制是在一个时间间隔内，而不是控制在某一时刻。,二、主从型J K 触发器,主从型J K 触发器由主触发器和从触发器组成，主触发器和从触发器时钟信号反相.,显然，输出状态在CP下降沿到达时改变。因此，这种触发器为下降沿触发。,0,1,Qn,复位端RD、置位端SD负脉冲有效，不受CP控制 。,主从型J K 触发器将触发器的翻转控制在CP下降沿这一时刻。主从型J K 触发器无不定状态，组成计数电路，可克服空翻。,主从型J K 触发器存在一次翻转的问题。即主触发器在CP1 期间只能翻转一次，要求J、K 状态在CP1期间不能变化。,逻
5、辑符号,负脉冲有效,下降沿触发,例：已知JK触发器（下降沿触发）的输入信号J、K 波形如图，试画出Q的波形（Q初始状态为0）。,Q,1,2,3,4,J,K,三、D触发器,0,1,D触发器仅在CP前沿到达时翻转，是边沿触发器。,逻辑符号,D 触发器无不定状态；克服空翻、一次翻转现象。,Q,D触发器的输出状态仅取决于CP上升 沿到达时刻输入的状态。,四、TT 触发器,T触发器,T 触发器,五、触发器逻辑功能的转换,JK D 触发器,JK T 触发器,D T触发器,D JK 触发器,例：已知各触发器的初态均为0，A、B、C 波形如图，试画出Q波形。,J,K,Q,第三节 寄存器,数码寄存器移位寄存器,
6、一、数码寄存器,寄存器是用于存放各种数码和指令的时序电路。由N个触发器组成的寄存器，能存储N位二进制代码。按功能分为数码寄存器和移位寄存器。,数码寄存器寄存数码时是从存入端同时存入，取出时又同时从取出端取出，所以又称为并行输入并行输出寄存器。,清零,寄存,取出,二、移位寄存器,移位寄存器按移位方向不同又分为左移、右移和双向移位三种。,1,1,0,1,0,0,1,1,1,常用寄存器集成电路,第四节 计数器,异步二进制计数器同步二进制计数器十进制计数器,计数器是统计输入脉冲个数的逻辑部件。除用于直接计数外，还可以用于定时、分频、产生节拍脉冲以及进行数字运算等等。,按计数功能分类,加法计数器,减法计
7、数器,可逆计数器,按数制分类,二进制计数器,二十进制计数器,按触发器翻转次序分类,同步式计数器,异步式计数器,一、异步二进制计数器,异步二进制加法计数器,0,012345670,0 0,0,0,1,0 1,0,1,1,1,1,1 0,0,0,0,0,1,1,1,0,0 0 0,1,1,J0K01,J1K11,J2K21,CP1Q0,CP2Q1,1,2,3,4,5,6,7,8,状态表,CP,时序图,1,2,3,4,5,6,7,8,Q2,Q0,Q1,若CP的频率为f0，则Q0、Q1、 Q2的频率分别为f02， f04， f08。所以计数器有分频作用。,一个触发器可表示一位二进制数，N个触发器可表示
8、N位二进制数，构成N位二进制计数器，也可称为2N进制计数器。可计（2N1）个脉冲，实现2N分频。,如：四触发器构成的计数器，称为2N16进制计数器。可计15个脉冲，实现16分频。,D触发器构成的异步二进制加法计数器,异步二进制减法计数器,J0K01,J1K11,J2K21,0,076543210,1,0,1 1,1,1,0,1 0,0 1,0,1,0,0,0 0,0,0,1,0 0 0,1,1,2,3,4,5,6,7,8,1,0,1,状态表,时序图,思考题：若用D触发器组成异步二进制减法计数器，应如何连接,二、同步二进制计数器,J0K01,J1K1Q0,J2K2 Q0 Q1,翻转条件： Q01
9、，F1翻转 Q0 Q1 1，F2翻转,触发器在满足翻转条件的情况下，CP脉冲到来时可同时翻转，其速度比异步式快。,三、十进制计数器,异步十进制计数器,J0K01,J2K21,J3 Q2 Q1 K31,CP1 CP3 Q0,CP2Q1,0,0 0 0,0,0,0 0 1,0,1,0 1,0 1 1,1,0 1 0,0,0,0,0,1,1,0,0 0 0 0,1,1,1,2,3,4,5,6,7,8,状态表,9,10,0,1,0,1,1,1 0 0,0,0,0,0,CP1 CP3 Q0,CP2Q1,0,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1
10、,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,0,0,0,0,0,1,1,0,0,1,1,1,1,1,1,1,1,0,0,CP,时序图,Q2,Q0,Q1,Q3,同步十进制计数器,J0K01,J2K2 Q0 Q1,J3 Q2 Q1 Q0 K31,例：在图示电路中，试列出状态表，并分析其逻辑功能。（原状态000）,J1 Q0,图示电路为同步计数器,K0Q1,K1Q2,0,0,1,1,0,1,0,0,1,0 0 0,1,1,1,2,3,4,5,0,0,0,1,1,0,0,0,0,1,1,0,0,0,0,0
11、,0,1,0,0,1,1,1,0,0,1,1,1,1,0,0,0,1,0,0,6,状态表,0,1,0,1,0,0,0,0,0,电路为同步六进制计数器,例：在图示电路中，试列出状态表，并分析其逻辑功能（原状态000）,J1K11,J2Q0Q1 K21,CP0 CP2 CP,CP1Q0,图示电路为异步计数器,状态表,0,0,0,1,0,1,0,0 0 0,1,1,1,2,3,4,0,1,0,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,1,0,0,1,0,1,1,1,1,0,0,0,0,0,5,0,电路为异步五进制加法计数器,第五节 集成计数器,T4293T4290,
12、T4293（二八十六进制计数器）,CP0、CP1为时钟输入端，R01、 R02为复位端，当R01 R0211时，计数器清零。,例：用T4293分别接成五、九进制计数器。,当用N进制计数器来完成M进制计数功能时(NM)，将输出端信号反馈到复位端，强迫计数器在顺序计数过程中越过(NM)个状态。,五进制,选用CP1为输入，Q3Q1为输出。,000001010 011 000 100,Q3接R01，Q1接R02 Q3 Q2 Q1101， R01 R021，复位,九进制,00001000 计数至1001，复位,选用CP0为输入， Q3Q0为输出。,Q3接R02，Q0接R01、CP1， Q3 Q011，R
13、01 R021，复位,T4290（二五十进制计数器）,CP0、CP1为时钟输入端，R01、 R02为复位端，S91、S92为置9端。 当R01R0211时，计数器清零；当S91S92 11时，计数器置9。,脉冲由CP0输入，Q0输出，为二进制； 脉冲由CP1输入，Q3 Q1输出，为五进制； 脉冲由CP0输入，Q3 Q0输出， CP1与Q0相接，为十进制。,常用计数器集成电路（TTL）,Q3 Q2 Q1 Q0 74LS90 CP1R02 R01 S92 S91 CP0,Q3 Q2 Q1 Q0 74LS90 CP1R02 R01 S92 S91 CP0,例：用T4290设计一个40进制计数器,40410,CP,十进制,四进制,例：用T4290设计一个48进制计数器,Q3 Q2 Q1 Q0 74LS90 CP1R02 R01 S92 S91 CP0,Q3 Q2 Q1 Q0 74LS90 CP1R02 R01 S92 S91 CP0,个位8，十位4,CP,个位,十位,
