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1、 组合逻辑电路设计(2降维图法降维图:将卡诺图的桅些变量也作为小方格内的值而得到的新的卡图记图变量,降维图小方格中的变量降维方法:若F(A、B、C、0-F(A、B、C、1)-0,则合并的小方格为0;若F(A、B、C、0-F(A、B、C、UD-L,则合并的小方格为1:若F(A、B、C、-0,F(A、B、C、D-L,则合并的小方格为D;若F(A、B、C、0)=1,F(A、B、C、D-0,则合并的小方格为/D;十(2降维图法00_0111_100|0|0|04技0001110|01|1C8E一E0|0川a2C30|0|PD+cD0|11|0a厂1|c|c+p0|11组合逻辑电路设计十【例1用一片8选
2、1数选器实现如下函数:F(A.B.C.D)=一、(L5.6.7.9.1112.13.14)F484一一A5BCDN_00011110茎_爻二G10|0|01|0酉EN|CN皿0L1101234567nb|D抖101|110111121e唐(卡诲图(0)阮维图图4219例4-7的陈维图图4-2-20用8选1MUX实现例4-7-弘组合逻辑电路设计十【例2】用8选1数选器实现如下函数:EF(A.B.C.D.E)=五、(0.13.9.1112.13.14.20.21.22.23.26.31)朐4848CP00011110CP00011110CD006111100110|0|000|11|0|00015|0061|00100111100o1|5|二|0口_11|010111|001111|01511H0|01011i0161F|10|0|4101E0E1卡语国(6)4变量阮维图484C0001T108010|D+5|E|0卯|001|0|B4B|p5|11()3变量陆维图组合逻辑电路设计十注意:仪选用不同的变量作记图变量其结果和复杂程度是不一样的即一题多解:如果只降维一次,则外围元件只需一个反向器,降维太多,外围电路将较复杂:诙法只适用于单输出函数。此语件下受可自行缘骗何改,供盘者!悦剩恩的盱特,我们务力健得更好1
