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1、111 级数字电路复习题及参考答案一、单选题1. 同或逻辑对应的逻辑图是( )。A. B. 1 C. 1 D.& 答案：A2. 在下列逻辑电路中，不是组合逻辑电路的是( ) 。A. 译码器B. 编码器C. 全加器D. 寄存器答案：D3. 用触发器设计一个同步十七进制计数器所需要的触发器数目是( ) 。A. 2B. 3C. 4D. 5答案：D4. 在下列各图中，或非逻辑对应的逻辑图是 ( ) 。A. B.C. D.答案：B5. 在何种输入情况下， “或非”运算的结果是逻辑“1” 。A. 全部输入是“0”B. 任意输入是“1”C. 仅一输入是“1”D. 全部输入是“1”答案：A6. 一个班级中有四
2、个班委委员，如果要开班委会，必须这四个班委委员全部同意才能召开，其逻辑关系2属于（ ）逻辑。 a.与； b. 或； c.非； d.与非答案： a7. 在一个四变量逻辑函数中， （ ）为最小项。a. ；b. ；c. ；d.ACDBACD()B答案：c8. 一个 4 路数据选择器，其地址输入（选择控制输入）端有（ ）个。A. 2 个B. 3 个C. 4 个D. 5 个答案：A9. 由与非门构成的基本 RS 触发器的输入端为 R、S ，则其约束条件为（ ） 。A. RS=0B. R+S=1C. RS=1D. R+S=0答案：A10. 在下列各图中，异或逻辑对应的逻辑图是（ ） 。A. & B. 1
3、C. 1 D.=1 答案：D11. JK 触发器在 CP 脉冲作用下，欲使 , 则对输入信号描述不正确的是( )。n+1Q=A. B. ，JK1JKC. ， D. ，=Q1答案：B12. 当异步置数端 时，输出状态是在 CP 由 1 变 0 时刻发生变化，且与 CP=1 期间输入状态IRSD变化无关，只取决于 CP 由 1 变 0 前瞬间输入状态而定的触发器是（ ） 。A. 基本 RS 触发器B. D 锁存器C. 同步 JK 触发器D. 负边沿 JK 触发器答案：D13. 时序逻辑电路中一定包含（ ） 。3A. 触发器B. 组合逻辑电路C. 移位寄存器 D. 译码器答案：A14. T 触发器的
4、状态方程是（ ） 。A. B.n+1nQ=n+1nQ=TC. D.答案：C15. 将 CMOS 或非门作如图所示连接，其输出 F=（ ） 。a.F=1 b.F=0 c. d.F=AFA答案： b16. 一个 16 路数据选择器，其地址输入（选择控制输入）端有（ ）个。A. 16 个B. 2 个C. 4 个D. 8 个答案：C17. 下列触发器中没有约束条件的是（ ） 。A. 基本 RS 触发器B. 主从 RS 触发器C. 钟控 RS 触发器D. 钟控 JK 触发器答案：D18. 一个 8 路数据选择器，其地址输入（选择控制输入）端有（ ） 。A. 1 个B. 2 个C. 3 个D. 4 个答案
5、：C19. 存在约束条件的触发器是（ ） 。A. 基本 RS 触发器B. D 锁存器C. JK 触发器D. D 触发器答案：A20. 一个 32 路数据选择器，其地址输入（选择控制输入）端有（ ） 。4A. 2 个B. 3 个C. 4 个D. 5 个答案：D21. 用代码代表特定信号或者将代码赋予特定含义的过程称为（ ） 。A. 译码B. 编码C. 数据选择D. 奇偶校验答案：B22. 组合逻辑电路一般由( )组合而成。A. 门电路B. 触发器C. 计数器D. 寄存器答案：A23. 正边沿 D 触发器，在时钟脉冲 CP 正边沿到来前 D 为 1，而 CP 正边沿后 D 变为 0，则 CP 正边
6、沿后为（ ） 。a.Q=0 b.Q=1 c. =1 d. =0Q答案： b 24. 下列器件中，不属于时序逻辑电路的是（ ） 。A. 计数器B. 移位寄存器C. 全加器 D. 脉冲序列发生器答案：C25. 求一个逻辑函数 F 的反函数，下列哪种说法不正确：（ ）A. “” 换成“+”， “+”换成 “”B. 原变量换成反变量，反变量换成原变量C. 变量不变D. 常数中的“0”换成“1”， “1”换成“0”答案：C26. 能完成两个 1 位二进制数相加并考虑到低位来的进位的电路称为（ ） 。A. 编码器B. 译码器C. 全加器D 半加器答案：C二、填空题1. 通常将具有两种不同稳定状态，且能在外
7、信号作用下在两种状态间转换的电路称为( )触发器。对于基本 RS 触发器，当 Q=1、 =0 时称触发器处于( ) 状态；当 Q=0、 =1 时称触发器处于( ) QQ状态。答案：双稳态； 1 ； 0 52. D 触发器的状态方程是( )，JK 触发器的状态方程是( )。答案： 、1nQ1nnJQK3. 描述逻辑函数各个变量取值组合和函数值对应关系的表格叫( )。答案：逻辑真值表（真值表）4. RS 触发器的状态方程是( )约束条件是( )，D 触发器的状态方程是( )。答案： 、 、1nnSR0S1n5. 请将十六进制数(4A) 16 转换为十进制数（ ） 。将十六进制数(37) 16 转换
8、为十进制数（ ） 。答案：（74） 10、 （55） 106. 请将十进制数 112 转换为十六进制数（ ） 。将二进制数 10100.011B 转换为八进制数（ ） 。答案：（70） 16、 （24.3） 87. 一个班级有 78 位学生，现采用二进制编码器对每位学生进行编码，则编码器输出至少（ ）位二进制才能满足要求。答案： 7 位 8. 共阴 LED 数码管应与输出（ ）电平有效的译码器匹配，而共阳 LED 数码管应与输出（ ）电平有效的译码器匹配。答案： 高 低 9. 逻辑变量和函数只有( )和( )两种取值，而且它们只是表示两种不同的逻辑状态。答案：0、110. 组合逻辑电路是指任何
9、时刻电路的输出仅由当时的（ ）决定。答案：输入11. (100101010011.00110111)8421BCD 表示的十进制数是( )。答案：95337 12. 三种基本逻辑门是( )、( )、( )。答案：与门、或门、非门13. 能够存储 1 位二值信号的基本单元电路统称为( )。答案：触发器14. 时序逻辑电路按触发器时钟端的连接方式不同可分为（ ）时序电路和（ ）时序电路两类。答案：4. 同步、异步15. 具有记忆和存储功能的电路属于时序逻辑电路，故（ ）和（ ）电路是时序逻辑电路。a.寄存器； b.多位加法器；c.计数器；d.译码器 答案： a 、 c 16. 请将十进制数 58
10、转换为二进制数（ ） 。将二进制数 101001.1101 转换为十进制数（ ） 。答案：（111010） 2、 （41.8125） 1017. 计数器按计数增减趋势分，有（ ） 、 （ ）和（ ）计数器。答案：递增、递减和可逆18.计数器按触发器的翻转顺序分，有 和 计数器。答案：同步和异步19.一个五进制计数器也是一个 分频器。答案：五三、化简题61. Z(A、B、C)=m(0, 1, 2, 5, 6, 7)答案：Z= ABC2. 用卡诺图化简函数 Y(A,B,C,D)=(m2,m3,m6,m7,m8,m10,m12,m14)答案： YACD3. ZABCD给定的约束条件为 AB+AC=0
11、答案：Z= BDAC4. Z=m(0, 1, 2, 4)+d(3, 5, 6, 7)答案：Z=15. Z=m(2, 3, 7, 8, 11, 14)+d(0, 5, 10, 15)答案：Z= BDCA6. 卡诺图化简 Y(A,B,C,D)= m(3,11,15)答案： YACDB四、图解题1.设一边沿 JK 触发器的初始状态为 0，CP 、J 、K 信号如图所示，试写出触发器 Qn+1的表达式及画出触发器 Q 端的波形。答案：特性方程为： 1nnQJKQ、 波形如下图所示： 图题 4.112.设触发器的初始状态为 0，试写出触发器 Qn+1 的表达式及画出在 CP 信号作用下触发器输出端 Q7
12、 的电压波形。答案： n+1Q=3.已知维持阻塞 D 触发器的 D 和 CP 端电压波形如图所示，试写出触发器 Qn+1 的表达式及画出 Q 和 Q端的电压波形。假定触发器的初始状态为 Q=0。答案：维持阻塞 D 触发器在 CP 上升沿到来时动作，其波形图如图所示D 触发器特性方程为： 1nQ4.设触发器的初始状态为 0，试写出触发器 Qn+1 的表达式及画出在 CP 信号作用下触发器输出端 Q1 的电压波形。答案： n+1Q=五、 试分析如图所示电路中各电路的逻辑功能。（1） （2） （3）答案：aZAB()()A为同或函数答案： b()()ZABC为三变量多数表决电路. 答案： C1ZAB
13、A2为一对互补异或函数（4） 、试写出如图所示电路输出 Y1和 Y2的函数式。 (4 分)答案： 12(0,46)(,357)YmCBABAC六、分析题1. 用与非门设计三变量的多数表决电路。答案：解：根据题意列真值表如下： A B C Y0 0 0 00 0 1 00 1 0 00 1 1 11 0 0 01 0 1 11 1 0 11 1 1 1Y=BCA2.在举重比赛中有 A、B、C 三名裁判，A 为主裁判，当两名以上裁判（必须包括 A 在内）认为运动员上举杠铃合格，按动电钮可发出裁决合格信号，请设计该逻辑电路。答案：设计一个三名裁判其中设有主裁判的举重裁决电路.真值表 （A 为主裁判）
14、 表达式(5,67)YmABC 电路：如图所示： 3、试分析用与非门和或非门设计一个三变量奇校验电路，当输入的三个变量中有奇数个为 1 时，输出为 1，否则为 0.答案： 三变量奇校验真值表 输出函数表达式(1.247)()YmABCAB（不能化简）输入 输出C B A Y0 0 0 0 0 10 1 00 1 11 0 01 0 11 1 01 1 101101001A B C Y0 0 0 00 0 1 00 1 0 00 1 1 01 0 0 01 0 1 11 1 0 11 1 1 1 用异或门实现的电路 用与非门实现的电路1247YmA七、分析时序逻辑电路1、分析如图所示时序电路的逻辑功能，写出电路的驱动方程、状态方程和输出方程，画出状态转换表、状态转换图和时序图。1
