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1、数字电路与数字逻辑19秋在线作业1 1 单选题 1 下列不属于简单PLD的是（） D A PLAB PALC GALD CPLD2 无论是那一种ADC，都是要把() C A 离散的模拟量转换成连续的数字量B 离散的模拟量转换成离散的数字量C 连续的模拟量转换成离散的数字量D 连续的模拟量转换成连续的数字量3 ISP工程KIT是基于（）编程接口实现的 B A PC串行I/OB PC并行I/OC 端口号D 存储器地址4 一个容量为1K*8的存储器有（）个存储单元 B A 8B 8K#8000C 81925 在外加触发信号有效时，电路可以触发翻转，实现()。 C A 置0B 置1C 置0或置16 多
2、余输入端可以悬空使用的门是（）。 B A 与非门B TTL与非门C 或非门D 亦或门7 寄存器是用来暂存数据的()部件。 C A 物理B 物理和逻辑C 逻辑8 二进制数100111011转换为八进制数是：() C A 164B 543C 473D 4569 组合电路是由（）。 A A 门电路构成B 触发器构成C A和B10 用二进制码表示指定离散电平的过程称为（） D A 采样B 量化C 保持D 编码2 多选题 1 ROM的一般结构由哪几部分组成（） A C D A 地址译码器B 指令译码器C 存储矩阵D 读出电路2 PLD编程连接点有哪几种形式() A C D A 固定连接B 不固定连接C
3、编程连接D 不连接3 基本RS触发器用两个输入端分别加有效信号（在这里低电平有效）可使触发器直接（）。 A B A 置0B 置1C 置-14 根据输出信号的特点可将时序电路分为() A B A Mealy型B Moore型C 同步时序逻辑电路D 异步时序逻辑电路5 输入级由组成。（） A B A 多发射级三极管B 电阻C 二极管D 电容6 脉冲异步时序逻辑电路中的存储元件可以采用（ ）。 A B C D A 时钟控制RS触发器B D触发器C 基本RS触发器D JK触发器7 （）的权存在着2的幂次关系。 A B C A 二进制B 八进制C 十六进制D 十进制8 具有透明特性的有()。 B C A
4、 D触发器B D锁存器C 钟控RS触发器D 主从型RS触发器9 下列哪些属于直接型ADC（） A D A 逐次逼近型ADCB 单积分型ADCC 双积分型ADCD 并联方式ADC10 除基本触发器外，触发器在电路结构形式上可分为（）等不同类型。 A B C D A 主从RSB JK触发器C 维持阻塞D触发器D 利用CMOS传输门的边沿触发器3 判断题 1 施密特触发器可用于将三角波变换成正弦波。 A A 错误B 正确2 在同步时序电路的设计中，若最简状态表中的状态数为2N，而又是用N级触发器来实现其电路，则不需检查电路的自启动性。 B A 错误B 正确3 所有的半导体存储器在运行时都具有读和写的
5、功能 A A 错误B 正确4 量化是对展宽的采样值进行划分量化级，级别越多，与模拟量相对的数字信号的位数越多 B A 错误B 正确5 矩形脉冲信号的参数有周期，占空比，脉宽。 B A 错误B 正确6 编码器能将特定的输入信号变为二进制代码；而译码器能将二进制代码变为特定含义的输出信号，所以编码器与译码器使用是可逆的。 A A 错误B 正确7 当传送十进制数5时，在8421奇校验码的校验位上值应为1。 B A 错误B 正确8 VHDL常用语句分并行(Concurrent)语句和顺序(Sequential)语句两种 B A 错误B 正确9 优先编码器的编码信号是相互排斥的，不允许多个编码信号同时有
6、效。 A A 错误B 正确10 通用阵列逻辑(GAL)器件是一种可用电擦除的,但是不可重复编程的高速PLD A A 错误B 正确11 十进制数（9）10比十六进制数（9）16小。 A A 错误B 正确12 在一个8位的存储单元中，能够存储的最大无符号整数（256）10。 A A 错误B 正确13 多谐振荡器的输出信号的周期与阻容元件的参数成正比。 B A 错误B 正确14 将模拟量转换为数字量的装置称为A/D转换器 B A 错误B 正确15 ADC的主要技术指标有分辨率、量化误差、线性度偏移误差 A A 错误B 正确16 施密特触发器的正向阈值电压一定大于负向阈值电压。 B A 错误B 正确17 ispEXPERT能进行逻辑优化，将逻辑映射到器件中去，但不能自动完成布局与布线并生成编程所需要的熔丝图文件 B A 错误B 正确18 单积分型ADC，输入的模拟电压被直接转换成数字代码，不经过任何中间变量 A A 错误B 正确19 单稳态电路在触发信号作用下，可从暂稳态进入稳态 A A 错误B 正确20 RAM的典型结构由地址译码、存储矩阵和读控制三部分组成 A A 错误B 正确
