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1、实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）实验二实验二组合逻辑电路组合逻辑电路1.掌握组合逻辑电路的功能测试；掌握组合逻辑电路的功能测试；2.验证半加器、全加器的逻辑功能；验证半加器、全加器的逻辑功能；3.学会二进制的运算规律。学会二进制的运算规律。一、实验目的一、实验目的2021/8/141实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）二、实验仪器二、实验仪器 1 1、数字电路实验箱一台、数字电路实验箱一台 2 2、器件、器件 74LS00 二输入端四与非门二输入端四与非门 3片片 74LS86 二输
2、入端四异或门二输入端四异或门 1片片 74LS54 四组输入与或非门四组输入与或非门 1片片2021/8/142实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）1、实验芯片介绍、实验芯片介绍三、必须掌握的知识点三、必须掌握的知识点 2021/8/143实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）2、什么是组合逻辑电路、什么是组合逻辑电路数字逻辑电路分为两大类：数字逻辑电路分为两大类：1、组合组合逻辑电路；逻辑电路；2、时序时序逻辑电路。逻辑电路。组合组合逻辑电路特点：电路当前得输出仅取决于逻辑电路特点：电路
3、当前得输出仅取决于当前当前的输的输入信号，输出信号随输入信号的变化而改变，入信号，输出信号随输入信号的变化而改变，与电路原与电路原来的状态无关，来的状态无关，这种电路无记忆功能。这就是组合逻辑这种电路无记忆功能。这就是组合逻辑电路在逻辑功能上的共同特点。电路在逻辑功能上的共同特点。三、必须掌握的知识点三、必须掌握的知识点 2021/8/144实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）3、组合逻辑电路的分析方法、组合逻辑电路的分析方法从给定组合逻辑电路图找出输出和输入之间的从给定组合逻辑电路图找出输出和输入之间的逻辑关系逻辑关系,分析其逻辑功能。分
4、析其逻辑功能。（1）根据给定逻辑电路图）根据给定逻辑电路图,从电路的输入到输出从电路的输入到输出 逐级写出输出变量对应输入变量的逻辑表达式。逐级写出输出变量对应输入变量的逻辑表达式。（2）由写出的逻辑逻辑表达式）由写出的逻辑逻辑表达式,列出真值表。列出真值表。（3）从逻辑表达式或真值表）从逻辑表达式或真值表.分析出组合逻辑电路的分析出组合逻辑电路的 逻辑功能。逻辑功能。三、必须掌握的知识点三、必须掌握的知识点 2021/8/145实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）4、组合逻辑电路的设计方法、组合逻辑电路的设计方法三、必须掌握的知识点三、必
5、须掌握的知识点 将文字描述的逻辑命题，转换为真值表：将文字描述的逻辑命题，转换为真值表：a a、分析事件的、分析事件的因果关系因果关系，确定输入和输出变量。一般总是把引起事件的，确定输入和输出变量。一般总是把引起事件的原因定为输入变量原因定为输入变量，把引起事件的，把引起事件的结果定为输出变量结果定为输出变量；b b、定义逻辑状态的含义，即给定义逻辑状态的含义，即给0 0，1 1逻辑状态赋值，确定逻辑状态赋值，确定0 0，1 1 分别代表输入、输出变量的两种不同状态；分别代表输入、输出变量的两种不同状态；c c、根据因果、根据因果关系列出真值表。关系列出真值表。由真值表写出逻辑表达式，并进行化
6、简。化简形式应根据由真值表写出逻辑表达式，并进行化简。化简形式应根据所选门电路而定所选门电路而定 ；画出逻辑电路图。画出逻辑电路图。2021/8/146实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）5、半加器与全加器、半加器与全加器三、必须掌握的知识点三、必须掌握的知识点 两两个个二二进进制制数数之之间间的的算算术术运运算算无无论论是是加加、减减、乘乘、除除，在在计计算算机机中中都都是是化化做做若若干干步步加加法法运运算算进进行行的的。因因此此，加加法器是构成算术运算器的基本单元。法器是构成算术运算器的基本单元。半加器：半加器：不考虑低位来的进位不考
7、虑低位来的进位加法叫半加；能完成半加加法叫半加；能完成半加功能的电路叫半加器。功能的电路叫半加器。全加器：全加器：考虑低位来的进位加法称为全加考虑低位来的进位加法称为全加。能完成全加。能完成全加功能的电路叫全加器。功能的电路叫全加器。2021/8/147实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）半加器逻辑符号半加器逻辑符号半加器逻辑符号半加器逻辑符号半加器半加器A加数加数B被加数被加数CO进位输出进位输出S半加和半加和全加器逻辑符号全加器逻辑符号全加器逻辑符号全加器逻辑符号进位输进位输入入加数加数全加和全加和全加器全加器进位输进位输出出被加数被加
8、数2021/8/148实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）（1 1） 1 1位半加器（位半加器（Half Adder） 不考虑低位进位，将两个不考虑低位进位，将两个1 1位二进制数位二进制数A、B相加的器件。相加的器件。 半加器的真值表半加器的真值表 逻辑表达式逻辑表达式1000C011110101000SBA 半加器的真值表BABAS+=如用与非门实现最少要几个门?C = AB 逻辑图2021/8/149实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）（2 2） 全加器（全加器（Full Adde
9、r） 1110100110010100全加器真值表 全加器能进行加数、被加数和低位来的进位信号相加，并根全加器能进行加数、被加数和低位来的进位信号相加，并根据求和结果给出该位的进位信号。据求和结果给出该位的进位信号。111011101001110010100000CSCBA2021/8/1410实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算） 于是可得全加器的逻辑表达式为2021/8/1411实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）加法器的应用1110100110010100全加器真值表 1110111
10、01001110010100000CSCBAABC有奇数个有奇数个1时时S为为1；ABC有偶数个有偶数个1和全为和全为0时时S为为0。-用全加器组成三位二进制代码用全加器组成三位二进制代码奇偶校验器奇偶校验器2021/8/1412实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）1、组合逻辑电路功能测试、组合逻辑电路功能测试选择选择74007400两片连接如下电路；两片连接如下电路；A A、B B、C C接电平开关，接电平开关，Y1Y1、Y2Y2接电接电平显示发光管，改变平显示发光管，改变A A、B B、C C的状态填表，的状态填表，并写出并写出Y1Y1
11、、Y2Y2的逻辑的逻辑表达式；表达式；将运算结果与实验结果比较。将运算结果与实验结果比较。四、实验内容四、实验内容 2021/8/1413实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）LED显示显示逻辑电平逻辑电平操作说明操作说明操作说明操作说明四、实验内容四、实验内容 2021/8/1414实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）2、测试用异或门和与非门组成的半加器逻辑功能、测试用异或门和与非门组成的半加器逻辑功能在实验箱上用异或门和与非门组成如下电路，输入接电在实验箱上用异或门和与非门组成如下电路
12、，输入接电平开关，输出端平开关，输出端Y Y、Z Z接电平显示发光二极管；改变输入接电平显示发光二极管；改变输入状态，记录输出结果。状态，记录输出结果。四、实验内容四、实验内容 2021/8/1415实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）3、测试全加器的逻辑功能、测试全加器的逻辑功能写出以下电路的逻辑表达式；写出以下电路的逻辑表达式；根据表达式列出真值表；根据表达式列出真值表；根据真值表画逻辑函数的卡诺图；根据真值表画逻辑函数的卡诺图；连接电路，根据不同的输入连接电路，根据不同的输入状态，记录输出结果。状态，记录输出结果。2021/8/141
13、6实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）4、测试用异或、与或和非门组成的全加器、测试用异或、与或和非门组成的全加器写出用异或门、与或非门、非门组成全加器的逻辑表达式；写出用异或门、与或非门、非门组成全加器的逻辑表达式；连接电路，注意连接电路，注意与或非门不用的输入端接地与或非门不用的输入端接地；根据不同的输入状态，记录输出结果。根据不同的输入状态，记录输出结果。1425326122113316。74LS8674LS5474LS00注意：注意：74LS543或或4或或5接地，接地，9或或10或或11接地接地2021/8/1417实验二实验二 组
14、合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）五、实验报告五、实验报告1、整理实验数据、图表并对实验结果、整理实验数据、图表并对实验结果 进行分析讨论。进行分析讨论。2、总结组合逻辑电路的分析方法。、总结组合逻辑电路的分析方法。关于悬空的问题关于悬空的问题无论是无论是TTL还是还是CMOS多余或暂时不用的输入端不能悬空，可按以（多余或暂时不用的输入端不能悬空，可按以（1）与其它输）与其它输入端并联使用。（入端并联使用。（2）将不用的输入端按照电路功能要求接）将不用的输入端按照电路功能要求接电源或接地。比如将与门、与非门的多余输入端接电源，将电源或接地。比如将与门、与
15、非门的多余输入端接电源，将或门、或非门的多余输入端接地。或门、或非门的多余输入端接地。2021/8/1418实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）下次预习内容实验三实验三 触发器（一）触发器（一）RS，D，JK2021/8/1419实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）六、实验结束六、实验结束 1 1、整理好工具，把连接线拉直并整齐放到一起；、整理好工具，把连接线拉直并整齐放到一起；2 2、关闭所用仪器电源开关、把仪器放好；、关闭所用仪器电源开关、把仪器放好； （探头不用拔掉）（探头不用拔掉）3 3、整理好抽屉方可离开；、整理好抽屉方可离开；4 4、清理个人周围卫生。、清理个人周围卫生。 请大家自觉遵守！谢谢！请大家自觉遵守！谢谢！2021/8/1420实验二实验二 组合逻辑电路（半加器全加器及逻辑运算）组合逻辑电路（半加器全加器及逻辑运算）部分资料从网络收集整理而来，供大家参考，感谢您的关注！
