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1、FPGAFPGA测试练习测试练习 20112011年年1111月月9 9日日单项选择题单项选择题 v1.EDA一般采用下列哪一种设计方式，进行电路的设计。（ ） A.自底向上 B.自顶向下 C.自底向上和自顶向下 D.都不采用v2.FPGA设计中，一般不采用下列哪种硬件语言进行电路的设计。（ ） A.ABEL B.VHDL C.Verilog HDL D.C+v3.随着时代的发展，集成电路的日新月异的发展，目前其发展趋势是（ ）技术。 A.小规模集成电路 B.大规模集成电路 C.SOC D.超大规模集成电路v4.在数字的表达式：中，缺省位宽时，为（ ） A.16位 B.8位 C .由具体的机器
2、系统决定 D.无法判断v5.下列标识符的表达中，正确表达的是（ ） A.34net B.a*b_net C.rest_o D.ns123v6.如果不明确地说明连接是何种类型，应该是指（ ） 类型。 A.reg B.wire C.tri D.supplyv7在always块的触发控制信号可以是一个，也可以是多个，在多个控制信号时，其间用（ ）连接。 A. and B. not C. or D. for v8.用于模块信息的屏幕显示的系统函数是（ ） A. $display B. $monitor C. $finish D. $readmemv9.如果a=4b1010，b=4b0010，判断表达式
3、ab的结果是（ ） A.逻辑1 B. 逻辑0 C. 大于 D.小于v10. 如果a=4b1010，b=4b0010，则a,b,2b01的结果是（ ）A. 8b10100010 B. 10b1010001001 C. 10b0110100010 D. 10b0110100000 v11.并行块中的语句并行执行，由（ ）关键词进行标识。 A.begin end B.assign C.fork-join D.parameterv12.用于指定一个宏名代表一个字符串的编译处理命令是（ ） A.define B. timescale C.include D.if名词解释题名词解释题 v1.SRAM: v2.SOC: v3.DSP: v4.ASIC: v5.IP: v 6.EDA: v7.ESL: v8.VLSI: v9.SOPC: v10.GAL: 简答题简答题 v1.对竞争冒险的理解？ 以及如何消除？ v2. 简述在FPGA中怎么理解“面积速度”这对矛盾体。v3.你知道哪些逻辑电平，TTL和cmos可以互连吗？ v4. 简述阻塞赋值与非阻塞赋值的特点与区别。v5.如何消除信号的毛刺？编程题编程题v 1.试用VERILOG描述8位异步D触发器逻辑。v2.利用VerilogHDL语言设计一个同步时钟异步复位的7分频电路，并且其占空比为50%。
