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1、微机原理与接口技术(楼顺天第二版)习题解答第6章总线及其形成6.1答：内存储器按其工作方式的不同，可以分为随机存取存储器(简称随机存储器或RAM)和只读存储器(简称 ROM。随机存储器。随机存储器允许随机的按任意指定地址向内存单元存入或从该单元取出信息，对任一地址的存取时间都是相同的。由于信息是通过电信号写入存储器的，所以断电时RAM中的信息就会消失。计算机工作时使用的程序和数据等都存储在RAM中，如果对程序或数据进行了修改之后， 应该将它存储到外存储器中，否则关机后信息将丢失。通常所说的内存大小就是指 RAM的大小，一般以 KB或MB为单位。只读存储器。只读存储器是只能读出而不能随意写入信息
2、的存储器。ROM中的内容是由厂家制造时用特殊方法写入的，或者要利用特殊的写入器才能写入。当计算机断电后，ROM中的信息不会丢失。当计算机重新被加电后，其中的信息保持原来的不变，仍可被读出。 ROM适宜存放计算机启动的引导程序、启动后的检测程序、系统最基本的输入输出程序、时钟控 制程序以及计算机的系统配置和磁盘参数等重要信息。6.2答：存储器的主要技术指标有：存储容量、读写速度、非易失性、可靠性等。6.3答：在选择存储器芯片时应注意是否与微处理器的总线周期时序匹配。作为一种保守的 估计，在存储器芯片的手册中可以查得最小读出周期t cyc (R)(Read Cycle Time)和最小写周期t c
3、yc (W)(Write Cycle Time)。如果根据计算，微处理器对存储器的读写周期都比存储器芯 片手册中的最小读写周期大，那么我们认为该存储器芯片是符合要求的，否则要另选速度更高的存储器芯片。8086CPU对存储器的读写周期需要4个时钟周期(一个基本的总线周期)。因此，作为一种保守的工程估计，存储器芯片的最小读出时间应满足如下表达式：t cyc(R) V 4T 一 tda tD T其中：T为8086微处理器的时钟周期；tda为8086微处理器的地址总线延时时间；tD为各种因素引起的总线附加延时。这里的tD应该认为是总线长度、附加逻辑电路、总线驱动器等引起的延时时间总和。同理，存储器芯片
4、的最小写入时间应满足如下表达式：tcyc(W) V 4T 一 tda tD T6.4答：全地址译码、部分地址译码和线选。全地址译码方式下CPU地址总线的所有地址均参与存储单元的地址译码，存储单元地址唯一；部分地址译码方式和线选方式下CPU地址总线的有一些地址信号没有参与译码，则取0或取1均可，所以存储器的存储单元地址不唯一，有重复。6.5答：数据总线的低8位接偶存储体，高8位接奇存储体；地址总线的偶存储体寻址，地址总线的A0只与偶地址存储体连接，32 K 8-6.6 答：(1)1k x 1 256 片，片内寻址：A。 Ag ,1K X1A19A1BHE与奇地址存储体连接。10同时对奇位；片选控
5、制信号:A10A15 ,共6位。(2)1k x 432 K 864片，片内寻址:1K *4AoAg，共10位;片选控制信号:AoA5，共 6 位。(3)4k x 832K88片，片内寻址:4K x8AoA11，共12位;片选控制信号:A12Ai5，共4位。32K 8二4片，片内寻址：Ao. An，共(4)16k X 4A14A15，共 2 位。6.7 答：(1)1k X 1号：A _ A19，共(2) 1k X 4AlO 一 A|9，共 10 位。256K 工 8(3) 4k X 864片，片内寻址：Ao A11，共12位；片选控制信号:418Al2 一 A|9，共 8 位。256 K 8(4
6、) 16k X 432片，片内寻址：Ao A13，共14位；片选控制信号:16K X4Ai4 一 A9 ,共 6 位。16K 4256K 814位;片选控制信号:1K 110位。256K 82048片，片内寻址：Ao. A9 ,512片，片内寻址:1K 4AoA9 ,共共1010 位;位;片选控制信片选控制信号:6.8答：32K=2 =8000H，所以，最高地址为：4000H+8000H-仁BFFFH，贝V,可用的最高地址为 OBFFFH.6.9 答:7FFFH -4000H+1=4000H=142 =16KB，内存容量为16KB6.10答：因为6264的片容量为8KB。RAM存储区域的总容量
7、为03FFFH-00000H+1=4000H=16KB ,故需要2片6264芯片。连接图如图6.10所示6264A131415A 16A 17A 18A 19MEMWMEMR5VA。 A12MEMRMEMWAYoBC丫4G 2 AG 2B丫1G1丫75V74LS138AoA2OEWECS2CS1图6.10与8088系统总线的连接图检测程序段：MOV AX,0000HMOV DS,AXMOV SI,0MOV CX,16*1024MOV AL,55HCMPL: MOV SI,ALMOV BL,SICMP BL,ALJNE ERRORINC SILOOP CMPLMOV DL,0EEHJMP NEX
8、TERROR: MOV DL,01HNEXT: 6.11答：EPROM芯片的编程有两种方式：标准编程和快速编程。在标准编程方式下，每给出一个编程负脉冲就写入一个字节的数据。Vpp上加编程电压，地址线、数据线上给出要编程单元的地址及其数据，并使CE =0, OE =1。上述信号稳定后，在PGM端加上宽度为 50ms 5ms的负脉冲，就可将数据逐一写入。写入一个单元后将0E变低，可以对刚写入的数据读出进行检验。快速编程使用100的编程脉冲依次写完所有要编程的单兀，然后从头开始检验每个写入的字节。若写的不正确，则重写此单元。写完再检验，不正确可重写。EEPROM编程时不需要加高电压，也不需要专门的擦
9、除过程。并口线EEPROM操作与 SRAM相似，写入时间约5ms。串行 EEPROM写操作按时序进行，分为字节写方式和页写方式。6.12答：8088最大方式系统与存储器读写操作有关的信号线有：地址总线 人一 A9，数据总线： Do丨D7，控制信号：MEMR ,MEMW。根据题目已知条件和74LS138译码器的功能，设计的板内数据总线驱动电路如图6.12(a)所示，板内存储器电路的连接电路图如图6.12 ( b)所示。MEMRD0D7A0B0A7B7DIRE74LS245XD0-XD7MEMW74LS138 的 Y0 74LS138 的 Y1 74LS138 的 Y2 74LS138 的 Y3图
10、6.12( a)板内数据总线驱动电路XD0-XD7pFInj述图6.12( b)板内存储器电路的连接图6.13答：Intel 2764的片容量为8KB，而题目给出的地址共32KB，说明有4个地址区重叠，即采用部分地址译码时，有2条高位地址线不参加译码(即Al3,Al4不参加译码)地址译码电路及2764与总线的连接如图6.13所示A15A16A17A18A19A0-A12A0D0D0D7A12D7MEMROEVPP+5VPGMCE2764图6.13地址译码电路及2764与总线的连接6.14答：2K X 8的Intel 6116SRAM 芯片有11个地址引脚，8个数据引脚，现形成 4KB的存储器，
11、则需要两块6116的芯片进行字节扩展。2000H3FFFH 有8KB，所以必定有地址重叠，应该采用部分地址译码方式。根据地址范围，A15A 13必为001 , A12与A11使用一个进行片选译码。C在图中A 11没有参与译码，以上面 6116芯片的地址范围为：当A15A 11为00100或00101时会选中上面的6116芯片，所2000H2FFFH ;当 A 15A 11 为 00110 或 00111 时会选中下面的6116芯片，所以下面6116芯片的地址范围为：3000H3FFFH6.15 答：(1) 00000H01FFFH 为 8KB , 03000H03FFFH 为 4KB，所以需要
12、 6 个 4K X 4 的ROM芯片，共 3组。6.16 答：（1）70000H7BFFFH 有0C000H 字节，即 48KB，根据题图，给出的 SRAM 芯片为16K X &所以需要 3片存储芯片;(2) 3个芯片的地址范围分别为:70000H73FFFH ， 74000H77FFFH ， 78000H7BFFFH6.17答：程序如下:STARTADDR = 2000HCHECKNUM = 9000HCODE SEGMENTASSUME CS:CODESTART:MOV AX,0MOV DS,AX;将数据段段地址寄存器DS设为0000HXH:ERROR:MOV BX,STARTADDRMO
13、V CX,CHECKNUMMOV DX,0MOV SI,1000HMOV AL,55HMOV BX,ALCMP BX,ALJNZ ERRORMOV AL,0AAHMOV BX,ALCMP BX,ALJNZ ERRORJMP RIGHTINC DXMOV SI,BX;用DX来计出错内存单元的个数;用SI进行出错字节单元地址存储寻址;写入;读出，比较;出错字节单元数增1;将出错字节单元的地址存入1000H 开始的缓冲区INC SI6.18所示。6264A 1 A13RDIVVR+5VA 19A 00A12d7OEWECS286264A0D0A12D7OE、A #L WED8 Dl5D o D7CS2CS1图6.18 SRAM 电路与 8086系统总线的连接图INC SIRIGHT:INC BXLOOP XHHLTCODE ENDSEND START
