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1、打开quartus II软件；新建工程:选择新建工程向导 对话框中介绍了其主要的功能，点击“Next”出现的对话框中说明你要建工程的存储目录，工程名称以及顶层文件名，一般情况下，工程名称和顶层文件名相同，点击“Next”这里让我们选择我们要加载的文件名，因为我们是新建工程，所以不需要加载任何文件，点击“Next”接下来出现的对话框是设计者要选择的器件型号，这里选择epm240t100c5n 作为对象，选好器件后，点击“Next”，再点finish工程就创建完成了。接下来点击file/new/verilog HDL Files创建一个程序文件。在新建的verilog HDL文件中编写好所需程序，
2、然后保存，注意文件名要和module后的文件名一致，如果不一致就会导致出错。点击Start Analysis&Synthesis对编写的程序编译和纠错，如果有错误，在窗口下面会有警告，然后回头重新修改程序，直到编译通过。编译通过后，出现的下面的对话框表示了我们使用的器件以及所占的器件的资源。点击Pin Planner可以对程序中所用的管脚和实际芯片管脚对应，设置完后关闭管脚设置，管脚设置完毕。按下图生成仿真网表按下图新建波形仿真文件在新建的文件中Name处双击，弹出对话框点击Node finder点击List找到的管脚添加到设计中点及OK这时就会看到设计中的所有输入输出管脚都会出现在仿真文件中，给所有输入加上所需仿真波形，输出不变，然后点击保存。点击setting这里设置仿真的形式，为功能仿真，仿真输入选择我们上一步保存的波形。点击开始仿真按钮出现需要的仿真结果，从结果可以看出输出out根据si的值随着a或b变化，当si为低电平时out=a ，当si为高电平时：out=b。
