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1、装订线此处不能书写此处不能书写此处不能书写此处不能书写此处不能书写此处不能书写此处不能书写北京理工大学珠海学院2008 2009学年第二学期数字电路与系统期末试卷（A）诚信声明考场是严肃的，作弊是可耻的，对作弊人的处分是严厉的。我承诺遵守考场纪律，不存在抄袭及其它违纪行为。考生（承诺人）签字： 专业：班级：学号：适用年级专业：2007级信息工程/自动化/微电子 试卷说明：闭卷，考试时间120分钟题号一二三四五六总分得分一、填空题（每空1分，共20分）【得分： 】1数制转换：(3EC)H=( )D=( )O。2逻辑代数的基本运算有 、 、 三种。3数字电路按照是否有记忆功能通常可分为 、 两类。
2、4能够实现“线与”的TTL门电路叫 。5JK触发器当时钟到来时，如果J=0，K=0，触发器的状态将 ；如果J=1，K=1，触发器的状态将 。6时序逻辑电路按照其触发器是否有统一的时钟控制分为 时序电路和 时序电路。7TTL与非门中，关门电平VOFF 的定义是 。开门电平VON 的定义是 。874LS138是3线8线译码器，译码为输出低电平有效，若输入为A2A1A0=110时，输出应为 。9一个10位地址码、8位输出的ROM，其存储容量为 。10数字系统的设计方法有 和 两种。11用VHDL语言描述电路时，基本结构由 和 两部分组成。二、选择题（每小题2分,共10分）【得分： 】1将十进制数13
3、.25转换成二进制数为( )。A1011.01 B.1011.1 C.1101.1 D.1101.012用8421BCD码表示两位十进制数，则至少需要( )0、1码。A. 5位 B.7位 C.8位 D.6位3n个变量的最小项是( )。A.n个变量的积项，它包含全部n个变量，每个变量可用原变量或非变量。B.n个变量的和项，它包含全部n个变量，每个变量可用原变量或非变量。C.n个变量的积项，它包含全部n个变量，每个变量仅为原变量。D.n个变量的和项，它包含全部n个变量，每个变量仅为非变量。4用JK触发器设计12进制同步计数器，至少需要( )触发器。A.2个 B.3个 C.4个 D.5个5一个4位移
4、位寄存器可以构成最长计数器的长度是（ ）。 A.8 B.12 C.15 D.16三、逻辑函数化简（每小题5分,共10分）【得分： 】1用代数化简法化简函数2将下列逻辑函数用卡诺图法化简为最简与或表达式。F(A,B,C,D)=m(0,1,5,7,8,11,14)+d(3,9,15)四、分析与设计题(共20分) 【得分： 】1由与非门构成的某议案表决电路如下图所示，其中A、B、C、D表示四个人，同意时用1表示，Z为1时表示议案通过。(10分)(1)分析电路，列出逻辑表达式和真值表，说明议案通过情况共有几种；(2)分析A、B、C、D中谁权力最大。2某组合逻辑电路的输入A、B、C和输出F的波形如下图所
5、示。(10分)(1)列出该电路的真值表；(2)写出逻辑函数表达式(化简为最简与或式)；(3)用与非门实现逻辑电路。五、综合题（共10分）【得分： 】试用图示的3线-8线译码器74LS138和必要的门电路产生如下多输出逻辑函数，要求(1)写出分析过程；(2)在给定的逻辑符号图上完成最终电路图。(10分) 六、应用与设计题（共30分）【得分： 】1.如图所示为由J-K触发器组成的电路。(共20分)(1)分别写出电路的驱动方程、状态方程和输出方程；(8分)(2)列出状态转换表，画出状态转换图；(8分)(3)根据已给CP波形，画出触发器输出端Q1、Q2的波形(设各触发器初始状态均为0)。(4分)1CP
6、Q1Q21J1K1J1K&ZC1C12.采用集成4位二进制同步计数器CT74161(可添加必要的门电路)，设计一个10进制计数器；CT74161如图，Rd：异步清零，LD：同步预置，CT、CP：控制端，C：进位。(10分)要求：(1)列出状态转移表；(2)设计这个计数器并画出该计数器的逻辑图。CT74161 功能表输 入输 出ETEPCPQ0Q1Q2Q3Q0 Q1 Q2 Q300 0 0 010D0D1D2D3D0 D1 D2 D31111计 数110触发器保持 C=01110保 持Q3 Q2 Q1 Q0CT CP R dD3 D2 D1 D0CT74161CPQ3 Q2 Q1 Q0LDC第 5 页 共 6 页
