数字式秒表的设计与制作电子技术综合课程设计

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1、电子技术综合课程 设 计 课 程： 电子技术综合课程设计 题 目： 数字式秒表的设计与制作 所属院(系) 物理与电信工程学院 专业班级 姓 名 学 号： 指导老师 帅春江 完成地点 501实验室 2012年 09月10日任务书数字式秒表一、任务和要求：设计并制作一个数字式秒表，要求如下：1、三位数码管及一个LED发光二极管显示秒表计时，格式如下： 开机时数码管显示000，LED灯灭；当计时超过59秒时，LED灯亮；计到1分59秒时，过一秒，LED灯灭，同时数码管重新计时显示。计时最小单位为0.1秒。2、具有如下功能键：开始/清零键：按第一下时计时开始，同时显示；按第二下，停止计时，恢复到初始状

2、态； 固定显示键：按第一下时，显示固定，但计时仍继续；再按下时，显示从新时间开始。 3、要求自制0.1秒信号源。4、设计并制作本电路所用直流电源。二、提示和参考文献直流稳压电源见参考资料P23数字电子技术实验任务书实验六目录前言11.方案论证21.1方案一21.2 方案二21.3 方案选择32.电路设计和原理32.1 5V电压源电路设计32.2 0.1s信号源设计42.2.1 555定时器引脚及功能表42.2.2 用555定时器构成多谐振荡器62.3 计数电路设计82.4译码锁存电路设计92.5显示电路设计102.6控制电路设计113.软件仿真与硬件装调123.1 软件介绍123.2 调试步骤

3、及方法124.实验调试、故障分析及解决方法145.总结与体会14附录：15A、总体电路图16B、元器件清单17C、元器件功能与管脚18D、实物图21E、参考文献22前言 本次课程设计所要实现的三位数字式秒表是我们通信类专业实验环节中最基本的一项设计性实验，也是学生们必须熟练掌握的一项基本技能之一。数字秒表是采用数字电路实现对分、秒、毫秒进行控制的数字显示计时装置，广泛用于体育比赛中，有很高的实用价值。该数字计数系统由直流电源、计数电路、0.1秒脉冲发生电路、计数控制电路、锁存译码及数码显示电路组成。其中核心的部分为0.1秒脉冲发生器、计数、译码及显示电路部分，而其它部分是为了使电子秒表功能更加

4、完善而采取的附加控制部分。 本课程设计介绍的是数字逻辑电路中以计数器集成电路为基础的数字式秒表，以电路的基本理论为基础，着重介绍电路的设计装调及性能参数的调试方法。本课程设计应达到如下基本要求：（1） 综合运用电子技术课程中所学的理论知识独立完成一个数字式秒表的设计。（2）通过查阅手册和参考文献资料，培养分析和解决实际问题的能力。（3）熟悉常用电子元器件的型号和特性，并掌握合理选用的原则。（4）能熟练掌握一种当前流行的EDA软件（电子电路设计分析自动化软件），例如：proteus（5）掌握电子电路的安装和调试技能。（6）熟悉各类数字电子仪器的使用方法。（7）学会撰写课程设计论文。（8）培养严肃

5、认真的工作作风和严谨的科学态度，培养团结合作的精神。本设计报告由方案论证、电路设计和原理、软件仿真与硬件装调、总结与体会、总体电路图、元器件清单等部分组成，力求将整个系统的设计过程、工作原理、以及心得体会完整的呈现出来。但由于设计者本人水平有限，报告中出现问题在所难免，望各位指导老师不吝赐教。1.方案论证1.1方案一此次设计中，我们做的是数字式秒表，按照任务书的要求我们需要做一个直流5V电压源和0.1s的信号源，计数电路部分由3个74LS160级联而成，其中秒十位是用做成七进制的74LS160实现的，并且采用的是预置数锁方式。锁存译码电路采用的是3个74LS373芯片级联，并通过3个74LS4

6、8译码由七段数码显示管显示计数。计数控制电路是由74LS160和秒十位的74LS160相连及1个锁存器组成来控制LED的亮与灭。其原理框图如下：直流电源计 数 控 制 电 路时钟脉冲电路锁存译码电路计数电路数码显示电路1.2 方案二数字式秒表要求能够对时间进行精确计时并显示出来，因此需要直流电源，时钟脉冲电路，计数电路，计数控制电路，锁存译码电路，数码显示电路。图中时钟脉冲电路由输出脉冲占空比为2/3的NE555定时器做成，计数电路由3个74LS160级联组成，其中秒十位由做成七进制的74LS160实现。锁存译码电路由三个CD4511做成。CD4511直接驱动共阴极的八段数码显示管。计数控制电

7、路是由JK触发器改装成的D触发器做成。框图如下：直流电源计 数 控 制 电 路时钟脉冲电路锁存译码电路计数电路数码显示电路1.3 方案选择综上比较，我们选择方案二。首先，从锁存译码电路来看方案二采用的是CD4511，它即具有锁存功能又有译码功能，因此方案二采用的芯片数量比方案一少。其次，从控制电路来看，方案二采用的是JK触发器改装成的D触发器来控制LED的亮灭，而方案一采用的是74LS160和一个锁存器来控制，芯片数量和种类较方案二来说较复杂。并且在连接电路和检查故障时难度比方案二高。因此，选择方案二。2.电路设计和原理2.1 5V电压源电路设计图1：直流稳压电源的方框图电源变压器：直流电压源

8、的输入端接220V 的交流电压，所需直流电压的数值和交流电压有效值相差较大，因而需要电源变压器进行降压。在对交流电压进行降压处理时，电路采用变压器直接变压的方法，输出9V交流电压。 整流电路一般分为半波整流和全波整流。桥式整流最为常用，单相桥式整流电路可将变压器副边电压从交流转变为直流电压。鉴于以上优点，本设计采用了桥式整流的方法。电容滤波电路是最常见并且最简单的滤波电路。一般在整流后，还需利用滤波电路将脉动的直流电压变为平滑的直流电压。其工作原理是在整流电路的输出端（即负载电阻两端）并联一个电容即构成电容滤波电路。滤波电容容量较大，利用其充放电作用，使输出电压趋于平滑。滤波电路需要1000u

9、F、100uF、3.3uF电容各一个。稳压电路的功能是使输出的直流电压趋于稳定，不随交流电网电压和负载的变化而变化。稳压电路有稳压二极管型稳压电路、串联型稳压电路和集成稳压器电路等多种类型。为使电路简单化、高效化、稳定化，我们采用了集成7805稳压器型稳压电路进行稳压，为后面的一切电路提供了稳定的5V直流电压。综上所述，电源整体设计思路为：220V/50HZ交流电压 9V电源变压器 整流电路 滤波电路 稳压电路 输出+5V直流电压。2.2 0.1s信号源设计通过利用555集成定时器，构成占空比为2/3的多谐振荡器产生周期为0.1s的矩形方波。2.2.1 555定时器引脚及功能表 图2：555引

10、脚图 图3：555定时器电路框图 1脚（GND）为接地端； 2脚（TR）为低电平有效，且1/3UDD输出端为1； 3脚（OUT）为输出端； 4脚（R）为复位端； 5脚（CO）为控制电压输入端； 6脚（TH）为阈值端，是高电平触发端； 7脚（D）为放电端； 8脚（UCC）为电源端表1：555定时器功能表当TH高触发端6脚加入的电平大于2/3UDD ，TL低触发端2脚的电平大于1/3UDD 时，比较器A1输出高电平，比较器A2输出低电平，触发器置“0”，放电管饱和，7脚为低电平。 当TH高触发端加入的电平小于2/3UDD ，TL低触发端的电平大1/3UDD 时，比较器A1输出低电平，比较器A2输出

11、低电平，触发器状态不变，仍维持前一行的电路状态，输出低电平，放电管饱和，7脚为低电平。 当TH高触发端6脚加入的电平小于2/3UDD，TL低触发端的电平小1/3UDD时，比较器A1输出低电平，比较器A2输出高电平，触发器置“1”，输出高电平，放电管截止，7脚为高电平。因7脚为集电极开路输出，所以工作时应有外接上拉电阻，故7脚为高电平。 当从功能表的最后一行向倒数第二行变化时，电路的输出将保持最后一行的状态，即输出为高电平，7脚高电平。只有高触发端和低触发端的电平变化到倒数第三行的情况时，电路输出的状态才发生变化，即输出为低电平，7脚为低电平。 由电路框图和功能表可以得出如下结论： 1555定时

12、器有两个阈值，分别是1/3UDD和2/3UDD。 2输出端3脚和放电端7脚的状态一致，输出低电平对应放电管饱和，在7脚外接 有上拉电阻时，7脚为低电平。输出高电平对应放电管截止，在有上拉电阻时，7脚为高电平。 3输出端状态的改变有滞回现象，回差电压为 。 4输出与触发输入反相。2.2.2 用555定时器构成多谐振荡器多谐振荡器是一种自激振荡器，接通电源后不需外加触发便能产生矩形脉冲图4：多谢振荡器我们用555定时器构成多谐振荡器的原理很简单,只要将施密特触发器的反相输出端经RC积分电路接回输入端即可。当接通电源以后,因为电容上的初始电压为0,所以输出为高电平,并开始经电阻R向电容C充电,当充到

13、输入电压为Vi=Vt+时,输出电压跳变为低电平,电容C又经过电阻R开始放电。当放至Vi=Vt-时,输出电位又跳变为高电平,电容C重新开始充电,如此周而复始,电路便不停的振荡.由Vc的波形求得电容C的充电时间T1和放电时间T2各为 T1=（R1+R2）CLn【(Vcc-VT-)/(Vcc-VT+)】=(R1+R2)CLn2 T2=R2CLn【(0-VT+)/(0-VT-)】=R2CLn2 振荡周期为T=T1+T2=(R1+2R2)CLn2 振荡频率为f=1/T=1/【(R1+2R2)CLn2】通过改变R和C的参数即可改变振荡频率。输出脉冲的占空比为q=T1/T=(R1+R2)/(R1+2R2)=

14、2/3，故得到R1=R2。又T=T1+T2=(R1+2R2)CLn2=0.1为了得到占空比为2/3的脉冲，可采用占空比可调的可调电路。经以上分析及计算若C=10uF ，R1=R2=4.76K。同时考虑到实际中不可能存在两个阻值完全相等的电阻，因此在R1和R2之间可加入一个200的滑动变阻器，通过调节电位器已达到R1、R2阻值完全相等的目的。图5：0.1S信号源如下图2.3 计数电路设计图6：74LS160引脚图表2：74LS160功能表及逻辑功能图74LS160为异步清零计数器，即端输入低电平，不受CP控制，输出端立即全部为“0”，功能表第一行。74LS160具有同步预置功能，在端无效时，端输入低电平，在时钟共同作用下，CP上跳后计数器状态等于预置输入DCBA，即所谓“同步”预置功能（第二行）。和都无效，ET或EP任意一个为低电平，计数器处于保持功能，即输出状态不变。只有四个控制输入都为高电平，计数器（161）实现模10加法计数，Q3 Q2 Q1 Q0=1001时，RCO=1。2构成任意进制计数器（模长M10） 用集成计数器实现M进制计数有两种方法，反馈清零法和反馈预置法。图（a）为反馈清零法连接（ 8进制），图（b）为反馈预置零法连接（8进制）。