《PLD原理与EDA技术》复习提纲

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1、PLD原理与EDA技术复习提纲一、基本概念1-1 EDA技术与ASIC设计和FPGA开发有什么关系？答：利用EDA技术进行电子系统设计的最后目标是完成专用集成电路ASIC 的设计和实现;FPGA和CPLD是实现这一途径的主流器件。FPGA和CPLD通常也 被称为可编程专用IC,或可编程ASIC。FPGA和CPLD的应用是EDA技术有机融 合软硬件电子设计技术、SoC （片上系统）和ASIC设计，以及对自动设计与自动 实现最典型的诠释。1-2 与软件描述语言相比， VHDL 有什么特点？ 答：编译器将软件程序翻译成基于某种特定 CPU 的机器代码，这种代码仅限 于这种CPU而不能移植，并且机器代

2、码不代表硬件结构，更不能改变CPU的硬件 结构，只能被动地为其特定的硬件电路结构所利用。综合器将VHDL程序转化的 目标是底层的电路结构网表文件,这种满足VHDL设计程序功能描述的电路结构, 不依赖于任何特定硬件环境；具有相对独立性。综合器在将VHDL（硬件描述语言） 表达的电路功能转化成具体的电路结构网表过程中，具有明显的能动性和创造 性，它不是机械的一一对应式的“翻译”，而是根据设计库、工艺库以及预先设 置的各类约束条件，选择最优的方式完成电路结构的设计。1-3什么是综合?有哪些类型?综合在电子设计自动化中的地位是什么？什么是综合？答：在电子设计领域中综合的概念可以表示为：将用行为和功 能

3、层次表达的电子系统转换为低层次的便于具体实现的模块组合装配的过程。有哪些类型?答：（1）从自然语言转换到VHDL语言算法表示，即自然语言综 合。（2）从算法表示转换到寄存器传输级（RegisterTransport Level，RTL），即 从行为域到结构域的综合，即行为综合。（3）从RTL级表示转换到逻辑门（包括触 发器）的表示，即逻辑综合。（4）从逻辑门表示转换到版图表示（ASIC设计），或 转换到FPGA的配置网表文件，可称为版图综合或结构综合。综合在电子设计自动化中的地位是什么？答：是核心地位（见图1-3）。综 合器具有更复杂的工作环境，综合器在接受VHDL程序并准备对其综合前，必须

4、获得与最终实现设计电路硬件特征相关的工艺库信息,以及获得优化综合的诸多 约束条件信息；根据工艺库和约束条件信息，将VHDL程序转化成电路实现的相 关信息。1-4在EDA技术中，自顶向下的设计方法的重要意义是什么？答：在EDA技术应用中，自顶向下的设计方法,就是在整个设计流程中各设 计环节逐步求精的过程。1- 5 IP在EDA技术的应用和发展中的意义是什么？答：IP核具有规范的接口协议，良好的可移植与可测试性，为系统开发提 供了可靠的保证。2- 1叙述EDA的FPGA/CPLD设计流程。答：1设计输入（原理图/HDL文本编辑）;2.综合;3.适配;4.时序仿真与 功能仿真;5.编程下载;6.硬件

5、测试。2-2 IP是什么?IP与EDA技术的关系是什么？IP是什么？答：IP是知识产权核或知识产权模块，用于ASIC或FPGA/CPLD 中的预先设计好的电路功能模块。IP与EDA技术的关系是什么？答：IP在EDA技术开发中具有十分重要的地 位；与EDA技术的关系分有软IP、固IP、硬IP:软IP是用VHDL等硬件描述语 言描述的功能块，并不涉及用什么具体电路元件实现这些功能;软IP通常是以 硬件描述语言HDL源文件的形式出现。固IP是完成了综合的功能块，具有较大 的设计深度，以网表文件的形式提交客户使用。硬IP提供设计的最终阶段产品: 掩模。2-3 叙述 ASIC 的设计方法。答：ASIC设

6、计方法,按版图结构及制造方法分有半定制（Semi-custom）和全 定制（Full-custom）两种实现方法。全定制方法是一种基于晶体管级的，手工设计版图的制造方法。半定制法是一种约朿性设计方式，约束的目的是简化设计，缩短设计周期， 降低设计成本，提高设计正确率。半定制法按逻辑实现的方式不同，可再分为门 阵列法、标准单元法和可编程逻辑器件法。2-4 FPGA/CPLD在ASIC设计中有什么用途？答: FPGA/CPLD在ASIC设计中，属于可编程ASIC的逻辑器件；使设计效 率大为提高，上市的时间大为缩短。2- 5简述在基于FPGA/CPLD的EDA设计流程中所涉及的EDA工具，及其在 整

7、个流程中的作用。答:基于FPGA/CPLD的EDA设计流程中所涉及的EDA工具有:设计输入 编辑器（作用:接受不同的设计输入表达方式，如原理图输入方式、状态图输入 方式、波形输入方式以及HDL的文本输入方式。）;HDL综合器（作用:HDL综合 器根据工艺库和约束条件信息，将设计输入编辑器提供的信息转化为目标器件硬 件结构细节的信息,并在数字电路设计技术、化简优化算法以及计算机软件等复 杂结体进行优化处理）；仿真器（作用:行为模型的表达、电子系统的建模、逻 辑电路的验证及门级系统的测试）适配器（作用:完成目标系统在器件上的布 局和布线）;下载器（作用:把设计结果信息下载到对应的实际器件，实现硬件

8、 设计）。3- 1 OLMC （输出逻辑宏单元）有何功能?说明GAL是怎样实现可编程组合电 路与时序电路的。OLMC有何功能？答：OLMC单元设有多种组态，可配置成专用组合输出、 专用输入、组合输出双向口、寄存器输出、寄存器输出双向口等。说明GAL是怎样实现可编程组合电路与时序电路的？答：GAL （通用阵列 逻辑器件）是通过对其中的OLMC （输出逻辑宏单元）的编程和三种模式配置 （寄存器模式、复合模式、简单模式）,实现组合电路与时序电路设计的。3-2什么是基于乘积项的可编程逻辑结构？答: GAL、CPLD之类都是基于乘积项的可编程结构；即包含有可编程与阵列 和固定的或阵列的PAL （可编程阵

9、列逻辑）器件构成。3-3什么是基于查找表的可编程逻辑结构？答：FPGA （现场可编程门阵列）是基于查找表的可编程逻辑结构。3-4 FPGA系列器件中的LAB有何作用？答：FPGA （Cyclone/Cyclone II）系列器件主要由逻辑阵列块LAB、嵌入 式存储器块（EAB）、I/O单元、嵌入式硬件乘法器和PLL等模块构成；其中LAB （逻辑阵列块）由一系列相邻的LE（逻辑单元）构成的;FPGA可编程资源主要 来自逻辑阵列块LAB。3-5与传统的测试技术相比，边界扫描技术有何优点？答：使用BST (边界扫描测试)规范测试，不必使用物理探针，可在器件正 常工作时在系统捕获测量的功能数据。克服传

10、统的外探针测试法和“针床”夹具 测试法来无法对IC内部节点无法测试的难题。3-6 解释编程与配置这两个概念。答：编程：基于电可擦除存储单元的EEPROM或Flash技术。CPLD 一股使用 此技术进行编程。CPLD被编程后改变了电可擦除存储单元中的信息，掉电后可 保存。电可擦除编程工艺的优点是编程后信息不会因掉电而丢失,但编程次数有 限，编程的速度不快。配置:基于SRAM查找表的编程单元。编程信息是保存在SRAM中的,SRAM 在掉电后编程信息立即丢失,在下次上电后，还需要重新载入编程信息。大部分 FPGA采用该种编程工艺。该类器件的编程一般称为配置。对于SRAM型FPGA来 说，配置次数无限

11、，且速度快；在加电时可随时更改逻辑；下载信息的保密性也 不如电可擦除的编程。3-7 请参阅相关资料，并回答问题：按本章给出的归类方式，将基于乘积项的 可编程逻辑结构的PLD器件归类为CPLD；将基于查找表的可编程逻辑结构的 PLD器什归类为FPGA，那么，APEX系列属于什么类型PLD器件？ MAX II系 列又属于什么类型的PLD器件?为什么？答：APEX(Advanced Logic Element Matrix)系列属于 FPGA 类型 PLD 器件; 编程信息存于SRAM中。MAX II系列属于CPLD类型的PLD器件；编程信息 存于EEPROM中。5- 1归纳利用Quartus II

12、进行VHDL文本输入设计的流程：从文件输入一直到 SignalTap II 测试。答: 1 建立工作库文件夹和编辑设计文件;2 创建工程;3 编译前设置; 4全程编译；5时序仿真;6引脚锁定；7配置文件下载；8打开SignalTap II编辑窗口； 9调入SignalTap II的待测信号；10 SignalTap II参数设置； 11 SignalTap II参数设置文件存盘；12带有SignalTap II测试信息的编译下 载； 13 启动 SignalTap II 进行采样与分析； 14 SignalTap II 的其他设置和 控制方法。6- 1 什么是固有延时?什么是惯性延时?答：固有

13、延时(Inertial Delay)也称为惯性延时,固有延时的主要物理机制 是分布电容效应。6-2 6是什么?在VHDL中，8有什么用处？6是什么?答：在VHDL仿真和综合器中，默认的固有延时量(它在数学上 是一个无穷小量)，被称为6延时。在VHDL中，8有什么用处?答：在VHDL信号赋值中未给出固有延时情况 下，VHDL仿真器和综合器将自动为系统中的信号赋值配置一足够小而又能满足 逻辑排序的延时量6；使并行语句和顺序语句中的并列赋值逻辑得以正确执行。6-4说明信号和变量的功能特点，以及应用上的异同点。答：变量：变量是一个局部量，只能在进程和子程序中使用。变量不能将信 息带出对它做出定义的当前

14、结构。变量的赋值是一种理想化的数据传输,是立即 发生的,不存在任何延时行为。变量的主要作用是在进程中作为临时的数据存储 单元。信号：信号是描述硬件系统的基本数据对象，其性质类似于连接线;可 作为设计实体中并行语句模块间的信息交流通道。信号不但可以容纳当前值,也 可以保持历史值；与触发器的记忆功能有很好的对应关系。6-5在VHDL设计中，给时序电路清零(复位)有两种力方法，它们是什么? 解：设Q定义成信号，一种方法：Qv= “000.000” 其中“000.000”反 映出信号Q的位宽度。第二种方法:Qv=(OTHERS= 0)；其中OTHERS= 0不需要给出信号Q的位宽度，即可对Q清零。6-

15、7什么是重载函数?重载算符有何用处?如何调用重载算符函数？答：(1)什么是重载函数？根据操作对象变换处理功能。(2) 重载算符有何用处？用于两个不同类型的操作数据自动转换成同种 数据类型，并进行运算处理。(3) 如何调用重载算符函数?采用隐式方式调用，无需事先声明。7-2 LPM_R0M、LPM_RAM、LPM_FIF0 等模块与 FPGA 中嵌入的 EAB、ESB、M4K 有怎样的联系？答: ACEX1K 系列为 EAB； APEX20K 系列为 ESB； Cyclone 系列为 M4K二、EDA名词解释1. CPLD:复杂可编程逻辑器件2. HDL:硬件描述语言3. LUT：查找表4. A

16、SIC:专用集成电路5. SOC:单片电子系统(或者片上系统)6. VHDL:超高速集成电路硬件描述语言7. FPGA:现场可编程门阵列8. RTL:寄存器传输级9. JTAG:联合测试活动组织10. EAB:嵌入式阵列块11: SOPC:片上可编程系统12 . ISP ：在系统可编程技术13. ICR:在线可重配置技术14 . IP ：知识产权核15. IEEE:电子电气工程师协会16. LPM:参数可定制宏模块库17. EDA:电子设计自动化18. FSM:有限状态机三、简答题：1. 简述 VHDL 程序的基本结构？答：VHDL程序是由以下几个部分组成的：( 1 ) LIBRARY (库)部分( 2) PACKAGE (程序包)部分