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1、34： BHE/S7(b= Hirk Ebk / statv)高8 位允许/状态复用引际 出景醒怠炒周期的T1状态时出， 当该引脚输出为饪电平时，表示当前散据总线上高8位数据有效. 该引脚和地址引脚M配合表示当前数据总经的使用情况，S7在 蜒 中未被定义，哲伟备用状布信号线.3031： RQ/GT1、RQ/GT0(bt/Grgt)忌线请求值号(输入)饵线请求允许信号(输 出).这两个信号可供8086以外的2个总线主设备向8086发出使用您线的请求信号ID (HIU 而80跖在现行忌经周期结束后让出以线发出兑线请求允许信号QT (HBSUU).此时，外部削曳主 设备便获得了以线的控制权.其中京0
2、苟Otti迎旬i的优先级商.33： MN/MX Qt&itnvalkximM co.txol)最小/大方 式控制信号，输入.祝引廉接高电平时8086/8088CR工作在 最小方式，在此方式下，全部拽制信号由CTO提供：“祝引脚 接低电平时，8086/8088工作在最大方式，这时，CIU发出的控 制信号冬8288免莪控制春进行变换和粗合29： LOCKOock)以线挝镇信号，输出.当为低电平时，系统中其他您埃主设备就不能获 得也经的控制权而占用总fii.LOCK信号由指令MSUCI产生，SCI指令后面的一条指令执行完后, 便撤消了IStS信号.另外，在ia期间，LOCK被浮空B5姓于高阻状态.3
3、2： RDauad)读枝制信号，输出.索如)时,表示将要执 行一个对存储器或1/。端口的读操作.到底是丛存储单元还是从 I/O端口读取敷据，取决于w旬(8086)或10位(8088)信号.MAX Ltnnrf MIN (MODE JGNDC140M vUCvccAD14C239 AD15AD13C338 A16/S3AD12C437 A17/S4AD11C536 A18/S5A010C635 A19/S6AD9C734 BHE/S7AD8C833 MN/MXAD7C9808632 RDAD6C10CPU31 RO/GTO(HOLD)AD5C1130 R0/GT1(HLDA)AD4匚1229 L
4、OCK(WR)AD3C1328 S2(M/IO)AD2C1427 SI(OT/R)AD1C1526 so(DEN)ADOC1625 OSO(ALE)NMIC1724 0S1(INTA)INTRE1823 TESTCLK匚1922 READYGNDC2021 RESET23： TEST等待测试信号，输入.当CR执行1AIT指令时， 每隰5个时时周期对TEST引稗进行一次测试.若为高电平，CTU 就仍处于空转状杏进行等待，宜到1ET引JU变为低电平，CHT结 束等待状态，执行下一条指令，以使C1U与外部硬件同步.17： NMIgrUd.iBterrt )非屏蔽中断请求 信号，输入，上升沿触发.此
5、请求不受标志寄存anus 中中断允许标志位if状态的 影响，只5J此信号一出现，在 当前指令执行结束后立即进 行中断处理.18： DTTR (laterrwt中断请求信 号，输入，高电平有效.CHJ 在每个指令同期的后一个 时仲周期检测谖信号是否有 效，若此值号有效，表明有外 设提出了中断请求，这时若 01, JW当前指令执行完后立 即响应中断I若u=o,财中 断被屏蔽,外设发出的中断靖 求将不被响应.程序员可通过 指令STI或CU将IF标志位 1或清零.22： READY据“准备 好信号线，0入它实际上 是所寻址的存储号或I/。端 口发来的数据准备就绪信号， 高电平有效. CRT在每个忌雄
6、周期的15状态对皿T引脚 采样，若为高电平，说明数据 已准备好：若为低电平，说明 数据还没有准备好,CHT在13 状态之后自动插入一个或几 个等待状态II,直到JMOT 变为高电平，才能进入T4状 态，完成数据传送过程，从而 结束当前兑我周期.19： CLK(ciock)系统时仲, 输入通常与8284A时钟发生 8S的时钟输出端相连.该时仲 信号有效高电平与时钟周期 的比为1：S.21： RESET复位信号，输 入，高电平有效复位信号使 处理备马上结束现行操作，对 处理器内部寄存器进行初始 化.汹6/8088要求点位脉冲 宜度不得小于4个时时周期. 复位后，内的状杰如 表3.4所示.系统正常运
7、行 时，BESBT保持低电平.26 27 28： S2、Sl S0(=总经周期状态信号，输出.低电平有效的三 个状态伯号连接到蔻线控制器8288的输入靖,8288对这些侑号进行俸码后产生内存及1/0端口的谊 写控制信号.表如聂.驾的代码短含对应曲操作S?S1So2观产生的控制帽号对应拨作000INTA发中断响应信号001IORC读DO端口010IOWC 和 AIOWC写IQ端口011无暂停100V?PDC101WRDC读内存11nMWTC 和 AMWC写内存111无无滤我态24 25： QS1、QS0(isfsuh.)指令队列状态信号，输出.qsi、qso两个信号电平的不同tfl合指明了 80
8、86/8088内部指令队列的状态表3 6 QS,、QS。的代叫俎合对应的含义QSiQSo含 义00无谶作01从指令队列的第一字节中取走代码10队列为空11除第一字节外,还取走了后续字节中的代码表3.3 S.与53柑合代表的正在使用的奇存器公S)当前正在使用的段奇存器0 0 .01CESS3c Ua /CX3 Z OO31: HOLD(】ldm*tst兑线保持请求信号，输入。当8086/8088CHT之外的兑线主设备暴求 占用兑经时，通过该引脚WCTO发一个高电平的兑残保持请求信号.30： HLDA(iMiuwkb北场保持响应信号，徐出.当cross收到励3信号后，这时 如果CIU允许让出总线，
9、就在当前忌线周期完成时，在T4状态发出高电平有效的皿L信号编以噌 应.此时，CRT让出您线使用权，发出HDUW求的总线主设备获得以健的控制权28： M/IO(Me明X)存储器/输入出控粉信号，出.用来区分CTO是进行存付群 访何还是输入输出访问.当该信号为高电平时，表示OU正在和存储号进行数据传送：如为低电平， 表明CIU正在知输入/输出设备进行数据传送.在18方式，该引脚被浮置为高阻状右27： DT/Ri：dm.vt.ftjgsa/接收信号，输出.用来控制数据的传送方向. 当g为高电平时，8086CHTi#过数拥您转收发器进行数18发送：当为低电平时，则进行数据接收.在IM方式，它被浮置为高
10、阻状态.26： DENMoaH.)数据允许伯号，出。当使用It据忌线收发君时，该信号为收发悬的oe 端提供了一个控制信号，该信号决定是否允许数据通过致据忌fii收发甥.ii函为高电平时，收发器 在收或发两个方向上荐不能传送数据，当iiiS为低电平时，允许教据通过数据总线收发尊.25： ALE(AHrssLmmXii地址镇存允许伯号，输出.是80昉/8088提供崎地址做存器的 控制信号，菖电平有效.在任何一个兑线周期的T1状态，Att为高电平，以表示当前地址/敷据SL用 总线上输出的是地址信息，All由高骂低的下降沿把地址装入地位锁存昌中.24： lNTA(iaMxE Adslu”)中断噌应信号，输出用于对外设的中断请求作出相应. nm#实际上是两个连续的负豚冲信号，第一个负耿冲通知外设接口，它发出的中断请求己被允许； 外设接口接到第2个负献冲后，将中断类型号放到散据总线上，以便CRT根据中断类型号到内存的 中断向量表中找出对皮中断的中断服务入口地址,从而转去执行中断服务程序.
