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1、数字电子技术（第2版) 第一套 A卷一、单选题（每题1分）1. 回差是( B )电路的特性参数。 时序逻辑 B 施密特触发器C 单稳态触发器 D 多谐振荡器2 石英晶体多谐振荡器的重要长处是( )。A 电路简朴 B 频率稳定度高C 振荡频率高 D振荡频率低3.对TL与非门多余输入端的解决，不能将它们( B )。 与有用输入端并联 B 接地C 接高电平 D 悬空4. TL与非门的关门电平是08V，开门电平是V，当其输入低电平为0.4，输入高电平为3.2V 时，其低电平噪声容限为（ )A 1.2V B 1.2V C 0.V D .5V. 逻辑函数的最简与或式为( B ）A. B. C. D 在什么
2、状况下，“与非”运算的成果是逻辑。( D )A.所有输入是0 B 任一种输入是0 C. 仅一种输入是 D 所有输入是17. 组合逻辑电路( D ）。A 一定是用逻辑门构成的 B 一定不是用逻辑门构成的C 一定是用集成逻辑门构成的 A与B均可.已知逻辑函数的真值表如下，其体现式是（ C ）A. B C. D. 图29 要把不规则的矩形波变换为幅度与宽度都相似的矩形波，应选择( C )电路。 多谐振荡器 基本RS触发器C 单稳态触发器 施密特触发器10. 所谓三极管工作在倒置状态,是指三极管( C )。A 发射结正偏置，集电结反偏置B 发射结正偏置，集电结正偏置 发射结反偏置,集电结正偏置D 发射
3、结反偏置，集电结反偏置11 TL与非门的关门电平为08V，开门电平为2，当其输入低电平为0.4V,输入高电平为3.5V时，其输入高电平噪声容限为( D ）。 11 V B 1.3 C 1.2V D 1.V12. 下图电路,对的的输出逻辑体现式是( ）。A. B C . 图22413. 下列消除竞争冒险的措施中错误的是( ）。A 修改逻辑设计 B引入封锁脉冲C 加滤波电容 以上都不对. 持续86个同或, 其成果是 ( A )1 B. 0 C . 8615. 主从JK型触发器是( B ）。A在C上升沿触发 B在CP下降沿触发 C在CP=1的稳态下触发 与C无关的二、判断题(每题1分)1. 译码是编
4、码的逆过程，编码是唯一的,译码也一定是唯一的 。( )2.如果想实现并串转换可以选择数据分派器。( ）3. 表达逻辑函数的逻辑体现式与真值表是等价的。( ）4. 优先编码器的输入祈求编码的信号级别一般是下标号大的级别高。( )5. 逻辑函数已是最简与或体现式。 ( )6. 七段显示译码器数据输入是二进制码。( ) . 合适提高施密特触发器的回差电压，可以提高它的抗干扰能力。 ( ). 一种四位数比较器进行数值比较时,只有四位数所有比较完才干产生比较成果。（ ）9. CMOS门电路的输入端不容许浮空,是由于其输入阻抗很高,容易引起干扰( ）。1. 没有专门的数据选择器,一般是用译码器改接的11.
5、 分析组合逻辑电路一定得写出逻辑体现式。 ( )2 用施密特触发器可以构成多些振荡器。 ( ）13. 竞争冒险现象是可以消除的。（ ）14. 一片8选1数据选择器可以实现二输入函数。( )5.异或函数与同或函数在逻辑上互为反函数。 ( )三、计算分析题(每题0分)1. 分析如图36电路,阐明功能。图3174LS160功能表输 入输 出 000111计数10保持110保持2 基于74LS290的异步清零功能设计一种24进制计数器。74LS29功能表输 入输出1000110010计 数3. 用卡诺图化简逻辑函数. 用74LS290设计一种9进制计数器，采用反馈清零法。74S29功能表输入输 出 1
6、000 010 00计 数5.用卡诺图鉴别下式与否为最简与或式，如不是,则化简为最简与或式。 用7LS63设计一种85进制加法计数器，规定采用反馈归零法。74LS16功能表输 入输 出 0 00010111计数110保持110保持0用74L1,设计一种40进制计数器。74LS160功能表输 入输 出 000010111计数11保持110保持0数字电子技术(第2版） 第一套 A卷答案一、单选题(每题1分)B2B3.B4.C5B6.D.8.C9.C10.C1.12A1.1.B二、判断题（每题1分）.对的2.错误3.对的4.对的.错误6.错误7对的8.错误.对的0.对的1.错误1.对的13.对的1.
7、对的15.对的三、计算分析题（每题1分)1经分析知,片(1)为一种原则的1进制计数器。片()从0111开始计数，计满时输出为1001,因此片（)是进制计数器。因此两级计数器共同构成进制计数器。2. 先用两片74L29级连成10进制计数器,采用异步清零措施,S2010100，反馈函数为,计数范畴是3,连线图如图7330。图30. 图25由卡诺图得最简逻辑体现式为： 4. 运用74LS90的反馈清零功能实现9进制计数器。74LS20的清零信号为高电平，即时,才干清零。又9=（）2。因此如图719所示。又由于9进制计数器的容量不小于5,故应将和相连。连线如图731所示。图7395 图257由卡诺图得最简逻辑体现式为: 6. 4S是具有同步置数、同步清零功能的4位进制加法计数器。经分析，需要两片7LS16级联,计数范畴是084,反馈状态从高位到低位依次为(0101011）2=（)16,据此画出计数器的逻辑图如图36所示。图73267 设计两个计数器级连，计数器分别是10进制计数器和4进制计数器，如图7所示。由7LS160（)实现一种原则10进制计数器。进制计数器,采用7410(2）的同步置数功能实现。计数起始值是0110，当74LS160计满时,即输出为1001,由此实现4进制计数器。因此两级计数器级连构成进制计数器。图71
