TFT屏时序分析----AT043TN13

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1、TFT屏的典型时序。其中VSYNC是帧同步信号,VSYNC每发出1个脉冲,都意味着新的1屏视频资料开始发送。而HSYNC为行同步信号,每个HSYNC脉冲都表明新的1行视频资料开始发送。而VDEN则用来标明视频资料的有效,VCLK是用来锁存视频资料的像数时钟。并且在帧同步以及行同步的头尾都必须留有回扫时间,例如对于VSYNC来说前回扫时间就是(VSPW+1)(VBPD+1),后回扫时间就是(VFPD +1);HSYNC亦类同。这样的时序要求是当初CRT显示器由于电子枪偏转需要时间,但后来成了实际上的工业标准,乃至于后来出现的TFT屏为了在时序上于CRT兼容,也采用了这样的控制时序。AT043TN

2、13(台湾群创:4.3寸屏)时序图Vsync时:(左边第一行)Tv=Tvp(帧之间垂直同步的无效行数(LCD屏幕的Datasheet一般有推荐值) )+Tvb(帧数据结束后的空白行数(LCD屏幕的Datasheet一般有推荐值)+Tvd+Tvf(帧数据开始前的空白行数(LCD屏幕的Datasheet一般有推荐值);Hsync时:(左边第七行)Th=Thp(行之间水平同步的无效CLK时钟数(LCD屏幕的Datasheet一般有推荐值) )+Thb(行结束后的CLK时钟数(LCD屏幕的Datasheet一般有推荐值)+Thd+Thf(行开始前的CLK时钟数(LCD屏幕的Datasheet一般有推荐

3、值);LCD屏幕的Datasheet推荐值设置其他信号线 其他信号线包括VD0-VD23和VFRAME、VLINE、VCLK等,分别在GPCCON,GPDCON中选择相应功能。 设置LCD的频率(VCLK) LCD的Datasheet上一般会写有一个推荐的频率,比如我使用的屏幕推荐频率为6.4M,我需要通过一些计算选择一个合适的CLKVAL以产生这个频率: 对于TFT LCD,S3C2440提供的VCLK的计算公式为:VCLK = HCLK / (CLKVAL+1)*2) 可以得出:CLKVAL = HCLK / (VCLK * 2) - 1 我的HCLK是100Mhz(CPU运行在400Mh

4、z, CLKDIV_VAL设置为5,Fclk:Hclk:Pclk = 1:4:8),VCLK使用屏幕推荐的6.4M,得到:CLKVAL = 100000000 / (6400000 * 2) - 1 = 6.8 选择最接近的整数值7,写入LCDCON1:17-8。 (VCLK其实就是根据 每秒帧数*帧行数*行像素 计算出来的,帧行数和行像素需要包含空白数和同步数) 设置其他相关参数 LCD相关的参数主要还有这几个:LIN: LCD水平像素-1,如320-1 = 319HOZVAL: LCD垂直像素-1,如240-1 = 239HFPD: 行开始前的VCLK时钟数(LCD屏幕的Datasheet

5、一般有推荐值)HBPD: 行结束后的VCLK时钟数(LCD屏幕的Datasheet一般有推荐值)HSPW: 行之间水平同步的无效VCLK时钟数(LCD屏幕的Datasheet一般有推荐值)VFPD: 帧数据开始前的空白行数(LCD屏幕的Datasheet一般有推荐值)VBPD: 帧数据结束后的空白行数(LCD屏幕的Datasheet一般有推荐值)VSPW: 帧之间垂直同步的无效行数(LCD屏幕的Datasheet一般有推荐值) (相关寄存器LCDCON2, LCDCON3, LCDCON4) AT043TN13(台湾群创:4.3寸屏)实验值;=; 480*272;= Clkval_TFT=dw

6、ord:1Vbpd=dword:2Vfpd=dword:2Vspw=dword:AHbpd=dword:12Hfpd=dword:10Hspw=dword:29LcdXsize_TFT=dword:1e0LcdYsize_TFT=dword:110;=VSPW指的是VSYNC处于高电平时的线的数目。HSPW指的是HSYNC处于高电平时的VCLK的数目。接线情况AT043TN13 飞凌OK3板子(管脚)1 VLED- GND2VLED+ +20V3 GND4 VDD=5V512R 2330 1320 G1417/19222128 B 61329 GND30 PCLK 39(VLCK_L)31 DISP 32(LCD_PWREN:接上此脚后屏幕的后半部分有闪烁,可用此脚控制LED的背光电源;为高时点亮屏幕;设置时间间隔的方法:WINCE界面右键- -属性-背景光-可改变时间)32 HSYNC 38(VLINE)33 VSYNC 37(VFRAME)34 DE 36(VM)35 AVDD=5V36 GND37 X1 44(TSXP) 38 Y1 48(TSYP)39X2 43(TSXM)40 Y2 47(TSYM)注:VLED-,VLED+需各串联一个100欧的电阻。

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