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1、摘 要本系统以51单片机为控制核心，由正弦信号发生模块、功率放大模块、调幅（AM）、调频（FM）模块、数字键控（ASK，PSK）模块以及测试信号发生模块组成。采用数控的方法控制DDS芯片AD9850产生0Hz30MHz正弦信号，经滤波、放大和功放模块放大至6v并具有一定的驱动能力。测试信号发生模块产生的1kHz正弦信号经过调幅（AM）模块、调频（FM）模块，对高频载波进行调幅或调频。二进制基带序列信号送入数字键控模块，产生二进制PSK或ASK信号，同时对ASK信号进行解调，恢复出原始数字序列。另外，本系统从简单、调整方便、功能完备为出发点，基本实现了设计中的要求，波形输出较稳定，且精度较高。本
2、设计还配备有LED显示屏、键盘，提供了友好的人机交互界面。关键词：直接数字频率合成（DDS）AD9850锁相环VCO 调幅 调频 数字键控ABSTRACTThis system is in the core of Micro-Processor , consist of sine signal generating module, Power amplifier, Amplitude Modulator, Frequency Modulator, ASK/PSK module and test signal generating module. The AD9850 controlled by
3、 MicroProcess in digital way to generate sine signal with the bandwidth 0Hz to 30MHz adjustable per 1Hz. After processing by LPF & power amplifier, the output signal has a peak value of move than 6V. The sine signal at 1 KHz was send to AM and FM module to modulate the high frequency carrier wavefor
4、m. The binary sequential was send to the relative module to generate ASK and PSK signal. At last demodulate module demodulate the ASK signal and got the same binary sequential as set before.In addition,the design of this system is basically satisfy the requirements of the symplification ,easy-modifi
5、cation and full-function.the output square wave is very stable and its precision is also very high. In order to provide a friendly user interface, the LED and remote infrared control keyboard was introduced in this system.Key words：DDS ; AD9850; PLL; VOC; AM; FM; ASK; PSK第一章绪论1.1课题研究的意义与作用1971年，美国学者
6、j.Tierney等人撰写的A Digital Frequency Synthesizer-文首次提出了以全数字技术，从相位概念出发直接合成所需波形的一种新的频率合成原理。限于当时的技术和器件水平，它的性能指标尚不能与已有的技术相比，故未受到重视。近10年间，随着微电子技术的迅速发展，直接数字频率合成器（Direct Digital Frequency Synthesis简称DDS或DDFS）得到了飞速的发展，它以有别于其它频率合成方法的优越性能和特点成为现代频率合成技术中的姣姣者。具体体现在相对带宽宽、频率转换时间短、频率分辨率高、输出相位连续、可产生宽带正交信号及其他多种调制信号、可编程和
7、全数字化、控制灵活方便等方面，并具有极高的性价比。1.2 DDS的研究现状及发展趋势在频率合成（FS, Frequency Synthesis）领域中，常用的频率合成技术有模拟锁相环、数字锁相环、小数分频锁相环（fractional-N PLL Synthesis）等，直接数字合成(Direct Digital SynthesisDDS)是近年来新的FS技术。单片集成的DDS产品是一种可代替锁相环的快速频率合成器件。DDS是产生高精度、快速变换频率、输出波形失真小的优先选用技术。DDS以稳定度高的参考时钟为参考源，通过精密的相位累加器和数字信号处理，通过高速D/A变换器产生所需的数字波形（通常
8、是正弦波形），这个数字波经过一个模拟滤波器后，得到最终的模拟信号波形。如图1-1所示，通过高速DAC产生数字正弦数字波形，通过带通滤波器后得到一个对应的模拟正弦波信号，最后该模拟正弦波与一门限进行比较得到方波时钟信号。DDS系统一个显著的特点就是在数字处理器的控制下能够精确而快速地处理频率和相位。除此之外，DDS的固有特性还包括：相当好的频率和相位分辨率（频率的可控范围达Hz级，相位控制小于0.09）,能够进行快速的信号变换（输出DAC的转换速率300百万次/秒）。这些特性使DDS在军事雷达和通信系统中应用日益广泛。其实，以前DDS价格昂贵、功耗大（以前的功耗达Watt级）、DAC器件转换速率
9、不高，应用受到限制，因此只用于高端设备和军事上。随着数字技术和半导体工业的发展，DDS芯片能集成包括高速DAC器件在内的部件，其功耗降低到mW级（AD9851在3.3v时功耗为650mW），功能增加了，价格便宜。因此，DDS也获得广泛的应用：现代电子器件、通信技术、医学成像、无线、PCS/PCN系统、雷达、卫星通信。基准时钟相位累加器相位/幅度变换D/A变换低通滤波比较器fo图1-1 DDS方波输出框图1.3 DDS的系统简介1.3.1DDS的基本原理DDS的基本原理是利用采样定理，通过查表法产生波形。DDS的结构有很多种，其基本的电路原理可用图1-2来表示。 相位累加器波形存储器D/A转换器
10、低通滤波器 K fS FO图1-2 DDS原理图相位累加器由N位加法器与N位累加寄存器级联构成。每来一个时钟脉冲，加法器将频率控制字与累加寄存器输出的累加相位数据相加，把相加后的结果送至累加寄存器的数据输入端。累加寄存器将加法器在上一个时钟脉冲作用后所产生的新相位数据反馈到加法器的输入端，以使加法器在下一个时钟脉冲的作用下继续与频率控制字相加。这样，相位累加器在时钟作用下，不断对频率控制字进行线性相位累加。由此可以看出，相位累加器在每一个时钟脉冲输入时，把频率控制字累加一次，相位累加器输出的数据就是合成信号的相位，相位累加器的溢出频率就是DDS输出的信号频率。 用相位累加器输出的数据作为波形存
11、储器（ROM）的相位取样地址，这样就可把存储在波形存储器内的波形抽样值（二进制编码）经查找表查出，完成相位到幅值转换。波形存储器的输出送到DA转换器，DA转换器将数字量形式的波形幅值转换成所要求合成频率的模拟量形式信号。低通滤波器用于滤除不需要的取样分量，以便输出频谱纯净的正弦波信号。 DDS在相对带宽、频率转换时间、高分辨力、相位连续性、正交输出以及集成化等一系列性能指标方面远远超过了传统频率合成技术所能达到的水平，为系统提供了优于模拟信号源的性能。1.3.2 DDS的性能特点（1）输出频率相对带宽较宽输出频率带宽为50%s（理论值）。但考虑到低通滤波器的特性和设计难度以及对输出信号杂散的抑
12、制，实际的输出频率带宽仍能达到40%s。 （2）频率转换时间短 DDS是一个开环系统，无任何反馈环节，这种结构使得DDS的频率转换时间极短。事实上，在DDS的频率控制字改变之后，需经过一个时钟周期之后按照新的相位增量累加，才能实现频率的转换。因此，频率转换的时间等于频率控制字的传输时间，也就是一个时钟周期的时间。时钟频率越高，转换时间越短。DDS的频率转换时间可达纳秒数量级，比使用其它的频率合成方法都要短数个数量级。 （3）频率分辨率极高若时钟s的频率不变，DDS的频率分辨率就由相位累加器的位数决定。只要增加相位累加器的位数N即可获得任意小的频率分辨率。目前，大多数DDS的分辨率在Hz数量级，
13、许多小于MHz甚至更小。 （4）相位变化连续 改变DDS输出频率，实际上改变的每一个时钟周期的相位增量，相位函数的曲线是连续的，只是在改变频率的瞬间其频率发生了突变，因而保持了信号相位的连续性。 （5）输出波形的灵活性只要在DDS内部加上相应控制如调频控制FM、调相控制PM和调幅控制AM，即可以方便灵活地实现调频、调相和调幅功能，产生FSK、PSK、ASK和MSK等信号。另外，只要在DDS的波形存储器存放不同波形数据，就可以实现各种波形输出，如三角波、锯齿波和矩形波甚至是任意的波形。当DDS的波形存储器分别存放正弦和余弦函数表时，既可得到正交的两路输出。 （6）其他优点 由于DDS中几乎所有部
14、件都属于数字电路，易于集成，功耗低、体积小、重量轻、可靠性高，且易于程控，使用相当灵活，因此性价比极高。第二章 单片机80C51的简介2.1 主芯片80C51的硬件资源2.1.1单片机的概念单片机（microcontroller，又称微控制器）是在一块硅片上集成了各种部件的微型计算机。这些部件包括中央处理器CPU、数据存储器RAM、程序存储器ROM、定时器/计数器和多种I/O接口电路。图2-1是80C51单片机的基本结构图图2-1 80C51单片机的基本结构图1.80C51单片机的结构特点有以下几点： 8位CPU； 片内振荡器及时钟电路； 32根I/O线； 外部存储器ROM和RAM，寻址范围各
15、64KB； 两个16位的定时器/计数器； 5个中断源，2个中断优先级 全双工串行口 布尔处理器2.定时器/计数器80C51内部有两个16位可编程定时器/计数器，记为T0和T1。16位是指它们都是由16个触发器构成，故最大计数模值为2-1。可编程是指他们的工作方式由指令来设定，或者当计数器来用，或者当定时器来用，并且计数（定时）的范围也可以由指令来设置。这种控制功能是通过定时器方式控制寄存器TMOD来完成的.如果需要，定时器在计到规定的定时值时可以向CPU发出中断申请，从而完成某种定时的控制功能。在计数状态下同样也可以申请中断。定时器控制寄存器TCON用来负责定时器的启动、停止以及中断管理在定时工作时，时钟由单片机内部提供，即系统时钟经过12分频后作为定时器的时钟。技术工作时，时钟脉冲由TO和T1输入3.中断系统80C51的中断系统允许接受五个独立的中断源，即两个外部中断申请，两个定时器/计数器中断以及一个串行口中断。外部中断申请通过INTO和INT1（即P3.2和P3.3）输入，输入方式可以是电平触发（低电平有效），也可以是边沿触发（下降沿有效）。两个定时器中断请求是当定时器溢出时向CPU提出
