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1、微机接口与通讯平时作业1. 从微型计算机的构造分析微解决器与存储器及I的关系,并阐明总线构造的长处。答:微型计算机是以微解决器即U为核心，系统总线连接内存储器和I/O接口电路而构成的。微型计算机采用了总线构造，这种构造可以使得系统内部各部件之间的互相关系变为各部件之间面向总线的单一关系。2. 从计算机应用角度分析不同构造、规模、体现形式的微型计算机的应用目的以及性能指标。答:8位机，在80年代初期和中期使用。字符、数字信息,适合于一般的数据解决。16位机，可进行大量的数据解决的多任务控制。3位机,除用于过程控制、事务解决、科学计算等领域、多媒体解决以及计算机辅助设计、计算机辅助制造等。 单片机
2、，体积小、功耗低，重要应用于智能仪器仪表以及其他控制领域。个人计算机,合用于家用、商用、教育等多种应用领域。工程工作站是一种微型化的功能强大的计算机,有速度快、内存大等特点,又有小巧灵活、轻便价廉等长处。3. 论述并比较886、0286、8386、80486、Petium PU的内容构造。答：8028：四个独立的解决部件,即执行部件、总线部件、指令部件IU和地址部件。 采用流水线作业方式,使各部件能同步并行地工作。 8036:由六部分构成,即总线接口部件、指令译码部件、执行部件、分段部件和分页部件。 8046：基本沿用386的体系构造,由8个基本部件构成：总线接口部件、指令预取部件、指令译码部
3、件、执行部件、控制部件、存储管理部件、高速缓存部 件和高性能浮点解决部件。 Pentium:采用了许多过去在大型机中才采用的技术,迎合了高性能微型机系统需要,其重要体目前超标量流水线设计、双高速缓存、分支预测、改善浮点 运算等方面。4. 论述指令周期、总线周期、时钟周期的互相关系，并举若干条86CU机器指令的执行过程来阐明上述三种周期。答:时钟周期是微解决器动作解决的最小时间单位，一种总线周期由若干个时钟周期所构成。一种指令周期一般由若个总线周期所构成,对于读取指令代码, 就是一种存储器读总线周期。 将微解决器内部累加器中的值写入指定存储器单元中,执行这条指令也许就需要二个总线周期:读总线周期
4、和写总线周期。 读总线周期： 写总线周期: T1:提供地址 1：提供地址T：读信号有效 2：写信号有效T：数据有效 T3:数据有效4：读操作结束 T4：写操作结束5. 给出88CPU处在最小模式时的CU子系统构造图,并阐明构成CP子系统的各芯片的功能。答：构造图如下 8084：用于产生系统时钟信号;地址锁存器:用于暂存地址值； 数据缓冲器,用于驱动数据。6. 阐明一般微解决器的内部构成与外部重要引脚的功能，并阐明执行加法指令过程中指令代码和加工的数据在P内部各部件流动和外部引脚的信号变化状况。答：构成微解决器的最基本的部件是运算部件、控制部件、寄存器组和内部数据总线。 外部重要引脚功能: 地址
5、线:输出，用于提供存储器或I/O接口的地址。地址线的位数决定了微解决器的寻址范畴。 数据线：双向，用于提供微解决器与外部互换数据的通道。 从累加器存入锁存器的数据和暂存器中的数据通过ALU运算,成果通过内部数据总线存回累加器,输出CU外部到存存储器或I/O。运算成果将影响标志寄存器和十进制调节电路,并对下一次运算产生作用。7. 相对实模式,阐明保持模式的特点。答:保持模式的特点： （1）地址由段描述表按“段地址”查到相应描述符,得到的真实地址+偏移 (2） 32位地址线，拥有GB的寻址(3） 实现虚拟存储和代码保护保持模式比实模式多了如下： (1） 寄存器GDR,DR,IR,TR,CR3。 （
6、2) 数据段，描述符表(GDT，DT)，任务数据段(TS)，页表。 (） 机制,权限检测（运用选择子/描述符/页表项的属性位）,线性地址到物理地址的映射。8. 论述计算机三级存储体系中Cache、主存、辅存的特点与作用，并阐明目前三类存储器由哪些类型的存储器承当,其存储器特性有什么特性。答：Che：构成:高速SRA;特点：迅速的存取性能,用于寄存PU访问频度最高的数据。 主存：构成:DRAM;特点:速度和容量介于Cache和辅存,用于寄存PU目前执行的程序和所需要的数据。 辅存：构成:磁盘、磁带、光盘等；特点：存储容量大,用于后备的程序和数据。 三级存储体系的目的：存储体系的速度入接近ace，
7、存储体系的成本接近于辅存。9. 阐明半导体存储器的内部构造，并比较静态RAM和动态RAM在存储原理、外部特性、性能指标等方面的异同。答:半导体存储器芯片的内部构造基本相似，都是由存储体和外围电路二部分构成。存储体是由一系列按行/列排列的基本存储单元所构成。外围电路由地址译码器、I/O电路、片选控制和输出驱动电路所构成。10. 以静态RM作为内存储器,比较并联组合和串联组合，阐明地址线、数据线、控制线的连接要点。答：并联组合：8片芯片为1组，一旦选中，则同步工作,或者输入，或者输出。数据线：每片存储器芯片数据线连至CPU不同位的数据线。地址线:每片地址线的连接都相似,与CU的地址线相连接。控制线
8、：每片的控制线连接都是相似。读写控制线连CU的读写控制线。 串联组合:U用高位地址选择存储器芯片,用低位地址选择赶集器芯片中的存储单元。同一时刻,CPU访问一种存储器芯片中的一种存储单元。 数据线:存储器芯片的数据线与P的数据线直接相连。地址线:存储器芯片的地址线与CPU低位地址线直接相连,用于选择芯片内的存储单元。控制线:存储器的读写控制线与CU的读写控制线直接相连,存储器的片选信号线由高位地址线经译码产生。11. 一般CP地址总线可寻址的范畴比系统实际使用的内存容量要大。试举一地址译码电路为例,阐明地址译码器的片选端和译码输入端应连接CPU的什么信号线,并分析该译码电路的各译码输出端所相应
9、的存储器地址范畴。答:用8K*的存储器芯片构成的16RAM电路，低位地址线A12-A0直接连至每一片的6264芯片的地址输入端，高位地址线经译码后来产生片选信号,分别连接到2片626的片选输入端。地址译码器4LS138是一种常用的38译码器，本地址A19-A161110时，该译码器选中，也就是说,该译码器 Y7-Y0输出的地址范畴为00H-EFFH。其中：当A15A1=000时，0输出有效，其地址范畴为 E0000-1FFF;当A5-A13=00时，Y1输出有效，其地址范畴为EH-E3FFFH。12. 针对动态RM的地址线分行列输入以及刷新行地址的输入，与静态M的接口电路相比较,阐明其存储器接
10、口电路有什么特点。答：（1）同静态RAM，CU输出的地址总线高位部分用于进行地址译码产生片选信号，地址总线的低位部分用于选择存储器内部的存储单元。但是,由于动态RM的地址输入是分行、列进行的，因此不能直接将PU的低位地址线直接连至存储器的地址线输入,而是需要将这部分地址一分为二,按行、列分时输入存储器。 （2)由于动态RAM有刷新规定，既需要刷新控制信号,也需要为动态RM提供刷新地址，因此,作为动态RAM的连接,还需要有一种产生刷新地址的电路，并通过选择电路，能在需要刷新时候将刷新地址送入动态AM13. 通过一般I/O接口电路的构造,论述/O接口电路的功能。答：I/O接口是为了协调CPU与多种
11、外设间的矛盾（不匹配）而设臵的介于CPU和外设之间的控制逻辑电路。因此,接口电路要面对CPU和外设两个方面, I/O接口有如下功能: ()数据缓冲和锁存功能（2）接受和执行CU命令的功能 (）信号电平转换功能 (4)数据格式变换功能 (5）中断管理功能（)可编程功能 对一种具体的接口电路来说,不一定都规定具有上述功能,不同的外设,不同的用途，其接口功能和内部构造是不同的。14. 与存储器映象寻址方式相比较，阐明独立I/O寻址方式的特点。答：（1）存储器映象寻址方式的编址方式是把系统中的每一种/0端口都看作一种存储单元，并与存储单元同样统一编址。而IO单独编址方式对系统中的输入输出端口地址单独编
12、址,构成一种/O空间； (）存储器映象寻址方式把I/O地址映射到存储空间,作为整个存储空间的一小部分,而I单独编址方式不占用存储空间，而是用专门的IN指令和T指令来访问这种具有独立地址空间的端口;15. 比较无条件传送方式、程序查询方式、中断方式以及M方式这四种数据传送方式，在硬件电路、U作用、应用范畴等方面论述其特性。答:无条件传送方式重要应用于己知或固定不变的低速I/接口设备或不必等待时间的设备。若是输入设备则直接使用三态缓冲器和数据总路线相连，PU在执行输入指令时，外设的数据是准备好的。若是输出设备,规定接口具有锁存功能，以使PU送出的数据在接口电路的输出端保持某些时间。 程序查询方式的
13、接口电路除了有传送数据的端口以外，还要有传送状态的端口。对于输入过程来说，当外设将数据准备好时,则使接口的状态端口中的“准备好”标志位臵成有效，表达目前输出数据端口己经处在“空闲”状态,可以接受下一种数据。 DM方式数据传送不需要CPU介入,由DMA控制器直接控制数据完毕存储器和I/O之间的传送，采用DMA控制器的硬件替代了本来的软件来控制数据的传送，且不需进行保护现场和恢复现场之类的额外操作，因此数据传送速度快、I/O响应时间短、CPU额外开销小，但增长了系统硬件的复杂性和提高了系统的成本。16. 以808CP为例,阐明中断响应和中断返回的过程。在阐明此过程中,如何保证优先权最高的中断申请源
14、能得到CP的中断服务。答:CPU响应中断: (1)关闭中断（为严禁PU响应其他中断申请);(2)保护断点现场信息(一般将断点和标志寄存器内容入栈）;（)获得中断服务入口地址，转中断服务程序。 一旦CPU响应中断,就可转入中断服务程序中：(1)保护现场 ；(）开中断;(3)中断服务;(）关中断；（5)恢复现场;（6）开中断返回。17. 论述I 829中断控制器的功能以及编程措施。答：(1)单片85A可以连接8个中断源, 多片829A连接后,可以控制多达4个中断源； (2） 可以设臵中断源的中断类型号; 在CPU应答后,能自动地向CPU发送中断类型号; (3)能管理中断源的优先级，并有固定优先级(
15、自动嵌套方式）和循环优先级（相等优先级)两种管理方式; (4)可以设臵中断祈求的方式（电平方式和脉冲方式）。259必须先进行初始化编程，后进行工作编程。初始化命令共预臵个命令字ICW1C4。工作编程用OCW-中断屏蔽操作命令字,OCW1用来实现对中断源的屏蔽功能，O的内容直接写入屏蔽寄存器IMR。18. 以Intel 7为例,阐明D控制器的一般构造及功能答：Intel 8283的DMA控制器构造有： (1）时序与控制逻辑;（）优先级编码电路;（3）数据和地址缓冲器组；(4）命令控制逻辑；(5）内部寄存器组； 87的引脚功能: (）LK：输入，时钟信号。(2)（HI SELET):输入，片选信号，低电
