多功能数字钟电路设计课程设计

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1、信息工程学院课程设计报告书题目: 多功能数字钟电路设计 专 业： 电子信息科学与技术 信息工程学院课程设计任务书学 号学生姓名专业（班级）电子信息科学与技术设计题目 多功能数字钟电路设计设计技术参数1. 电阻、电容构成的555多谐振荡器产生1OOOHz的方波信号，再经过三个分频器产生1Hz的方波信号。2. 计数器74ls160和74ls161加上74ls48译码器构成数字时钟。3. 门电路构成的校时电路能够对时、分准确校时。设计要求 准确计时，以数字形式显示时、分、秒的时间。 小时的计时要求为“23翻0”，分和秒的计时要求为60进制进位。 校正时间。 定时闹时。 正点报时。工作量1. 整体构思

2、设计方案花了1天。2. Proteus仿真花了3个工作日。3. 课程设计报告制作花了2天。工作计划参考资料指导教师签字教研室主任签字 年 月 日 学生姓名： 学号： 专业（班级）： 课程设计题目： 指导教师评语： 成绩： 指导教师： 年 月 日信息工程学院课程设计成绩评定表 摘 要 数字钟是一个对1Hz频率进行计数的电路。振荡器产生的时钟信号经过分频器形成秒脉冲信号，秒脉冲信号输入计数器进行计数，显示出时间。秒计数器电路计满60后触发分计数器电路，分计数器电路计满60后触发时计数器电路，当计满24小时后重零开始计数。一般由振荡器、分频器、计数器、译码器、数码显示器等几部分组成。振荡电路：主要用

3、来产生时间标准信号。石英晶体振荡器可以提高时间信号的稳定度。分频器：振荡器产生的标准信号频率很高，要得到“秒”信号，需一定级数的分频器进行分频。计数器：有了“秒”信号，则可以根据60秒为1分，24小时为1天的进制，分别设定“时”、“分”、“秒”的计数器，分别为60进制，60进制,24进制计数器，并输出一分，一小时，一天的进位信号。译码显示：将“时”“分”“秒”显示出来。将计数器输入状态，输入到译码器，产生驱动数码显示器信号，呈现出对应的进位数字字型。 关键词：振荡电路 分频器 计数器 译码器 目 录1 任务提出与方案论证11.1 设计多功能数字钟的背景11.2 方案论证12 总体设计32.1

4、整体设计图32.2 proteus仿真图43 详细设计53.1振荡器设计53.2分频器设计53.3时分秒计数器设计63.4校时电路设计113.5定时控制电路的的设计113.6仿广播电台正点报时电路的的设计124 总结13参考文献14 1 任务提出与方案论证1.1 设计多功能数字钟的背景 数字钟是一种用数字电路技术实现时、分、秒计时的装置，与机械式时钟相比具有更高的准确性和直观性，且无机械装置，具有更长的使用寿命，因此得到了广泛的使用。其采用数字电路实现对时、分、秒数字显示的计时装置,广泛用于个人家庭,车站, 码头办公室等公共场所,成为人们日常生活中不可少的必需品,由于数字集成电路的发展和石英晶

5、体振荡器的广泛应用,使得数字钟的精度,远远超过老式钟表, 钟表的数字化给人们生产生活带来了极大的方便，而且大大地扩展了钟表原先的报时功能 。结合以上的原因，加之对数字的爱好，最终决定做多功能数字钟的设计。1.2 方案论证 方案一：由集成逻辑门与RC组成的时钟源振荡器或由集成电路定时器555与RC组成的多谐振荡器作为时间标准信号源。 图A 方案二:振荡器是数字钟的核心。振荡器的稳定度及频率的精确度决定了数字钟计时的准确程度，通常选用石英晶体构成振荡器电路。石英晶体振荡器的作用是产生时间标准信号。因此，一般采用石英晶振荡器经过分频得到这一时间脉冲信号。图B 如图(2)所示为电子手表集成电路（如5C

6、702）中的晶体振荡器电路，常取晶振的频率为32768Hz，因其内部有15级2分频集成电路，所以输出端正好可得到1Hz的标准脉冲。 结论：与方案一相比，方案二使用的振荡器频率的精度与稳定度基本决定了数字电子钟的质量保证数字钟的走时准确及稳定，故选用方案一。2 总体设计首先构成一个555定时器产生振荡周期为一秒的标准秒脉冲；然后秒的个位由74LS161采用清零法完成0-9的循环显示，同时在清零端加非门连向秒的十位CLK端完成秒的个位向十位的进位，秒的十位由74LS160采用清零法完成0-5的循环显示，这样就组成了六十进制的秒计数器；六十进制分计数器的设计方法跟秒计数器的设计方法完全相同；二十四进

7、制时计数器由两片74LS160采用置数法完成。使用555定时器的输出作为秒记数器的CP脉冲，把秒记数器的进位输出作为分记数器的CP脉冲，分记数器的进位输出作为时记数器的CP脉冲；译码器使用的是74LS48； 数码管选择的是普通共阴数码管。校时电路采用按键与门电路实现对时、分的校准。功能扩展电路有定时扩展电路和仿广播台正点报时电路。 2.1 整体设计图译码驱动译码驱动时十位计数分频器电路分频器电路振荡器电路译码驱动译码驱动译码驱动译码驱动时个位计数分十位计数分个位计数秒十位计数秒个位计数校时电路校分电路 图2-1数字钟整体设计图2.2 proteus仿真整体图 图2-2整体仿真图3 详细设计 3

8、.1振荡器设计 振荡器是数字电子时钟的核心部分，其作用是产生一个标准频率的脉冲信号，信号振荡频率的精度和稳定度决定了数字钟的质量。本实验中采用555集成芯片与RC构成多谐振荡器产生脉冲信号（如图2），信号从“3”脚输出，。调节Rp可以改变脉冲信号的频率。一般来说，振荡频率越高，产生信号的精确度越高，但是，同时振荡频率增大耗电量也会增加。试验中，微调Rp使信号的输出频率为1kHZ。（若要对精确度具有更高要求的时候，可以采用石英晶体振荡器产生脉冲信号） 3.2分频器器设计 由于振荡器产生的频率很高（f=1kHZ），要得到标准的秒脉冲信号，需要分频电路。本实验由集成电路定时器555与RC组成的多谐振

9、荡器，产生1KHz的脉冲信号。因此，可以采用三片74LS90集成芯片（二五十分频器）来实现分频。计数脉冲从输入，若为输出时实现二分频；当与相连，作为输出端时，电路实现十分频。三片74LS90均采用十分频连接，从而得到需要的1HZ标准秒脉冲信号。电路如图3.。 3-2 分频器设计3.3时分秒计数器的设计 3.3.1 60进制计数器60进制计数器由一片74LS161，一片74LS160和两片74LS00，两片NOT门连接而成。74LS00是2输入与非门，其仿真管脚图如图4。74LS00在此电路中是为了到10，59或23以后再进位时进行置零或置数，用于置数法和清零法的反馈。NOT门在此电路中接在74

10、LS00（清零）后是为了到10，59后作为秒十位，分十位的CLK脉冲而设计的，其仿真管脚图如图5所示：图4 74LS00仿真管脚图 3.3.1 NOT门仿真管脚图74LS161是一种典型的高性能，低功耗4位同步加计数器，可以用置数法和清零法的反馈完成十进制计数。74LS161引脚图如下图所示：3.3.1 74LS161仿真引脚图 74LS161功能表如下表1所示： 表1 74LS161功能表CLKENPENT工作状态0置零10预置数1101保持110保持1111计数74LS160的功能表跟74LS16的完全相同，所不同的仅在于74LS160是十进制而74LS161是十六进制。利用74LS161，74LS160，74LS00和非门即可以组成60进制分和秒计数器，60进制计数器接线如下图7所示。其中输出的脉冲经过74LS00和非门后到下一个计数器的脉冲输入，采用的是清零法连接电路。图7 60进制计数器接线图60进制原理第1片的74LS161的输出Q1，Q3经74LS00反向后接清零端,在74LS00后接上非门NOT后接秒的十位CLK端，当第1片的计数完9后,Q1，Q3同时为高电平1经74LS00后立刻清零,同时74LS00后的非门NOT接第2片计数器CLK端，在清零的同时就完成了向秒的十位的进位；第2片计数器的输出Q1，Q3接第2片的计数