实验3vhdl语言设计简单电路

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实验3vhdl语言设计简单电路实验目的:1. 学习与门,非门,与非门,或门,或非门,异或门和异或非门的vhdl描述。2. 学习vhdl的文字规范描述,程序书写方法和quartus ii功能仿真一:位全加器1.建立vhdl file2.编写程序直到编译正确。3.建立波形文件,并仿真。二:二选一数据选择器1.建立vhdl file2.编写程序直到编译正确。3.建立波形文件,并仿真。

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