eda实习心得体会

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1、eda实习心得体会 这次eda课程设计的实习激起了我尔后勤奋进修的乐趣,我想这将对我以后的进修发作主动的影响。其次,此次课程设想让我充份认识到到团体,在此分享心得体会。下面是xx为大家搜集整理的,欢迎大家阅读。 篇1 不到一周的EDA实训就这么结束了,即使时间有些短暂,学习的有些仓促,不过这次实训我是认真的。我没有像以往一样单一的照猫画虎,没有等候着参考他人的结果,而是一边画电路图,一边分析原理,碰到不会的,自己先勇于尝试,然后和同学交流。即使有很多地方依然不是很明白,不过自己最少尽心尽力了。 首次使用Multisim软件,加之又是英文版的,会很吃力,我们可能找不准元器件,可能因不懂它的属性而

2、用错,像这么的问题不是没出现过,就在完成实训第一题目时这些错误就出现了。当初因为用错电阻的属性,造成仿真出的波形和他人不一样,然而这个问题在当初困扰了我和同学很久,一直找不出问题出在哪里,以后还好有老师的指导,才找出问题的所在。 实训内容包含了对电路、模拟电子、数字电路的简单操作,我们经过Multisim软件画出电路图,用虚拟的仪表对电路参数进行测量,用虚拟示波器对电路输入输出波形进行观察,这不但让我们熟悉使用该软件,同时体验软件仿真在电路分析中的主要作用,利用该软件不但能够正确测量各参量,还可帮助我们测试电路的性能。它确实很方便实用。 即使有了这种强大软件的帮助,不过对于我们这些初学者来说,

3、必需学会自己分析电路原理,来判定测试结果。电路、模电、数电是一年前学的,或许是因时间长,好多知识点被遗忘了,或许是当初就没将这三门功课学好,对知识点的生疏,造成实训的进行并不是很顺利,有时半天分析不出一个原理图。 实训时间很短,该软件的学习过程还很长,我不期望自己因实训结束而停止对其的认识和学习。写到这,我想起前几天一位留学回国的姐说过的话:你现在所学的那些专业软件,你必需深入了解和学习;就学校进行一到两礼拜的学习是远远不够的,自己课后必需加强学习。之前的实训机会已经被荒废了,现在的机会自己应该好好珍爱。大学的美好时光所剩不多,假如以为自己之前没有尽心尽力,那么接下来的时间自己好好珍爱吧。 篇

4、2 EDA课程设计心得体会,这次EDA课程设计历时两个星期,经过这次设计,经过这次课程设计使我知道了理论和实际相结合是很主要的,在设计的过程中碰到问题,同时在设计的过程中发觉了自己的不足之处,这次设计的数字秒表还是比较成功的,在设计中碰到了很多问题,PLC实训心得,在学完PLC理论课程后我们做了课程设计,此次设计以分组的方法进行,没有过实际开发设计的经验,我们基础学会了PLC设计的步聚和基础方法。 这次EDA课程设计历时两个星期,在整整两个星期的日子里,能够说是苦多于甜,不过能够学的到很多很多的东西,同时不但能够巩固以前所学过的知识,而且学到了很多在书本上所没有学到过的知识。经过这次设计,深入

5、加深了对EDA的了解,让我对它有了愈加浓厚的爱好。尤其是当每一个子模块编写调试成功时,心里尤其的快乐。不过在编写顶层文件的程序时,碰到了不少问题,尤其是各元件之间的连接,和信号的定义,总是有错误,在细心的检验下,最终找出了错误和警告,排除困难后,程序编译就经过了,心里最终舒了一口气。在波形仿真时,也碰到了一点困难,想要的结果不能在波形上得到正确的显示:在设定输入的时钟信号后,数字秒表开始计数,不过一直看不到秒和小时的循环计数。以后,在数十次的调试以后,才发觉是因为输入的时钟信号对于器件的延迟时间来说太短了。经过一再调试,最终找到了比较适宜的输入数值:时钟周期设置在15秒左右比较适宜。另外,En

6、dtime的值需要设置的长一点:500us左右,这么就能够观察到完整的仿真结果。 其次,在连接各个模块的时候一定要注意各个输入、输出引脚的线宽,因为每个线宽是不一样的,只要让各个线宽相互匹配,才能得出正确的结果,不然,出现任何一点小的误差就会造成整个文件系统的编译出现错误提醒,在器件的选择上也有一定的技巧,只有选择了适宜目前电路所适合的器件,编译才能得到完满成功。 经过这次课程设计使我知道了理论和实际相结合是很主要的,只有理论知识是远远不够的,只有把所学的理论知识和实践相结合起来,从理论中得出结论,才能真正为社会服务,从而提升自己的实际动手能力和独立思索的能力。在设计的过程中碰到问题,能够说得

7、是困难重重,这毕竟第一次做的,难免会碰到过多种多样的问题,同时在设计的过程中发觉了自己的不足之处,对以前所学过的知识了解得不够深刻,掌握得不够牢靠。 在设计过程中,总是碰到这么或那样的问题。有时发觉一个问题的时候,需要做大量的工作,花大量的时间才能处理。自然而然,我的耐心便在其中建立起来了。为以后的工作积累了经验,增强了信心。 篇3 本学期末我们进行了EDA实训,我们组做的是四路智能抢答器,不过此次实训和以往最大的不一样是在熟练并掌握Verilog硬件描述语言的基础上,利用Quartus软件,对其进行波形和功效的仿真。我们组抢答器的设计要求是:可容纳四组参赛者,每组设置一个抢答按钮供抢答者使用

8、,电路含有第一抢答信号的判别和锁存功效,系统含有计分、倒计时和倒计时锁存等电路,输入信号有:各组的抢答按钮A、B、C、D,系统清零信号CLR,系统时钟信号CLK,计分复位端RST,加分按钮端ADD,计时预置控制端LDN,计时使能端EN,计时预置数据调整按钮能够用如TA、TB表示;系统的输出信号有:四个组抢答成功是否的指示灯控制信号输出口可用如LEDA、LEDB、LEDC、LEDD表示,四个组抢答时的计时数码显示控制信号若干,抢答成功组别显示的控制信号若干,各组计分动态显示的控制信号若干。整个系统最少有三个关键模块:抢答判别模块、抢答计时模块、抢答计分模块。 实训的第一天我们组三个人就开始对抢答

9、器的各部分源程序进行调试,因为刚开始对于quartus2软件用的不是很熟练,因此在第一天几乎上没有啥大的进展,一直全部在改程序中的错误。在不停的反复的编译、改错。拿着EDA修改稿、资料书检验犯错的地方,一边又一遍的校对分析其中的错误。 在实训中我们碰到了很多的问题。为了处理这些问题我和她们两个全部在的想措施经过多种渠道寻求处理问题的方法。上网查资料、问同学、图书馆查资料、问老师、自己想措施,其实最有效的方法还是自己去想那样学到的东西才会愈加的深刻记得时间也是最长的,她人的帮助当然是很好的,但只是临时的要想真正的学到东西还是要靠自己去想措施。不能一有问题就期望要她人帮忙,一定自己先好好想想实在处

10、理不了的再去问老师找同学。 因为在一开始的时候对quartus2软件的不熟悉耽搁了很多的时间,在接下来的几天里碰到了不少的问题。刚开始的时候是源程序中的错误一直在那改,好不轻易多个模块中的错误全部一个个排除了,但当把她们放到一起时问题就又出现了。于是又开始了检验修改,可是弄了好长时间也没有弄明白,最终找了一个在试验室的同学说是顶层文件有问题。于是晚上又找了些有关顶层文件资料还有书本上的例子。最终对步骤已经有了很熟练的掌握,很快就完成了程序编译、仿真、下载到最终的调试。 纸上谈来终觉浅,绝知此事要躬行。在这短暂的两周实训中深深的感觉到了自己要学的东西实在是太多了,自己知道的是多么的有限,因为本身

11、专业知识的欠缺造成了这次实训不是进行的很顺利,经过这次实训暴露了我们本身的很多的不足之处,我们会引认为鉴,在以后的生活中更应该努力的学习。 即使实训仅仅进行了两个星期就急忙的结束了,但在这两个星期中收获还是很多的。实训的目标是要把学过的东西拿出来用这一个星期的实训中不但用了而且对于quartus2软件的使用也愈加的得心应手,这次实训提升了我们的动手能力、理论联络实际的能力、发觉问题分析问题处理问题的能力。实训只要你认真做了全部是对自己能力一次很大的提升。 此次设计过程中得到我们老师的悉心指导。瓮老师数次问询设计进程,并为我们指点迷津,帮助我们理顺设计思绪,精心点拨,时刻在帮助着我们去提升自己。瓮老师一丝不苟的作风,严谨求实的态度,踏扎实实的精神,不但是我学习的标兵,并将主动影响我以后的学习和工作。在此真挚地向瓮老师致谢。

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