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1、AO2.910.280JSVIP视频压缩卡一、 设 计 思 想本视频编解码板采用GEC公司出品的符合H.261建议的VP系列视频编解码芯片组 ，完成会议电视系统终端视频采集,压缩, 编码, 收发等功能. 为降低系统成本, 提高通用 性, 采用 Philips 公司出品的视频输入输出处理芯片SAA7111,SAA7185, 提供复合视频输 入输出接口. 其数字视频接口满足CCIR601建议. 数据收发采用 X.21 串行接口与DCP 板实现通讯. 其总框图如下。图1 YA100-VIP视频编解码板系统框图注：H.261 关于视频编解码建议X.21 关于串行通讯建议CCIR601 关于数字视频格式
2、建议底图总号 AO2.910.280 JS日期签名更改标记数量更改单号签 名日期 第 2/11 页格式（4a） 描图 徐向群 幅面：4二、 原 理 框 图底图总号 AO2.910.280 JS日期签名更改标记数量更改单号签 名日期 第 3/11 页格式（4a） 描图 徐向群 幅面：4 三、 基 本 原 理3.1. 视频输入摄像机输入复合视频信号至SAA7111(A/D变换),输出格式为4:2:2的16位YUV数据, 由于SAA7185输出的数字视频分辨率不严格符合CCIR601格式。 3.2.视频处理编码端VP520对输入YUV 数据进行滤波, 抽样, 转换成 CIF/QCIF 格式数据, 输
3、出8BIT 宏块(MB)数据至VP2611， VP2611 对宏块数据进行运动矢量预测, 离散余弦变换 (DCT)，帧内/帧间编码。输出行 游程编码至VP2612。VP2612作变长编码后转换成 X.21串行码流输出。解码端为编码端的逆过程，由VP2614接收X.21码流，并作BCH校验及变长解码 输出至VP2615，VP2615作相应的游程解码，离散余弦反变换，输出CIF/QCIF数 据至解码端VP520，转换成CCIR601分辨率的16位YUV 数据。3.3.视频输出SAA7185对YUV 数据D/A变换后作复合视频编码，输出PAL/NTSC复合视频信号。 四、 软 件 接 口本板占用PC
4、机I/O口地址310h-1fh作为板上各芯片片选和数据口，定义如下：0x310复位控制口0x311各芯片地址口0x312 读状态口0x313自环及 速率控制数据口0x317SAA7111SAA71850x319编码端VP520数据口0x31aVP2611数据口0x31bVP2612数据口0x31cVP2614数据口0x31dVP2615数据口0x31e解码端VP520数据口由于芯片多而I/O口地址有限，访问某一芯片上寄存器时，先将该寄存器的地 址写在0x311地址口里，再对该芯片的数据口进行读写操作。4.1.VP520初始化:VP520有地址线四根, 映射内部寄存器地址00-0Fh, 其中00
5、-06h为参数寄存器, 07-0fh底图总号 AO2.910.280 JS日期签名更改标记数量更改单号签 名日期 第 4/11 页格式（4a） 描图 徐向群 幅面：4为控制寄存器。例如：outportb(0x311, 0x08); /地址口写0x08, 即VP520控制寄存器 0 地址outportb(0x319, 0x0e0); / VP520控制寄存器 0 赋值 0xe0VP520 主要寄存器(1) CR_8 控制寄存器0： Bit 0; 1: 内插; 0: 抽样; Bit 1: 1: NTSC; 0: PAL; Bit 2: 1: QCIF; 0: CIF; Bit 3: 0: 亮度值减
6、16; Bit 4: 0: 色度值减128; Bit 5: 1: 与 HREF/VREF 锁相; 0: 产生同步; Bit 6: 1: VREF 上升沿有效; 0: 下降沿有效; Bit 7: 1: HREF 上升沿有效; 0: 下降沿有效;(2) CR _9 控制寄存器1： Bit 0; 1: V 超前 U; 0: U 超前 V; Bit 1: 1: 外部场检测; 0: 内部场检测; Bit 2: 场选择; Bit 3: 0: 使用 64Kx16 DRAM; Bit 4: 1: 分屏模式; Bit 5: 1: 帧准备禁止; 0: 帧准备使能; Bit 6: 1: 全屏消隐; 0: 全屏显示;
7、 Bit 7: 1: DRAM 写禁止; 0: DRAM 写使能;4.2. VP2611, VP2615 初始化：VP2611，VP2615有8位数据线及一位CADR信号线，CADR指示数据线上是数据还 是命令，操作方式先写入命令，再进行读写。底图总号 AO2.910.280 JS日期签名更改标记数量更改单号签 名日期 第 5/11 页格式（4a） 描图 徐向群 幅面：4 例如: outportb(0x311, 0x00); /地址口写0x00, 即 CADR=0 outportb(0x31a, 0x00);/写入命令0x00, VAR Threshold 设置 outportb(0x311,
8、 0x01);/地址口写0x01, 即 CADR=1 outportb(0x31a, 0x08);/写入数据0x08VP2611 指令:0x00： 输入 VAR 门限;0X02: 输 入帧间量化系数;0X03: 输入帧内量化系数;0X04: 入设置参数;0X05: 输入控制功能;0X08: 输出 GOB 号;0X09: 输出 MB 号;0X0B: 输出控制参数;0X0C: 输出设置参数;VP2615 指 令：0X04: 输入设置参数;0X08: 输出 GOB 号;0X09: 输出 MB 号;0X0B: 输出控制参数;0X0C: 输出设置参数;4.3. VP2612, VP1614初始化:操作步
9、骤先锁存欲访问的地址, 再读写寄存器, 例如:outportb(0x311, 0x00); /地址锁存器写0x00, 即VP2612 寄存器PTYPE地址outportb(0x31b, 0x38); /PTYPE 写入 0x38底图总号 AO2.910.280 JS日期签名更改标记数量更改单号签 名日期 第 6/11 页格式（4a） 描图 徐向群 幅面：4VP2612 指令:0x00: PTYPE;0x01: Temporal Reference;0x02: PSPARE;0x03: TR Source;0x04: GSPARE;0x08: 发送缓存写地址高8位;0x09: 发送缓存写地址低8
10、位;VP2614 指令:控制寄存器 A:0x02: Bit 0, 冻结释放; Bit 1, 强制冻结; Bit 2, 出错中断; Bit 3, EVT 中断使能; Bit 4, ERR 中断使能; Bit 5, 视频保持; Bit 6, 清缓存; Bit 7, 系统重起;控制寄存器 B:0x03: Bit 0: 图象起始码重锁定; Bit 3: 1 Bit 纠错; Bit 4: 2 Bit 纠错; Bit 5: FEC 使能; Bit 6: 清视频失锁计数器; Bit 7: 清其他计数器;4.4. X.21 时钟速率选择及自环测试:板上时钟速率选择及自环测试寄存器定义:Bit0, 1, 2:
11、对应一, 二, 三级自环;底图总号 AO2.910.280 JS日期签名更改标记数量更改单号签 名日期 第 7/11 页格式（4a） 描图 徐向群 幅面：4Bit4, 5, 6: 对应速率选择; X.21时钟源16.384M, 经可编程分频电路分频可得64K-2M的速率. 板上设有四级自环测试电路: 第一级: Bt812-Bt851第二级: 编码端VP520-解码端VP520 第三级: VP2611-VP2615第四级: VP2612-VP1614其中第四级为跳线器选择, 前三级通过自环控制字0-2位选择. 例如:4.5. 复位:复位寄存器最低位置0则复位全板, 置1清复位. 例如:outportb(0x310, 0x00);/最低位置0, 复位delay(2);/延时outportb(0x310, 0x01);/最低位置1, 清复位五、 主 要 器 件 介 绍5.1 VP520VP520 为 GEC 公司数字视频格式转换器, 通过软件可设置成抽样模式和内插模式两种模式互为逆过程. 抽样模式: * 将 CCIR601 格式数据转换成公共中间格式 CIF/QCIF, * 宏块输出 内插模式: * 将 CIF/QCIF 格式数据转换成 CCIR601 视频数据. * 宏块输入.注: 参见 GEC 公司 “Digital
