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1、XXXXXXXX硬件实习报告目 录1.计数器的发展、应用及前景1.1概述计数器是一种基础测量仪器，到目前为止已有30多年的发展史。早期，设计师们追求的目标主要是扩展测量范围，再加上提高测量精度、稳定度等，这些也是人们衡量电子计算器的技术水平，决定电子计数器价格高低的主要依据。目前这些基本技术臻完善，成熟。应用现代技术可以轻松地将电子计数器的测频上限扩展到微波频段。 1.2基础知识简介电子计数器是一种多功能的电子测量仪器。它利用电子学的方法测出一定时间内输入的脉冲数目，并将结果以数字形式显示出来。通常电子计数器按照它的功能可分为以下三类：（1）通用计数器是利用数字电路技术数出给定时间内所通过的脉
2、冲数并显示计数结果的数字化仪器。通用计数器是其他数字化仪器的基础。在它的输入通道接入各种模-数变换器，再利用相应的换能器便可制成各种数字化仪器。通用计数器特点：测量精度高、量程宽、功能多、操作简单、测量速度快、直接显示数字，而且易于实现测量过程自动化。通用计数器按功能可分3类：1、频率计数器：专门用于测量高频和微波频率的计数器。2、计算计数器：具有计算功能的计数器，可进行数学运算，可用程序控制进行测量计算和显示等全部工作过程3、微波计数器：是以通用计数器和频率计数器为主配以测频扩展器而组成的微波频率计。应用领域：通用计数器在工业生产和科学实验中得到广泛应用。（2）频率计数器电子工程师经常需要测
3、量频率、时间间隔、相位和对事件计数，精确的测量离不开频率计数器或它的同类产品，如电子计数器和时间间隔分析仪。这些仪器为研发提供高精度和分析能力，为大批量生产提供高效率并为维修提供低成本和便携性。最早的电子计数器是为了对诸如原子现象之类的事情进行计数而设计出来的。在发明计数器之前，频率的测量都是用频率计(一种精度很低的协调装置)完成。频率计数器是以数字方式对信号参数进行精密测量的首批仪器之一。衡量频率计数器主要指标是测量范围、测量功能、精度和稳定性，这些也是决定价格高低的主要依据。随着电子测试技术的发展，频率计数器日趋成熟。目前，频率计数器已经能轻松测量射频、微波频段信号。除频率测量外，大多数频
4、率计数器还综合了以下功能：频率比、时间间隔、周期、上升/下降时间、相位、占空比、正/负脉冲宽度、总和、峰值电压以及时间间隔平均等。频率计功能延伸的最高境界就是综合了调制域分析仪的功能。（3）计算计数器一种带微处理器的具有计算功能的计数器，除了具有通用计数器的功能之外，能进行数学运算，求解比较复杂的方程式，可靠程序控制进行测量计算和显示等全部工作。 （4）频率计数器以通用计数器或频率计数器为主体，配以测频扩展器而组成的微波频率计。它的测频上限已进入毫米波段，有手动、半自动、全自动三类。系列化微波计数器是电子计数器发展的一个重要方向。 频率扩展技术将微波测频转换为较低的测频，按其原理主要有置换法、
5、取样法和变频法等。各种方法的主要性能评定项目包括测量速度、准确度、灵敏度、动态范围、允许信噪比、允许调频量、允许调幅量和幅度甄别等。 置换法：利用零拍原理，用与被测频率fx有一定关系的低频f0来置换fx，用计数器测出f0,从而求出fx。这种方法灵敏度高、动态范围大、允许调幅量大、幅度甄别显示最强分量，测量上限频率达26吉赫。 取样法：以取样技术为基础，应用锁相原理将微波频率转换为低频来测量。它兼具置换法和变频法的优点，但测量频率上限受微波取样技术的限制。 变频法：利用变频技术,将微波频率与频标谐波差频变换成低频,测量低频而算出被测频率。变频法的优点是允许信噪比高，允许调频量大，幅度甄别显示最弱
6、分量等。2.设计要求利用8253定时/计数器和8255接口电路，设计一个十进制计数器，对外部事件进行计数，计满100即清0，并在八个发光二极管或七段led.显示器上显示计数值。按下开关K0开始对外部事件计数,按下开关K1停止计数,按下开关K2显示器清零.2.1设计目的2.1.1 进一步撑握8255可编程并行接口芯片的工作原理及控制LED显示电路的编程方法。2.1.2 进一步撑握8253定时器计数器的工作原理和编程方法。2.2 设计意义课程设计是计算机应用、电子类专业较重要的一个实践性环节。 其目的和作用是使学生能将已学过的模拟电路、数字电路、微机原理与接口技术、EDA等知识综合运用于电子系统的
7、设计中，从而培养学生对电子系统的设计能力，这是在所有实践性课程中最具活力，最能培养学生的自主学习、实践能力，最能培养学生创新思维的实践课程之一。同时课程设计是对学生的一种基本素质训练较好方式。通过课程设计，使学生能运用已学过的计算机软件硬件知识来进行微机接口应用系统开发和调试。了解微机接口应用开发的全过程：分析需求，设计原理图，选用元器件，布线，编程，调试，撰写报告等。培养学生的动手能力和解决实际问题的能力，为今后从事微机接口应用和开发方面的工作打下坚实的基础3.硬件设计3.1设计方案3.1.1 系统框图及其描述（1） 系统框图如图1所示开始/暂停开关清零开关GATE0OUT0CLK0CPUA
8、D0-AD15IO/RDIO/WR8253D0-D7RDWRA1A08255D7-D0 PA口 PB0 PB1RDWR PC3-PC5A1A0CS74LS138地址译码器74LS138地址译码器数码管 系统框图 图 1（2） 系统框图描述8086通过地址译码器选中8253、8255芯片，通过数据总线D0D7对8253及8255进行数据的读写 。8253的定时器0工作在方式3，CLK1接外部事件（单脉冲），GATE0接开关K0，控制计数器的开始和暂停。OUTO接PB0。8255的PA、PB、PC三个端口均工作于方式0，PA、PC作为输出口，PB作为输入口。PC口通过3-8译码器选中对应的数码管，
9、PB0接OUT0的输出，检测电平的跳变从而实行计数，PB1接开关K1，对清零信号进行检测。PA0PA7接数码管的LED-ALED-DP，控制数码管数字的显示。3.1.2方案实现原理设定计时器0工作在方式3，计数器初值设定为2，外部事件脉冲通过计数器0CLK0输入，将OUT0接到PB0，外部事件每触发一次，则在OUTO上发生一次电平的跳变，8086通过检测PB0口累计电平的跳变的次数，将值存放在寄存器CL中，每当CL中的值等于10，将CH中的值加1，实现十进制的进位，最后通过查表，将CL和CH的值显示到对应的数码管中。开关K0通过GATE0控制计数器的工作状态，实现开始和暂停的功能，开关K1通过
10、控制PB1端口的电平实现清零的功能。3.2硬件原理3.2.1硬件原理图 硬件原理图 图 23.2.2硬件原理图描述（1）外部连线 8086通过地址总线A3A7接地址译码器输入端，Y1(F210H)接8253片选，Y3(F218H)接8255片选。8253计数器0CLK0接单脉冲触发器（外部事件），OUT0接8255PB0，PB1接开关K1,GATE0接开关K0，8255PC3PC5分别接 LED-SALED-SC,8255PA0PA7分别接LED-ALED-DP。（2）原理图描述 8086的地址线低位接在地址译码器74LS138上，8253、8255的片选端都接在地址译码器的输出上，从而决定了
11、8253、8255的各端口地址。从图上可以看出8253的片选地址是F210H，8255的片选地址 是F218H。8086的数据总线与8255、8253的数据端接起来，对8253及8255进行数据读写。8086将运算结果送到PA端口上，实现计数器的功能。3.3模块电路的介绍及分析3.3.1 8253芯片（1）8253的引脚及其功能8253是双列直插式24脚芯片，标准封装为DIP24,引脚如图（2）8253的内部结构Intel 8253芯片由数据总线缓冲器（8位）、读/写控制逻辑电路、控制字寄存器和3个结构完全相同的计数器组成。数据总线缓冲器用于将8253与系统数据总线相连，CPU读写8253的所
12、有数据都经过这个缓冲器，包括CPU写入方式控制字、CPU写入计数值和CPU读出计数值。读/写控制逻辑电路接收来自系统总线的输入信号，将其转换成8253内部的操作和控制信号，选择读写操作对象，决定内部总线上数据的传送方向。控制字寄存器接收来自CPU的方式控制字，控制相应计数器的工作方式。三个独立的计数器通道计数器0、计数器1和计数器2都是16位减1计数器，减1操作由每个计数器/定时器的时钟输入脉冲下降沿触发启动。与16位减1计数器对应的还有一个16位预置寄存器和输出锁存器。预置寄存器存放计数初值，输出锁存器用于写入锁存命令时锁定当前计数值。每个计数器在CLK输入频率一定的情况下，可编程GATE的
13、控制方式和OUT的输出方式生成6种信号发生器： 基本计数器， 可重复触发的单稳态触发器， 分频器， 方波发生器， 软件触发的选通信号发生器， 硬件触发的选通信号发生器。 8253引脚图 图 3 8253引脚功能图 图 4（3）8253方式控制字 8253的控制字包括4项不同的编程信息：D7 D6 D5 D4 D3 D2 D1 D0SC1SC0RW1RW0M2M1M0BCD 计数器选择 读写格式 工作方式选择 数制计数器选择：00为计数器0，01为计数器1，10为计数器2，11为非法。读写格式：00为计数器锁存命令，01为只读写低字节，10为只读写高字节，11为先读写低字节，再读写高字节。工作方
14、式选择：由3位确定6种工作方式。000为方式0，001为方式1，x10为方式2，x11为方式3，100为方式4，101为方式5。数制：0为二进制计数，1为BCD计数。3.3.2 8255芯片（1）8255的引脚及其功能8255是双列直插式40脚芯片，标准封装为DIP40,引脚如图（2）8255的内部结构 8255A由数据总线缓冲器、读/写控制逻辑电路、A组和B组控制电路以及数据端口A、B和C组成。数据总线缓冲器是8255A与系统数据总线的接口，CPU输入输出的数据、CPU输出的控制字和外设的状态信息都是通过这个缓冲器传送的。读/写控制逻辑电路把CPU的控制命令或输出数据送至相应的端口，把外设的状态信息或输入数据通过相应的端口送至CPU。数据端口PA和PB都包含一个8位输出锁存器/缓冲器和一个8位输入锁存器，PC口包含一个8位输出锁存器/缓冲器和一个8位输入缓冲器（不锁存输入信号）。在工作方式1或方式2下，PC口分成高4位和低4位两个输入口作为PA和PB的控制信号输出或状态信号输入。、A、A、和
