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1、在使用 DXP 的时候，不存在网表导入等问题，大多数的行为已经是软 件自动完成了，但是在Allegro中却不行，需要自己手动来完成。注意 在绘制电路板的时候，要先确定绘制区域，以及各个层的状况，边界， 安装孔等，都不是随意的来修改。网表的生成，首先要重新编辑元件编号，先选择 dsn 文件，然后选 择 Tools - Annotate。 scope 要选择整个工程， entire。 action 中要先选 择 reset part references to ?来取消所有的编号， 然后再选择无条件的 索引更行， Unconditional reference update 来进行全部重新跟新。然
2、后进行DRC检查，先选择dsn文件，然后再选择Tools - Design Rules Check。 DRC 只能检查出原理图的连接问题，和元器件的属性等。接着再来查阅器件的封装，在确定器件封装的时候，我有一点点建 议，虽然稍微麻烦一点，但是却能够减小出问题的概率。原理图检查之后，不仅仅要保证没有DRC错误，还要保证没有原理 上的错误，这样就生成一张器件清单列表，方法为：在dsn文件被选中 的情况下，Tools - Bill of Materials。可以不做任何修改的生成bom清 单，路径在最下面的Browse可以看到，不做修改会放在同一工程目录 下的。查阅工程目录表，可以看见Outputs
3、下面就有一个.bom后缀名的 文件，双击这个文件就可以看见使用了哪一些器件，以及个数。生成元 件清单除了是.bom的方式外，也可以是excel表格，但是由于生成的速 度比较慢，所以我就直接选择复制粘贴到excel表格中了。生成的这个表格有两个作用：一是采购元件的时候有一个详细列表， 能够方便的采购人员来查阅；二是将各种器件的封装记录下来，保证每 一个封装都存在。器件封装的绘制见之前的博文。封装的添加，在原理图中，在 dsn 文件出右键，选择 Editor Object Property, 查阅 PCB Footprint 这一栏中是不是每一个器件的封装都已经 填写上了，并且是不是和相应的原理图
4、对应。如果是那就成功了很大一 部分了。最后检查核对好了，就可以生成网络表了 dsn文件,Tools - CreateNetlist,生成器件封装和原理图一一对应的网表。在于博士的视屏中选 用的是PCB Editor，但是我的软件中不能顺利的生成网络表，所以使用 了 Other 组件。Combined properint 要修改成如图所示，Formatters 要选中 allegro.dll 文件，如果没有就要去网上下载这个.dll文件，并且要和oraccel.dll文件 放在同一个目录。在Browse处注意生成文件的路径，后缀名是net。到 此处是原理图的网络表的生成。导入网表，File -I
5、mport -Lo,弹出一个对话框，由于刚才是使 用Other组件生成的网表，因而在此也要使用Other组件来将网络表导 入。可以看见刚才生成的文件是.net的文件，开始导入网络表。因为有一 些封装是自己绘制的，固然要注意路径问题，不然会提示找不到封装的 不仅仅是封装的器件，还有自己绘制的一些pin最好都一次性添加进来。封装路径的再次确认。在绘制 brd 的界面，选择 Setup - UserPreferences，就会弹出一个界面，在Library中有三个路径要确认， devpath、padpath和psmpath，这三个路径的添加具体步骤就省略了，点 击 Value 对应的方框，就可以弹出
6、添加路劲的页面，添加上就好了。誌 Usflr Prffereftcis HditcrCategoffiesCategoiy: Lib0口口00匕仁口CJ口口 00Mv_favaitesDisplayDrawingDreFacilitiesF ile_marbagemertl fc_packaging liHsrac Create Symbol生成的.txt文件是使 用 File - Create Device 生成的。最后网络表终于顺利的导入进去了。可以通过Place - Manually来 检查，当元器件都导入进去的时候，Placement List选项下面的 Components by refdes 中能看见原理图中的元件标号全部显示在里面。在文件导入的过程中，我只遇见了这些问题，并且最后都一一解决了。这一 段内容说起来容易但是做起来还是有一些复杂，第一次弄这个，研究了很久。并 且在朋友的帮助下才完成的，cadence用起来的不容易，也说明了约束性的良 好，不是随意就能修改的。各种文档的管理和错误纠正，还是需要一定的标 准来规范。
