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1、第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 MCS51单片机内部有单片机内部有4个并行口，当内部并行口不够用个并行口，当内部并行口不够用时可以外扩并行口芯片。可外扩的并行口芯片很多，分成时可以外扩并行口芯片。可外扩的并行口芯片很多，分成2类：不可编程的并行口芯片（类：不可编程的并行口芯片（74LS3734和和74LS245）和可编）和可编程的并行口芯片（程的并行口芯片（8255）。）。 7.1 不可编程并行口芯片的扩展不可编程并行口芯片的扩展 7.2 可编程并行口芯片的扩展可编程并行口芯片的扩展 第七章第七
2、章 MCS-51 MCS-51并行口的扩展并行口的扩展 7.1.1 74LS373的扩展的扩展7.1.2 74LS245的扩展的扩展 7.1 不可编程并行口芯片的扩展不可编程并行口芯片的扩展 第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 1、 74LS373的结构的结构2、 74LS373的引脚的引脚3、 74LS373与与89C51的连接的连接7.1.1 74LS373的扩展的扩展连接图连接图DCPQDCPQDCPQDCPQDCPQDCPQDCPQDCPQD0D1D2D3D4D5D6D7Q0Q1QQ3Q4Q5Q6Q7LEOE思考思考第七章第七章 MCS-51 MCS-51
3、并行口的扩展并行口的扩展 ALERDWRPSEN89C51A0A1A2A3A4A5A6A7OELED0D1D2D3D4D5D6D774LS373DBABCBOED0D774LS373AB15AB0AB15地址码的计算地址码的计算LE74LS373与与89C51的连接图的连接图+Q7 Q6 Q5 Q4 Q3 Q2 Q1 Q0 计算计算74LS373的地址（的地址（8051送出何种地址码时可以将数送到送出何种地址码时可以将数送到Q端端） P27 P26 P25 P24 P23 P22 P21 P2 0 P07 P06 P05 P04 P03 P02 P01 P00 AB15AB14 AB13 AB
4、12 AB11 AB10 AB9 AB8 AB7 AB6 AB5 AB4 AB3 AB2 AB1 AB0 0 * * * * * * * * * * * * * * *第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 ALERDWRPSEN89C51A0A1A2A3A4A5A6A7OELED0D1D2D3D4D5D6D774LS373DBABCBOED0D774LS373AB15AB0AB15LE思考思考:2片片74LS373与与89C51的连接图的连接图+Q7 Q6 Q5 Q4 Q3 Q2 Q1 Q0OED0D774LS373LE+Q7 Q6 Q5 Q4 Q3 Q2 Q1 Q
5、0 计算计算74LS373的地址（的地址（8051送出何种地址码时可以将数送到送出何种地址码时可以将数送到Q端端） P27 P26 P25 P24 P23 P22 P21 P2 0 P07 P06 P05 P04 P03 P02 P01 P00 AB15AB14 AB13 AB12 AB11 AB10 AB9 AB8 AB7 AB6 AB5 AB4 AB3 AB2 AB1 AB0 0 1 * * * * * * * * * * * * * * 1 0 * * * * * * * * * * * * * *AB14第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 1、 74LS2
6、45的结构的结构2、 74LS245的引脚的引脚3、 74LS245与与89C51的连接的连接7.1.2 74LS245的扩展的扩展连接图连接图B0A0思考思考B1A1B2A2B3A3B4A4B5A5B6A6B7A7+EDIR第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 ALERDWRPSEN89C51A0A1A2A3A4A5A6A7OELED0D1D2D3D4D5D6D774LS373DBABCBDIRB0B774LS245AB15AB0AB15地址码的计算地址码的计算E74LS245与与89C51的连接图的连接图+A7 A6 A5A4 A3 A2 A1A0 计算计算74
7、LS245的地址（的地址（8051送出何种地址码时可以将数由送出何种地址码时可以将数由A端传到端传到B端端） P27 P26 P25 P24 P23 P22 P21 P2 0 P07 P06 P05 P04 P03 P02 P01 P00 AB15AB14 AB13 AB12 AB11 AB10 AB9 AB8 AB7 AB6 AB5 AB4 AB3 AB2 AB1 AB0 0 * * * * * * * * * * * * * * *第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 ALERDWRPSEN89C51A0A1A2A3A4A5A6A7OELED0D1D2D3D4D
8、5D6D774LS373DBABCBDIRB0B774LS245AB15AB0AB15E思考思考:2片片74LS245与与89C51的连接图的连接图+A7 A6 A5A4 A3 A2 A1A0DIRB0B774LS245E+A7 A6 A5A4 A3 A2 A1A0 计算计算74LS245的地址的地址 P27 P26 P25 P24 P23 P22 P21 P2 0 P07 P06 P05 P04 P03 P02 P01 P00 AB15AB14 AB13 AB12 AB11 AB10 AB9 AB8 AB7 AB6 AB5 AB4 AB3 AB2 AB1 AB0 0 1 * * * * *
9、* * * * * * * * * 1 0 * * * * * * * * * * * * * *AB14第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 7.2.1 8255的结构的结构7.2.2 8255的引脚的引脚7.2.3 8255的工作方式的工作方式7.2.4 8255的控制字的控制字7.2.5 8255的应用的应用 7.2 可编程并行口芯片的扩展（可编程并行口芯片的扩展（8255） 第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 8255有三个并行的8位I/O接口，分别称为A口、B口、C口。也就是说，扩展一片8255则可扩展24位并行端口。 7.2
10、.1 8255的结构的结构数据数据总线总线缓冲器缓冲器读写读写控制控制逻辑逻辑A组组控制控制B组组控制控制口口A口口C高高4口口C低低4口口B D0D7RDWRCSA0A1RESETPA0PA7PB0PB7PC4PC7PC0PC3第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 7.2.1 8255的结构的结构数据数据总线总线缓冲器缓冲器读写读写控制控制逻辑逻辑A组组控制控制B组组控制控制口口A口口C高高4口口C低低4口口B D0D7RDWRCSA0A1RESETPA0PA7PB0PB7PC4PC7PC0PC3 8位的双向的三态缓冲器。作为8255A与系统总线连接的界面，输入/
11、输出的数据，CPU的编程命令以及外设通过8255A传送的工作状态等信息，都是通过它来传输的。第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 7.2.1 8255的结构的结构数据数据总线总线缓冲器缓冲器读写读写控制控制逻辑逻辑A组组控制控制B组组控制控制口口A口口C高高4口口C低低4口口B D0D7RDWRCSA0A1RESETPA0PA7PB0PB7PC4PC7PC0PC3 读/写控制逻辑电路负责管理8255A的数据传输过程。它接收片选信号及系统读信号、写信号、复位信号RESET，还有来自系统地址总线的口地址选择信号A0和A1。第七章第七章 MCS-51 MCS-51并行口的
12、扩展并行口的扩展 7.2.1 8255的结构的结构数据数据总线总线缓冲器缓冲器读写读写控制控制逻辑逻辑A组组控制控制B组组控制控制口口A口口C高高4口口C低低4口口B D0D7RDWRCSA0A1RESETPA0PA7PB0PB7PC4PC7PC0PC3 这是两组根据CPU命令控制8255A工作方式的电路，这些控制电路内部设有控制寄存器，可以根据CPU送来的编程命令来控制8255A的工作方式，也可以根据编程命令来对C口的指定位进行置/复位的操作。A组控制电路用来控制A口及C口的高4位。B组控制电路用来控制B口及C口的低4位。第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 7.
13、2.1 8255的结构的结构数据数据总线总线缓冲器缓冲器读写读写控制控制逻辑逻辑A组组控制控制B组组控制控制口口A口口C高高4口口C低低4口口B D0D7RDWRCSA0A1RESETPA0PA7PB0PB7PC4PC7PC0PC3A口是一个独立的8位I/O口，它的内部有对数据输入/输出的锁存功能。 C口可以看作是一个独立的8位I/O口；也可以看作是两个独立的4位I/O口。也是仅对输出数据进行锁存。B口也是一个独立的8位I/O口，仅对输出数据的锁存功能。第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 7.2.2 8255的引脚的引脚数据数据总线总线缓冲器缓冲器读写读写控制控制
14、逻辑逻辑A组组控制控制B组组控制控制口口A口口C高高4口口C低低4口口B D0D7RDWRCSA0A1RESETPA0PA7PB0PB7PC4PC7PC0PC38255与与89C51的连接图的连接图第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 7.2.2 8255的引脚的引脚数据数据总线总线缓冲器缓冲器读写读写控制控制逻辑逻辑A组组控制控制B组组控制控制口口A口口C高高4口口C低低4口口B D0D7RDWRCSA0A1RESETPA0PA7PB0PB7PC4PC7PC0PC3D0-D7：8位，双向，三态数据线，用来与系统数据总线相连。RD：读信号，输入，控制：读信号，输入，
15、控制8255将数据或控制信息送将数据或控制信息送到到CPU。 WR：写信号，输入，控：写信号，输入，控制制CPU将数据或状态信息将数据或状态信息送到送到8255A。 CS：片选，输入，用来决：片选，输入，用来决定芯片是否被选中。定芯片是否被选中。 A1，A0：内部口地址的选择，输：内部口地址的选择，输入。这两个引脚上的信号组合决定入。这两个引脚上的信号组合决定对对8255A内部的哪一个口或寄存器内部的哪一个口或寄存器进行操作。进行操作。 RESET：复位信号，高电平有效，输入，用来：复位信号，高电平有效，输入，用来清除清除8255A的内部寄存器，并置的内部寄存器，并置A口，口，B口，口，C口均
16、为输入方式。口均为输入方式。注意：注意：8255工作之前，硬件上必须先复位，使工作之前，硬件上必须先复位，使8255内部的各个部件处于待命状态。内部的各个部件处于待命状态。8255A的操作功能表的操作功能表 第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 7.2.2 8255的引脚的引脚数据数据总线总线缓冲器缓冲器读写读写控制控制逻辑逻辑A组组控制控制B组组控制控制口口A口口C高高4口口C低低4口口B D0D7RDWRCSA0A1RESETPA0PA7PB0PB7PC4PC7PC0PC3PA0PA7：A组数据信组数据信号，用来连接外设。号，用来连接外设。PB0PB7：B组数据信组数据信号，用来连接外设。号，用来连接外设。PC0PC7：C组数据信组数据信号，用来连接外设或者号，用来连接外设或者作为控制信号。作为控制信号。 第七章第七章 MCS-51 MCS-51并行口的扩展并行口的扩展 8255 与与 89C51 的的 连连 接接 图图ALERDWRPSEN89C51A0A1A2A3A4A5A6A7OELED0D1D2D3D4D5D6D774LS373DBABCBAB0
