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1、本文格式为Word版，下载可任意编辑计算机组成原理课后答案第四章 计算机组成原理 第2版 唐塑飞 第四章 斟酌题与习题 1解释以下概念 主存、 辅存、 Cache、 RAM、 SRAM、 DRAM、 ROM、 PROM、 EPROM、 EEPROM、 CDROM、 Flash Memory 答： 主存：与 CPU 直接交换信息，用来存放数据和程序的存储器。 辅存：主存的后援存储器，不与 CPU 直接交换信息。 CACHE：为了解决 CPU 和主存的速度匹配，设在主存与 CPU之间，起缓冲作用，用于提高访存速度的一种存储器。 RAM：随机存储器：是随机存取的，在程序执行过程中既可读出也可写入，存
2、取时间与存储单元所在位置无关。 SRAM：静态 RAM，以触发器原理存储信息。 DRAM：动态 RAM，以电容充放电原理存储信息。 ROM：只读存储器，在程序执行过程中只能读出，而不能对其写入。 PROM：一次性编程的只读存储器。 EPROM：可擦除的可编程只读存储器，用紫外线照射举行擦写。 EEPROM：用电可擦除的可编程只读存储器。 CDROM：只读型光盘 Flash Memory：快擦型存储器，是性能价格比好，稳当性高的可擦写非易失型存储器 2计算机中哪些部件可用于存储信息，请按其速度、容量和价格/位排序说明。 答： 寄放器、缓存、主存、磁盘、磁带等。 速度按依次越来越慢，容量越来越高和
3、价格/位越来越低 3存储器的层次布局主要表达在什么地方？为什么要分这些层次，计算机如何管理这些层 次？ 答：存储器的层次布局主要表达在Cache主存和主存辅存这两个存储层次上。 Cache主存层次在存储系统中主要对CPU访存起加速作用，即从整体运行的效果分析，接近于Cache的速度，而容量和位价却接近于主存。 主存辅存层次在存储系统中主要起扩容作用，其容量和位价接近于辅存，而速度接近于主存 4说明存取周期和存取时间的识别。 答： 存取周期和存取时间的主要识别是：存取时间仅为完成一次存取操作的时间，而存取周期不仅包含操作时间，还包含操作后线路的恢复时间。即： 存取周期 = 存取时间 + 恢复时间
4、 5什么是存储器的带宽？若存储器的数据总线宽度为 32 位，存取周期为 200ns，那么存储器 的带宽是多少？ 解：存储器的带宽指单位时间内从存储器进出信息的最大数量。 存储器带宽 = 1/200ns32位= 160M位/秒 = 20MB/S = 5M字/秒 1 计算机组成原理 第2版 唐塑飞 6某机字长为 32 位，其存储容量是 64KB，按字编址它的寻址范围是多少？若主存以字节 编址，试画出主存字地址和字节地址的调配处境。 答： 存储容量是64KB时，按字节编址的寻址范围就是64KB，那么：按字寻址范围 = 64K8 / 32=16K字 按字节编址时的主存地址调配图如下： 7一个容量为 1
5、6K32 位的存储器，其地址线和数据线的总和是多少？选中用以下不同规 格的存储芯片时，各需要多少片？ 1K4 位，2K8 位，4K4 位，16K1 位，4K8 位，8K8 位 答： 地址线和数据线的总和 = 14 + 32 = 46根； 各需要的片数为： 1K4：16K32 /1K4 = 168 = 128片 2K8：16K32 /2K8 = 8 4 = 32片 4K4：16K32 /4K4 = 4 8 = 32片 16K1：16K32 /16K1 = 32片 4K8：16K32 /4K8 = 4 4 = 16片 8K8：16K32 / 8K8 = 2X4 = 8片 8试对比静态 RAM 和动
6、态 RAM。 特性 存储 破坏性读出 需要刷新 地址复用 运行速度 集成度 功耗 适用场合 SRAM 触发器 非 不要 无 快 低 高 cache DRAM 电容 是 需要 有 慢 高 低 大容量主存 9什么叫刷新？为什么要刷新？说明刷新有几种方法。 2 计算机组成原理 第2版 唐塑飞 答： 刷新对DRAM定期举行的全部重写过程； 刷新理由因电容泄漏而引起的DRAM所存信息的衰减需要实时补充，因此安置了定期刷新操作； 常用的刷新方法有三种集中式、分散式、异步式。 集中式：在最大刷新间隔时间内，集中安置一段时间举行刷新； 分散式：在每个读/写周期之后插入一个刷新周期，无CPU访存死时间； 异步式
7、：是集中式和分散式的折衷 10半导体存储器芯片的译码驱动方式有几种？ 答： 半导体存储器芯片的译码驱动方式有两种：线选法和重合法。 线选法：地址译码信号只选中同一个字的全体位，布局简朴，费器材； 重合法：地址分行、列两片面译码，行、列译码线的交错点即为所选单元。可大大节省器材用量，是最常用的译码驱动方式 11. 一个8K8位的动态RAM芯片，其内部布局排列成256256形式，存取周期为0.1s。试问采用集中刷新、分散刷新及异步刷新三种方式的刷新间隔各为多少？ 答： 设DRAM的刷新最大间隔时间为2ms， 那么异步刷新的刷新间隔 =2ms/256行 =0.0078125ms =7.8125s 即
8、：每7.8125s刷新一行。 集中刷新时，死时间为256*0.1us=25.6us。 分散刷新，刷新间隔0.2us，死时间为0.1us，读写周期0.2us 异步刷新，死时间0.1us，刷新间隔7.8125us。 12. 画出用10244位的存储芯片组成一个容量为64K8位的存储器规律框图。要求将64K分成4个页面，每个页面分16组，指出共需多少片存储芯片。 答： 设采用SRAM芯片，那么： 总片数 = （64K8位） / （10244位）= 642 = 128片 题意分析：此题设计的存储器布局上分为总体、页面、组三级，因此画图时也应分三级画。首先应确定各级的容量： 页面容量 = 总容量 / 页
9、面数 = 64K8 / 4 = 16K8位，4片16K8字串联成64K8位 组容量 = 页面容量 / 组数 = 16K8位 / 16 = 1K8位，16片1K8位字串联成16K8位 组内片数 = 组容量 / 片容量 = 1K8位 / 1K4位 = 2片，两片1K4位芯片位并联成1K8位 存储器规律框图： 3 计算机组成原理 第2版 唐塑飞 4 计算机组成原理 第2版 唐塑飞 13 设有一个 64K8 位的 RAM 芯片， 试问该芯片共有多少个根本单元电路 （简称存储基元） ？ 欲设计一种具有上述同样多存储基元的芯片， 要求对芯片字长的选择应得志地址线和数 据线的总和为最小，试确定这种芯片的地址
10、线和数据线，并说明有几种解答。 答： 存储基元总数 = 64K 8位 = 512K位 = 219位； 设存储器有X根地址线和Y根数据线 那么有 2X *Y=219 Y=1,X=19 X+Y=20 Y=2,X=18 X+Y=20 Y=4,X=17 X+Y=21 Y=8,X=16 X+Y=24 Y=16,X=15 X+Y=31 Y=32。 由上可看出：片字数越少，片字长越长，引脚数越多。片字数、片位数均按2的幂变化。 结论：假设得志地址线和数据线的总和为最小，这种芯片的引脚调配方案有两种：地址线 = 19根，数据线 = 1根；或地址线 = 18根，数据线 = 2根。 因此，有两种解答，512K*1
11、位和256K*2位 14某 8 位微型机地址码为 18 位，若使用 4K4 位的 RAM 芯片组成模块板布局的存储器， 试问： （1）该机所允许的最大主存空间是多少？ （2）若每个模块板为 32K8 位，共需几个模块板？ （3）每个模块板内共有几片 RAM 芯片？ （4）共有多少片 RAM？ （5）CPU 如何选择各模块板？ 答： （1）218 = 256K，那么该机所允许的最大主存空间是256K8位（或256KB）； （2）模块板总数 = 256K8 / 32K8 = 8块； （3）板内片数 = 32K8位 / 4K4位= 8 2 = 16片； （4）总片数 = 16片 8 = 128片；
12、（5）CPU通过最高3位地址译码选板，次高3位地址译码选片。地址格式调配如下： 15设 CPU 共有 16 根地址线，8 根数据线，并用 MREQ （低电平有效）作访存操纵信号， R W 作读写命令信号（高电平为读，低电平为写）。现有以下存储芯片： ROM（2K8 位，4K4 位，8K8 位）， RAM（1K4 位，2K8 位，4K8 位） 及 74138 译码器和其他门电路（门电路自定）。 试从上述规格中选用适合芯片，画出 CPU 和存储芯片的连接图。要求： （1）最小 4K 地址为系统程序区，409616383 地址范围为用户程序区； （2）指出选用的存储芯片类型及数量； （3）细致画出片选规律。 答： （1）地址空间调配图如下 A15A12 A11A8 A7A4 A3A0 5 8
