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1、编号： 课程设计说明书题 目： 智力竞赛抢答器 院 （系）： 信息与通信学院 专 业： 电子信息工程 学生姓名： 学 号： 指导教师： 莫建文 2014 年 12 月 20 日摘 要随着电子技术的飞跃发展，人类社会逐渐步入了信息化时代，人们的生活水平不断提高，对精神文明生活的要求也跟着提高，这对电子领域提出了跟更高的要求。电子学是一门应用很广泛的科学技术，其发展非常迅速。要想学好这门技术，首先是基础理论的系统学习，然后要进行技术训练，进而培养我们对理论联系实际的能力，设计电路的能力，实际操作的能力，以及培养正确处理数据、分析和综合实验结果、检查和排除故障的能力。同时也可以加深我们对电子产品的理
2、解。关于这次设计的用于多人竞赛抢答的器件，在现实生活中很常见，尤其是随着各种益智电视节目的不断发展，越来越多的竞赛抢答器被用在了其中，这种抢答器的好处是不仅能够锻炼参赛选手的反应能力，而且能增加节目现场的紧张、活跃气氛，让观众看得更有情趣。在知识竞赛中，特别是做抢答题时，在抢答过程中，为了知道哪一组或哪一位选手先做出抢答，必须要有一个系统来完成这个任务。如果在抢答中，只靠人的视觉是很难判断出哪组先答题。这次设计就是用D触发器实现抢答，并通过简单的门电路和译码器把选手编号送到数码管显示器中进行显示，使以上问题得以解决，即使两组的抢答时间相差几微秒，也可分辨出哪组优先答题。本次抢答器的设计还考虑了
3、定时抢答功能和声光提示报警功能，使抢答器更接近实际情况，更加智能化。本文主要介绍了抢答器的工作原理及设计，以及在设计过程中出现的一些问题和解决方法。关键字：信息化；抢答；触发；译码；报警；智能目 录引言- 1 -1 功能介绍- 1 -1.1 主要功能介绍- 1 -1.2 扩展功能介绍- 1 -2 设计说明- 1 -3 主要元器件及其芯片介绍- 2 -3.1 主要元器件芯片图- 2 -3.2 计数器74LS192介绍- 3 -3.3 NE555介绍- 4 -3.4 锁存器74LS175介绍- 4 -3.5 译码器74LS47介绍- 4 -4 设计思路- 5 -5 设计原理及过程- 5 -5.1
4、总体方案设计- 6 -5.2 单元模块设计- 6 -5.2.1抢答器控制端设计- 6 -5.2.2时钟发生信号- 7 -5.2.3倒计时设计- 8 -5.2.4控制电路和报警电路设计- 9 -6 智力竞赛抢答器仿真结果- 10 -7 PCB图制作- 11 -8 抢答器实物- 12 -9 设计总结- 13 -10 致谢- 14 -11 参考文献- 15 - 15 -引言本设计是根据实习要求进行智力竞赛抢答器的设计，首先根据设计要求画出了抢答器的系统框图，然后分模块对抢答器进行原理图设计，并用Multisim软件进行电路仿真，确定没有问题后再用Altium Designer Winter软件进行P
5、CB电路板的绘制，根据电路图对设计进行制作，焊接元件，最后进行调试测试。此设计报告包括了电路的设计和制作，并提出了一些设计的改进想法，总结了自己的不足。1 功能介绍1.1 主要功能介绍（1） 抢答器最多可供4名选手参赛，编号为14号，各队分别用一个按钮（分别为S1、S2、S3、S4）来实现抢答，并设置一个系统清零和抢答控制开关S5,限时抢答开关S6，由主持人控制。 （2）抢答器具有数据锁存功能,并将锁存数据用LED数码管显示出来，直到主持人清零。 （3）开关S5作为清零及抢答控制开关（由主持人控制），当开关S5被按下时允许抢答,当开关S5松开后则抢答电路清零。输入抢答信号由抢答按钮开关S1、S
6、2、S3、S4实现。 （4）有抢答信号输入（开关S1、S2、S3、S4中的任意一个开关被按下）时，并显示出相对应的组别号码。此时再按其他任何一个抢答器开关均无效，数码管显示器依旧“保持” 第一个开关按下时所对应的状态不变。1.2 扩展功能介绍（1）抢答器具有定时抢答的功能，且一次抢答的时间为30秒。当节目主持人启动“开始抢答”键S6后，要求定时器立即减计时，并用显示器显示。 （2）参加选手在设定的时间内抢答，抢答有效，定时器停止工作，显示器上显示选手的编号，并保持到主持人将系统清零为止。 （3）如果定时抢答的时间已到，却没有选手抢答时，本次抢答无效，封锁输入电路，禁止选手超时后抢答，时间显示器
7、上显示0。（4）每次有选手抢答或主持人操作按键以及倒计时都有相应的声光提示。2 设计说明如下图所示，为抢答器的逻辑框图。它主要由输入电路、锁存判断电路、声光显示电路、计时电路和数码显示电路等组成。抢答时，当抢先者按下面前的按钮时，输人电路立即输出一抢答信号，经判别电路后，输出响应信号去驱动声光显示电路。声响电路和计时电路以及时钟的输入信号是由555多谐振荡电路产生的脉冲信号来提供。抢答按钮锁存器译码显示主持人控制开关控制电路报警电路秒脉冲产生电路定时电路显示电路译码电路图2.1 数字抢答器系统框图3 主要元器件及其芯片介绍3.1 主要元器件芯片图图3.1 元器件芯片图3.2 计数器74LS19
8、2介绍74LS192具有下述功能：74LS192是双时钟方式的十进制可逆计数器。 （1）异步清零：CR=1，Q3Q2Q1Q0=0000 （2）异步置数：CR=0，LD=0，Q3Q2Q1Q0=D3D2D1D0（3）保持： CR=0，LD=1，CPU=CPD=1,Q3Q2Q1Q0保持原态 （4）加计数：CR=0, LD=1，CPU=CP，CPD=1，Q3Q2Q1Q0按加法规律计数 （5）减计数：CR=0, LD=1，CPU=1，CPD= CP，Q3Q2Q1Q0按减法规律计数注：CPU为加计数时钟输入端，CPD为减计数时钟输入端。LD为预置输入控制端，异步预置。 CR为复位输入端，高电平有效，异步清
9、除。 CO为进位输出：1001状态后负脉冲输出 BO为借位输出：0000状态后负脉冲输出。表3.1 74LS192真值表CR清零LD置数CPUCPD功能1000010001111复位置数保持加法计数减法计数3.3 NE555介绍NE555是属于555系列的计时IC的其中的一种型号，其主要特点如下：（1）只需简单的电阻器、电容器，即可完成特定的振荡延时作用。其延时范围极广，可由几微秒至几小时之久。 （2）它的操作电源范围极大，可与TTL，CMOS等逻辑电路配合，也就是它的输出电平及输入触发电平，均能与这些系列逻辑电路的高、低电平匹配。（3）其输出端的供给电流大，可直接推动多种自动控制的负载。 （
10、4）它的计时精确度高、温度稳定度佳，且价格便宜。 3.4 锁存器74LS175介绍74LS192具有下述功能：74LS175为四D触发器。（1）CLP：时钟输入端（上升沿有效） （2）CLR：清除端（低电平有效）（3）1D4D：数据输入端（4）1Q4Q：数据输出端 （5）1Q4Q：数据互补输出端表3.2 74LS175真值表输入输出DQ 1O1 00 1注：CLR为控制端，低电平有效，当为有效电平时锁存器停止工作3.5 译码器74LS47介绍74LS47具有下述功能：74LS47为七段数码管驱动器(1)LT：试灯输入，是为了检查数码管各段是否能正常发光而设置的。当LT=0时，无论输入A3，A2
11、，A1，A0为何种状态，译码器输出均为低电平，也就是七段将全亮,若驱动的数码管正常，是显示8。(2)BI：灭灯输入，是为控制多位数码显示的灭灯所设置的。当BI=0时，不论LT和输入A3，A2，A1，A0为何种状态，译码器输出均为高电平，使共阳极数码管熄灭。(3)RBI：灭零输入，它是为使不希望显示的0熄灭而设定的。当对每一位A3=A2=A1=A0=0时，本应显示0，但是在RBI=0作用下，使译码器输出全为高电平。其结果和加入灭灯信号的结果一样，将0熄灭。(4)RBO：灭零输出，它和灭灯输入BI共用一端，两者配合使用，可以实现多位数码显示的灭零控制。表3.3 74LS47真值表4 设计思路接通电
12、源后，主持人将开关拨到清除状态，抢答器处于禁止状态，主持人将开关置于开始状态，宣布开始抢答器工作，选手可按相应按键进行抢答。定时器倒计时，选手在定时时间内抢答时，抢答器完成：优先判断、编号锁存、编号显示、扬声器和发光二极管提示。当一轮抢答之后，定时器停止、禁止二次抢答。 如果再次抢答必须由主持人再次操作清除和开始状态开关。5 设计原理及过程5.1 总体方案设计（1）主持人有开始键和复位键（为同一个电键），按下开始键后才能开始抢答，否则无效。（2）用数码管显示，正常抢答后显示抢到的队号，同时扬声器和发光二极管开始报警。 （3）如果30秒内没有抢答，则说明该题超时作废。（4）复位键用于恢复超时状态
13、，时间清零，抢答显示器也同时复位。5.2 单元模块设计 5.2.1抢答器控制端设计电路选用锁存器74LS175来完成。该电路主要完成两个功能：一是分辨出选手按键的先后，并锁存优先抢答者的编号，同时译码显示电路显示编号（显示电路采用七段数字数码显示管）；二是禁止其他选手按键，其按键操作无效。工作过程：开关自下而上，分别是S1,S2,S3 S4,S5，S5是控制清零端，当S5断开时，抢答模块74LS175的CLR端置0，使整个模块处于禁止工作状态；当S5闭合时，抢答器处于等待工作状态，当有选手将抢答按键按下时（如按下S4），输出经74LS175锁存器接到七段显示电路处于工作状态，4Q3Q2Q1Q=
14、0100,经译码显示为“4”。此外，CLK0，使74LS175锁存器处于禁止状态，封锁其他按键的输入，确保不会出二次按键时输入信号，保证了抢答者的优先性。如有再次抢答需由主持人将S5开关重新置“清零”然后才可能进行。 图5.1 抢答器电路仿真图图5.2 抢答器清零5.2.2时钟发生信号时钟发生信号由555构成的多谢振荡电路来产生，电阻R1、R2和电容C1构成定时电路。定时电容C1上的电压UC作为高触发端TH（6脚）和低触发端TL（2脚）的外触发电压。放电端D（7脚）接在R1和R2之间。电压控制端K（5脚）不外接控制电压而接入高频干扰旁路电容C2（0.01uF）。直接复位端R（4脚）接高电平，使NE555处于非复位状态。多谐振荡器的振荡周期T和振荡频率f分别为T=Th+Tl=（R1+2R2）C1ln2 (1)f=1/T=1/（R1+2R2）C1ln2 (2)图5.3 时钟信号发生电路5.2.3倒计时设计由节目主持人对定时时间电路进行控制，闭合电键对计时器进行清
