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1、第四章 组合逻辑模块及其应用4.1 编码器一.编码器的基本概念及工作原理编码将特定的逻辑信号编为一组二进制代 码。能够实现编码功能的逻辑部件称为编码器。一般而言，N个不同的信号，至少需要n位二进制数编码。N和n之间满足下列关系:2nN 例：设计一个键控8421BCD码编码器。（2）由真值表写出各输出的逻辑表达式为：解：（1）列出真值表：重新整理得：（3）由表达式画出逻辑图：（4）增加控制使能标志GS ：当按下S0S9任意一个键时，GS=1，表示有信号输入；当S0S9均没按下时，GS=0，表示没有信号输入。二.二进制编码器3位二进制编码器有8个输入端，3个输出端，所以常称为8线3线编码器，其功能
2、真值表见下表：（输入为高电平有效）由真值表写出各输出的逻辑表达式为：用门电路实现逻辑电路：三优先编码器允许同时输入两个以上信号，并按优先级输出 。集成优先编码器举例74148（8线-3线）注意：该电路为反码输出。EI为使能输入端(低电平有效)，EO为 使能输出端(高电平有效) ，GS为优先编码工作标志(低电平有 效)。 四编码器的应用1编码器的扩展用两片74148优先编码器串行扩展实现的16线4线优先编码器2组成8421BCD 编码器4.2 译码器一译码器的基本概念及工作原理译码器将输入代码转换成特定的输出信号例：2线4线译码器写出各输出函数表达式：画出逻辑电路图 ：二、集成译码器 1.二进制
3、译码器741383线8线译码器2.8421BCD译码器7442三、译码器的应用1译码器的扩展用两片74138扩展为4线16线译码器2实现组合逻辑电路例4.2.1 试用译码器和门电路实现逻辑函数：解：将逻辑函数转换成最小项表达式，再转换成与非与非形式。=m3+m5+m6+m7=用一片74138加一个与非门就可实现该逻辑函数。例4.2.2 某组合逻辑电路的真值表如表4.2.4所示，试用译码器和门电路设计该逻辑电路。解：写出各输出的最小项表达式，再转 换成与非与非形式:用一片74138加三个与非门就可实现该组合逻 辑电路。可见，用译码器实现多输出逻辑函数时，优点更明显。3构成数据分配器数据分配器将一
4、路输入数据根据地址选择码分配给多路数据输出中的某一路输出。用译码器设计一个“1线-8线”数据分配器四、数字显示译码器常用的数字显示器有多种类型，按显示方式分，有字型重叠式、 点阵式、分段式等。按发光物质分，有半导体显示器，又称发光二极管(LED)显示 器、荧光显示器、液晶显示器、气体放电管显示器等。 1七段数字显示器原理按内部连接方式不同，七段数字显示器分为共阴极和共阳极两种 。2七段显示译码器7448七段显示译码器7448是一种与共阴极数字显示器配合使用的集成译码器。7448的逻辑功能：（1）正常译码显示。LT=1，BI/RBO=1时，对输入为十进制数l 15的二进制码（00011111）进
5、行译码，产生对应的七段显示 码。（2）灭零。当LT=1，而输入为0的二进制码0000时，只有当RBI =1时，才产生0的七段显示码,如果此时输入RBI =0 ，则译码器 的ag输出全0，使显示器全灭；所以RBI称为灭零输入端。（3）试灯。当LT=0时，无论输入怎样，ag输出全1，数码管七 段全亮。由此可以检测显示器七个发光段的好坏。 LT称为试 灯输入端。 （4）特殊控制端BI/RBO。BI/RBO可以作输入端，也可以作输出端。作输入使用时，如果BI=0时，不管其他输入端为何值，ag均输出0，显示器全灭。因此BI称为灭灯输入端。作输出端使用时，受控于RBI。当RBI=0，输入为0的二进制码00
6、00时，RBO=0，用以指示该片正处于灭零状态。所以，RBO 又称为灭零输出端。将BI/RBO和RBI配合使用，可以实现多位数显示时的“ 无效0消隐”功能。具有无效0消隐功能的多位数码显示系统4.3 数据选择器一、 数据选择器的基本概念及工作原理数据选择器根据地址选择码从多路输入数据中选择一路，送到输出。例：四选一数据选择器根据功能表，可写出输出逻辑表达式：由逻辑表达式画出逻辑图：二、集成数据选择器 集成数据选择器74151（8选1数据选择器）三、数据选择器的应用1数据选择器的通道扩展用两片74151组成 “16选1”数据选择器2实现组合逻辑函数（1）当逻辑函数的变量个数和数据选择器的地址输入
7、变量个数 相同时，可直接用数据选择器来实现逻辑函数。 例4.3.1 试用8选1数据选择器74151实现逻辑函数：解：将逻辑函数转换成最小项表达式：=m3+m5+m6+m7画出连线图。（2）当逻辑函数的变量个数大于数据选择器的地址输入变量个数时。 例4.3.2 试用4选1数据选择器实现逻辑函数：解：将A、B接到地址输入端，C加到适当的数据输入端。作出逻辑函数L的真值表，根据真值表画出连线图。4.5 加法器 一、加法器的基本概念及工作原理加法器实现两个二进制数的加法运算1半加器只能进行本位加数、被加数的加法运算而不考虑低位进位。列出半加器的真值表：画出逻辑电路图。由真值表直接写出表达式:如果想用与
8、非门组成半加器，则将上式用代数法变换成与非形式：由此画出用与非门组成的半加器。2全加器能同时进行本位数和相邻低位的进位信号的加法运算 。由真值表直接写出逻辑表达式，再经代数法化简和转换得：根据逻辑表达式画出全加器的逻辑电路图：二、多位数加法器4位串行进位加法器本章小结1常用的中规模组合逻辑器件包括编码器、译码器、数据选择器、数值比较器、加法器等。2上述组合逻辑器件除了具有其基本功能外，还可用来设计组合逻辑电路。应用中规模组合逻辑器件进行组合逻辑电路设计的一般原则是：使用MSI芯片的个数和品种型号最少，芯片之间的连线最少3用MSI芯片设计组合逻辑电路最简单和最常用的方法是，用数据选择器设计多输入、单输出的逻辑函数；用二进制译码器设计多输入、多输出的逻辑函数。
