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1、机EDA设计实验教程“实验西朋子秸表电路北航计算机学院艾明晶Date实验目的了解掌握电子秒表电路的结构与原理。掌握创建顶层图形设计文件的方法。“焦练掌握引脚锁定及编程下载的方法。Date验要求设计/停L具有异步清零和启动B子秒表电路,使其个E计数功能,最大能计到显示0,动序卜淬茎野Date。用发兆工极管显示向按下启/停按钮时,钮时,则暂停计数;第三次按下启/停按钮时,原来的数值基础|分钟的通同动计数;计数和停止计数使口E继续计数.。59.99s,并共秘高位、秒低位,百分秒位信号。个输入信号。数码管高位、百分秒低位当第一肢/停第二次按验原理设计此电路的关键在于BCD码计数器的计数时钟,它应由肢/
2、停接钮来控制:当启动计数时,计数时钟输出T04018的时钟信早;当停正计数时,计数时铎输出维持在高电平或低电平,同时计数时钟信号的计数器(即分频计数器保持T计数值!浩伟DateDate本实验选亢fclk=50MHz;坩实验箱的模式7FPGA适配板上的J6应接最下方两个插针选择Clock0一按钮式开关铺1Pin2337,锋1p1n237)(高脉沥寺续时闾为20ms)实现异步清零和肢动/停止计数功能团4个(共阳级)7段码显示数码管数码5、数码4显示计一数器秒高位和秒低发光二极管D1进位的值,用数码2、数码1显示百分秒高位和百分秒低位的值位的(PI040-Pin161显示向分钟的验内容将电路划分为3
3、个子模块,先进行子模块设计“分频电路子模块clkdiv100.v、“将输入时钟T=0.1ms分频力T=0.0ls,即|仪频系数为0|“提示:所有赋值语句均采用非阻塞赋值采用语句“clkoutk=(count6:0=-99);“使clkout在计够100个数后才有一个正跳变。巳医|心1am,apapapapapapapanapalaooGcopupmopopapg四9门定时计数子模块bedcnt.v“按0.01s的步长计时。苞)整个程序包括3个部分(采用非阻塞赋值语QR|clr信号为低有效,进位信号cn清雷,4个计数器清零。计数可以采用4个1f浩句的嵋套。皂e000000090700000000SSIDDDTGDate-E-Ialelelelslsls|一显示子模块p7segv*将定时计数子模块bedcnt.v的每个4位,三迹制计数器的输出信号译码为7段数码管的输,入信号,以便驱动(共阳级)数码管。*提示:为便于进行引脚锁定,p7seg.v七段码各字段的输出不用a+g表示,而组信号out6.0表示,分别对应ag。Date一-图形设计文件Csecondbdf)lmrzznza10o心Date一-E-
