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1、第第 2 2 次作业次作业 一、单项选择题（本大题共一、单项选择题（本大题共 4040 分，共分，共 2020 小题，每小题小题，每小题 2 2 分）分） 1. IEEE754 标准规定的 32 位浮点数格式中，符号位为 1 位，阶码为 8 位，尾数为 23 位，则它能表示的最大规格化正数为：( )。A. （22-23）2+127 B. （12-23）2+127 C. （22-23）2+255 D. 2+1272-23 2. MIPS32 指令系统描述正确的是（ ）。A. MIPS 指令可一次性取出 32 位的立即数 B. 其条件跳转指令跳转的范围大约为指令前后约 1M 字节 C. 其无条件跳
2、转指令的跳转范围为指令前后范围的 4GB 字节 D. 其指令的长度为固定长度，均为 32 位长度的指令 3. 输入输出指令的功能是（ ）。A. 进行算术运算和逻辑运算 B. 进行主存与 CPU 之间的数据传送 C. 进行 CPU 和 I/O 设备之间的数据传送 D. 改变程序执行的顺序 4. 下列（ ）属于应用软件。A. 操作系统 B. 编译系统C. 连接程序D. 文本处理5. 在 cache 存储器系统中，当程序正在执行时，由（ ）完成地址变换。A. 程序员 B. 硬件 C. 硬件和软件 D. 操作系统 6. IEEE754 标准规定的 32 位浮点数格式中，符号位为 1 位，阶码为 8 位
3、，尾数为 23 位，则它能表示的最大规格化正数为（ ）。A. （22-23）2+127 B. （12-23）2+127 C. （22-23）2+255 D. 2+1272-23 7. 在下面描述的 RISC 指令系统基本概念中不正确的表述是（ ）。A. 选取使用频率低的一些复杂指令，指令条数多。 B. 指令长度固定 C. 指令格式种类多 D. 只有取数/存数指令访问存储器8. 某型计算机系统的微处理器的主频为 100MHZ ，四个时钟周期组成一个机器周 期，平均三个机器周期完成一条指令，则它的机器周期为 ( )ns 。A. 40 B. 50 C. 80 D. 100 9. 系统级的总线是用来连
4、接（ ）。A. CPU 内部的运算器和寄存器 B. 主机系统板上的所有部件 C. 主机系统板上的各个芯片 D. 系统中的各个功能模块或设备 10. MIPS32 指令系统描述正确的是（ ）。A. MIPS 指令可一次性取出 32 位的立即数B. 其条件跳转指令跳转的范围大约为指令前后约 1M 字节 C. 其无条件跳转指令的跳转范围为指令前后范围的 4GB 字节 D. 其指令的长度为固定长度，均为 32 位长度的指令 11. 下列命令组合情况中，一次访存过程中，不可能发生的是（ ）。A. TLB 未命中，Cache 未命中，Page 未命中 B. TLB 未命中，Cache 命中，Page 命中
5、 C. TLB 命中，Cache 未命中，Page 命中D. TLB 命中，Cache 命中，Page 未命中 12. 在 MIPS 中跳转和跳转链接指令的地址范围(M=1024 K)是多大？（ ）A. 地址在 0-64M-1 之问 B. 地址在 0-256M-1 之间 C. 由 PC 提供高 4 位地址的 256M 大小的块中任意地址 D. 分支前后地址范围各大约 128M 13. 下列陈述中正确的是（ ）。A. 在 DMA 周期内，CPU 不能执行程序 B. 中断发生时，CPU 首先执行入栈指令将程序计数器内容保护起来 C. DMA 传送方式中，DMA 控制器每传送一个数据就窃取一个指令周
6、期 D. 输入输出操作的最终目的是要实现 CPU 与外设之间的数据传输 14. 设寄存器$s0=0xffffffff, $s1=0x00000001，指令 slt $t0，$s0，$s1 和 sltu $t0，$s0，$s1 执行以后，寄存器$t0 和$t1 的值分别是( )。A. 0,0 B. 0,1 C. 1,0 D. 1,1 15. 某机器字长 16 位，主存按字节编址，转移指令采用相对寻址，由两个字节组 成，第一字节为操作码字段，第二字节为相对位移量字段。假定取指令时，每 取一个字节 PC 自动加 1。若某转移指令所在主存地址为 2000H，相对位移量 字段的内容为 06H，则该转移指
7、令成功转以后的目标地址是（）。A. 2006H B. 2007H C. 2008H D. 2009H 16. 下列命令组合情况中，一次访存过程中，不可能发生的是( )。A. TLB 未命中，Cache 未命中，Page 未命中B. TLB 未命中，Cache 命中，Page 命中 C. TLB 命中，Cache 未命中，Page 命中 D. TLB 命中，Cache 命中，Page 未命中 17. 下面对计算机总线的描述中,确切完备的概念是（ ）。A. 地址信息、数据信息不能同时出现 B. 地址信息与控制信息不能同时出现 C. 数据信息与控制信息不能同时出现 D. 两种信息源的代码不能在总线中
8、同时传送 18. 某 32 位计算机的 cache 容量为 16KB，cache 块的大小为 16B，若主存与 cache 的地址映射采用直接映射方式，则主存地址为 1234E8F8（十六进制）的 单元装入的 cache 地址为( )。A. 00 0100 0100 1101 (二进制) B. 01 0010 0011 0100 (二进制) C. 10 1000 1111 1000 (二进制) D. 11 0100 1110 1000 (二进制) 19. 设寄存器$s0=0xffffffff, $s1=0x00000001，指令 slt $t0，$s0，$s1 和 sltu $t0，$s0，$
9、s1 执行以后，寄存器$t0 和$t1 的值分别是( )。A. 0,0 B. 0,1 C. 1,0 D. 1，120. MIPS 中条件分支的地址范围（ ）。 A. 地址范围 0-64K-1 B. 地址范围 0-256K-1 C. 分支前后地址范围各大约 32K D. 分支前后地址范围各大约 128K 二、判断题（本大题共二、判断题（本大题共 6060 分，共分，共 2020 小题，每小题小题，每小题 3 3 分）分） 1. DMA 控制器和 CPU 可同时使用总线。2. 跳转指令的目标地址由当前的 PC+4 的高 4 位与跳转指令的低 26 位左移 2 位后 相加而成。3. DMA 设备的中
10、断级别比其他外设高，否则可能引起数据丢失。4. 浮点加法符合结合律。 5. I/O 设备是处于主机之外的输入/输出设备，所以应为外围设备分配独立的设备 码而不能与主存单元统一进行编址。6. 舍人方法有很多种，最简单的是四舍五入。7. 更强大的指令意味着更高的性能。8. 程序中断与调用子程序于一样，都是程序的切换过程，没有任何区别。9. 在微程序控制方式中，每一条机器指令用一条微指令解释执行。10. 取指令操作受指令操作码控制。11. 具有越低失效率的计算机系统性能越高。12. 没有减少强制缺失的方法。13. 在虚拟存储器中，当程序正在执行时，由操作系统完成地址映射。14. 微程序控制控制方式与
11、硬布线控制方式相比， 最大的优点是提高了指令的执行 速度。15. 在一条微指令中，顺序控制部分的作用是产生后继微指令的地址。16. 一条机器指令由一段微指令编成的微程序来解释执行。17. 微程序控制控制方式与硬布线控制方式相比， 最大的优点是提高了指令的执行 速度。18. 在减少缺失方面，关联度比容量更为重要。19. 写回机制的实现也比写直达要简单得多。20. MIPS 是测量计算机性能的一致性指标。答案：答案：一、单项选择题（一、单项选择题（4040 分，共分，共 2020 题，每小题题，每小题 2 2 分）分） 1. A 2. C 3. C 4. D 5. B 6. A 7. A 8. A 9. D 10. C 11. D 12. C 13. D 14. C 15. C 16. D 17. D 18. C 19. C 20. C 二、判断题（二、判断题（6060 分，共分，共 2020 题，每小题题，每小题 3 3 分）分） 1. 2. 3. 4. 5. 6. 7. 8. 9. 10. 11. 12. 13. 14. 15. 16. 17. 18. 19. 20.
