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1、1北京邮电大学北京邮电大学 2012201220132013 学年第学年第 1 1 学期学期微处理器与接口技术微处理器与接口技术 期末考试试题期末考试试题（A）考 试 注 意 事 项一、学生参加考试须带学生证或学院证明，未带者不准进入考场。 学生必须按照监考教师指定座位就坐。 二、书本、参考资料、书包等物品一律放到考场指定位置。 三、学生不得另行携带、使用稿纸，要遵守北京邮电大学考场规 则 ，有考场违纪或作弊行为者，按相应规定严肃处理。 四、学生必须将答题内容做在试题答卷上，做在草稿纸上一律无效。五、学生的姓名、班级、学号、班内序号等信息由教材中心统一印 制。考试 课程微处理器与接口 技术考试
2、时间 2 小时2012 年 1 月 8 日题号一二三四五 （1）五 （2）五 （3）六总分满分18202418668得分阅卷 教师一、填空题（每空一、填空题（每空 1 分，共分，共 18 分）分）1. 假设 AL 中存放二进制数 01011101B，若执行指令 NEG AL 后再执行CBW，则 AX 的内容为 0FFA3H ，如果认为结果是补码，则按十进制大小是 -93 。2. 8086 在执行 MOV AL，2001H 时，需要一个总线周期，ALE 在该总线周期内要持续 1 个时钟周期有效，此时 BHE 为 0/低电平 ，A0为 1/高电平 。班级： 学号： 班内序号： 姓名：-装- -订-
3、 -线- -23. 某 8 位数据总线的微处理器系统中由 6 片 16K4 的芯片组成 ROM 内存，若该内存的末地址为 0FFFFFH，则其首地址为 0F4000H （填写物理地址）。4. 计算机内的堆栈存取采用 后进先出/先进后出 原则，有一个堆栈区，地址为 1250H:0000H1250H:0100H，(SP)=0052H，则栈顶的物理地址是 1250H:0052H/12552H ，栈底的物理地址是 1250H:0100H/12600H 。5. 已定义“VAR1 DB 01H，10H，00H，02H” ，且 AX=0210H，则指令“DIV VAR1+1”的源操作数是 10H ，执行该指
4、令后 不会 （会/不会）发生除法溢出中断。6. 标志寄存器中， TF 标志没有相应的指令来修改，可以通过以下命令来对其置位，请补充完整。PUSHFPOP AXOR AX,0100H PUSH AXPOPF7. D/A 转换器的分辨率是指 其所能分辨的最小电压 。8. 8086 的 INTR 中断响应时会发出两个低电平的中断响应周期，其中在第2 个中断响应周期，8259 会通过数据总线向 CPU 提供中断类型号，该类型号的低 3 位由 8259 的中端输入引脚的编号 提供。9. 8253 的工作方式中，方式 1 和 5 （要填写所有符合条件的方式）要通过 GATE 端来触发启动计数，在计数过程中
5、如果需要读取计数值，应该向 8253 发出一个锁存命令 。二、判断题，正确的在括号内打二、判断题，正确的在括号内打，否则打，否则打（每小题（每小题 2分，共分，共 20 分）分）31.8086 的指令执行部件 EU 负责指令的执行，所以读写存储器的 MOV指令产生的读写控制信号由 EU 负责产生。 （ ）2.在 8086 总线周期的 T1 状态，若引脚/S7 输出低电平，表示高 8BHE位数据总线 AD15AD8 上的数据有效。 （ ）3.若 Y 是数据段中的变量，指令 ADD Y，OFFSET Y 是正确的。 （ ）4.PC 总线使用 8086 的最大模式，所以 8288 总线控制器产生的读
6、写控制信号在 PC 总线中都可以找到。 （ ）5.采用虚拟存储技术可以解决主存储器的空间和速度不足的问题。 （ ）6.由于 8086 在中断服务程序执行前，自动设置 IF=TF=0，所以返回时系统要将其置位。 （ ）7.采用存储器映像的 I/O 寻址方式的系统，存储器地址增加，则 I/O 端口地址就减少，且 I/O 端口可以有较多的寻址方式。 （ ）8.8237DMA 数据块传送模式的特点是：一次请求传送一个数据块，但在整个 DMA 传送期间如果有中断请求，CPU 不能响应它。 （ ）9.在多级 8259 的情况下，对于主从 8259 需要分别初始化，而且总是会使用初始化命令字 ICW4。 （
7、 ）10.DRAM 以 MOS 晶体管的栅极电容来存储二进制信息，需要定时刷新。（ ）三、选择题（每小题分，共三、选择题（每小题分，共 24 分）分）1. CPU 中程序计数器（IP）中存放的是（ B ） 。A. 指令B. 指令地址C. 操作数D. 操作数地址2. 当 8086/8088 访问 100H 端口时，采用（ C ）寻址方式。4A. 直接B. 立即C. 寄存器间接D. 相对3. 设 BL05H，要使结果 BL0AH，应执行的指令是（ C ） 。A. NOT BLB. AND BLC. XOR BL, 0FHD. OR BL, 0FH4. 在同一程序段中，定义有下面的伪指令，使用正确的
8、是（ B ） 。A. PORT1 EQU AL PORT1 EQU 2000HB. PORT2=3500H AND 0FFHC. POP DD ABCDD. PORT4 PROC RET END5. 已知（SP）=1310H，执行 IRET 指令后（SP）为（ D ） 。A. 1304HB. 1314HC. 1312HD. 1316H6. 某微机接口电路中，要设置 10 个只读寄存器、8 个只写寄存器和 6 个可读可写寄存器，一般应为它至少提供（ C ）个端口地址。 A. 24B. 14C. 16D. 187. 主存储器和 CPU 之间增加高速缓冲存储器的目的是（ A ） 。 A. 解决 CP
9、U 和主存之间的速度匹配问题 B. 扩大主存储器的容量 C. 扩大 CPU 中通用寄存器的数量 D. 既扩大主存储器的容量又解决 CPU 和主存之间的速度匹配问题8. 如果有多个中断同时发生，系统将根据中断优先级响应优先级最高的 中断请求。若要调整中断事件的响应次序，可以利用（ B ） 。 A.中断响应B.中断屏蔽C.中断向量 D.中断嵌套98088 系统中，15H 号中断的中断向量存放在内存储器的（ A ）单 元中。5A. 0000:0054H-0000:0057HB. 0000:0060H-0000:0063H C. FFF0:0054H-FFF0:0057HD. FFF0:0060H-F
10、FF0:0063H10. PC 系列机中，确定外部硬中断的服务程序入口的地址是（ D ） 。 A. 主程序中的调用指令 B. 主程序中条件转移指令 C. 中断控制器中的中断服务寄存器 D. 中断控制器发出的中断向量号11. 设串行异步通信的数据格式是：1 位停止位，7 位数据位，1 位校验 位，1 位起始位。若传输率为 2400 位/秒，则每秒传输的最大字符个数 为（ D ） 。 A. 10 个B. 110 个C. 120 个D. 240 个12. 8237A 的地址是双向的，因为（ D ） 。 A. 8237A 可以传输输入/输出的地址 B. 8237A 内部的地址是双向的 C. 8237A
11、 作为系统总线时应该是双向的 D. 8237A 既可以是系统总线的主控者，也可以是从设备四、简答题（每题四、简答题（每题 4 分，共分，共 24 分）分）1、说明堆栈的概念，用途，给出定义堆栈段（1024 Byte）和初始化相关寄存器的代码。 堆栈是后进先出方式组织的一块存储区域。主要用来保存返回地址和临时变 量。stk segment stack skeep db 1024 dup (?) stk endsmov ax, seg stk mov ss, ax mov sp size skeep2、说明什么是立即寻址、直接寻址以及 CPU 是如何取得要执行的指令的。 操作数包含在指令中，是立即
12、寻址。操作数的地址包含在指令中，是直接寻 址。取指令的寻址方式是寄存器间接寻址。3、总线周期的含义是什么? 8086/8088 的基本总线周期由几个时钟周期组成?如果一个 CPU 的时钟频率为 4.77MHz，那么，它的一个时钟周期是多少?一个基本总线周期为多少?6一个总线周期是 CPU 通过总线与外部(MEM/IO 口)进行一次通讯所需要的时间。4 个。 0.21us(1/4.77)。0.84us（4/4.77） 。4、说明 A/D 转换的逐次逼近法原理。逐次逼近法的转换时间与哪些因素有关？ 逐次逼近法是在 AD 内部使用逐次逼近寄存器，将该寄存器的值与模拟信号 比较，从高位开始逐位设置和调
13、整寄存器内容，最终确定变换结果。转换时 间是 A/D 的位数乘以一次转换和比较的时间。5、说明 IO 端口的两种编址方式，各自对指令系统和硬件有什么要求？ 与内存统一编址和独立编制。独立编址需要单独的 IO 指令，总线需要独立 的 IO 访问控制或指示信号。统一编址没有这些要求。6、说明 DMA 的工作原理，简述外设、DMAC、CPU 的交互过程。 DMA 由 DMAC 控制系统，直接在内存和 IO 设备之间进行数据传递。 外设向 DMAC 发出请求（DRQ） ，DMAC 向 CPU 发出 HOLD，CPU 回应 HLDA，DMAC 向外设发出 DACK。五、接口综合题（共五、接口综合题（共
14、20 分）分）1. 接口电路如图，请回答如下问题（6 分）：71X 表示 0 和 1 都可以。OUT 23H, AL ; 写入方式字MOV AL, 0CH ；(00001100B) 使 PC2、PC3 为高电平OUT 22H, AL ; 把 0CH 写入 C 口。可使 A/D 转换开始（4）CPU 如何知道 A/D 转换结束？CPU 何时以及如何读取转换好的数据？（1 分）11从图中可知 A/D 转换结束信号为 EOC，该信号接到 8259A 的 IR2，所以 CPU 发现中断请求后就可知道 A/D 转换结束。CPU 在中断响应后，转入 IR2 的中 断服务程序既可读取 A/D 转换好的数据。
15、附：附：8255A 方式选择控制字方式选择控制字3. 根据以下连接示意图回答问题。（8 分）1270DD 70DD RDRDWRWRCSCS0A0A1A0Y1Y7YAG2BG21GABC+0A1A2A3A4A5A14A15A8086系统总线70DD IORIOW7PA1PA0PA8259825513874LSV5特殊 外设KINTINTR的到80865IR0PC7PCRDYSTART6Y注：图中(a)8086 系统总线的地址信号经过或非门后的输出接至 74LS138 的145AA K端；1G(b)图中有一特殊外设，其发送的数据送到 8255 的 PA 引脚端，但其发送数据有如下要求：需由人手动控制，即只有在开关 K 每次从合上到断开后才允许其发送一个 8
