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1、第 1 页共 5 页2010 届电子升学班 时 序 逻 辑 电 路 试 题学 号 _姓名_一、填空题：1、数码寄存器主要由_和_组成，其功能是用来暂存二制数码。2、从电路组成看，时序逻辑电路由组合逻辑电路和_两部分组成。3、时序逻辑电路的特点是电路的输出状态不仅与当前的输入信号有关，而且还与电路 有关。4、计数器按 CP 控制触发方式的不同可分为 _计数器和_计数器。5存放 n 位二进制数，需要_个触发器。6、异步十进制计数器是由_个 JK 触发器组成。7、用三个触发器组成的计数器最多可有 _ 个有效状态，它称为 进制计数器。若要构成六进制计数器，最少用 _ 个触发器，有 _ 个无效状态。8、
2、4 位移位寄存器，经过_个 CP 脉冲之后， 4 位数码恰好全部串行移入寄存器，经过_个 CP 脉冲可得到并行输出；再经过 _个 CP 脉冲可得到串行输出。9、分频器电路如图，已知 CP 脉冲的频率为 2000HZ，则 Q0 的频率为_HZ，Q 1 的频率为_HZ。二、单选题：1、如果一个寄存器的数码是“同时输入，同时输出” ，则该寄存器是采用( )A、串行输入、串行输出 B、并行输入、并行输出 CP Q0Q0DQ1Q1D第 2 页共 5 页C、串行输入、并行输出 D、并行输入、串行输出 2、下列电路中不属于时序逻辑电路的是( )A、同步计数器 B、数码寄存器 C、编码器、译码器 D、异步计数
3、器 3、在相同的时钟脉冲作用下，同步计数器与异步计数器比较，工作速度( )A、较快 B、较慢 B、一样4、同步十进制加法计数器的初态为 Q3Q2Q1Q0=0000，则当第 6 个 CP 到来时 Q3Q2Q1Q0=( )A、0011 B、0110 C、1011 D、01015、设计一个四进制计数器中，需要触发器的个数至少为( )A、1 个 B、2 个 C、4 个 D、8 个6、若三位异步二进制减法计数器的初态为 Q2Q1Q0=000，接收一个计数脉冲后，Q 2Q1Q0 应为（ ）A、111 B、001 C、010三、分析、作图题：（共 50 分）1、分析下图所示电路，（1）它是_器；（2）当 =
4、1 且 CP 脉冲的_沿到来时，电路接收数码；CR（3）若电路的初始状态 Q2Q1Q0=000，输入的数据为 1101，列出连续 4 个CP 脉冲作用下的状态表。1101Q1DQDQ DQQCPQ0Q2Q3 CR第 3 页共 5 页2、将下面的 JK 触发器分别连接成 3 位二进制异步减法器和同步加法器。（1）异步减法器（2）同步加法器3、如图示电路，写出状态表，画出 Q2、Q 1、Q 0的工作波形。Q0JKCQ1JKCQ0JKC CPQ0JKCQ1JKCQ0JKC CPJKKKJJQ0Q1Q2CPCRCP1 2 3 4 5 6 7 8Q0Q1Q2第 4 页共 5 页4、如图示，已知初态 Q1Q000，（1）写出状态表；（2）说明电路的逻辑功能；（3）画出 4 个 CP 脉冲作用下的 Q1、Q 0 的波形。CPQ0Q1 JDK01第 5 页共 5 页
