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1、1数字电子技术实验报告开课实验室 指导教师 班级 学号 姓名 日期 实验项目 实验一 TTL 逻辑门电路 和组合逻辑电路 一、实验目的1掌握 TTL“与非”门的逻辑功能。2学会用“与非”门构成其他常用门电路的方法。3掌握组合逻辑电路的分析方法与测试方法。4学习组合逻辑电路的设计方法并用实验来验证。二、预习内容1用 74LS00 验证“与非”门的逻辑功能 Y1= AB2用“与非”门（74LS00）构成其他常用门电路Y2= Y3=A+B= Y4= AB实验前画出 Y1Y4 的逻辑电路图，并根据集成片的引脚排列分配好各引脚。3.画出用“异或”门和“与非”门组成的全加器电路。 （参照实验指导书 P.7
2、5 图 3-2-2）并根据集成片的引脚排列分配好各引脚。4设计一个电动机报警信号电路。要求用“与非”门来构成逻辑电路。设有三台电动机，A、B、C。今要求： A 开机，则 B 必须开机；B 开机，则 C 必须开机；如果不同时满足上述条件，则必须发出报警信号。实验前设计好电动机报警信号电路。设开机为“1” ，停机为“0” ；报警为“1” ，不报警为“0”。 （写出化简后的逻辑式，画出逻辑图及引脚分配）三、实验步骤1 逻辑门的各输入端接逻辑开关输出插口，门的输出端接由发光二极管组成的显示插口。逐个测试逻辑门 Y1-Y4 的逻辑功能，填入表 1-1表 1-12 用 74LS00 和 74LS86 集成
3、片按全加器线路接线，并测试逻辑功能。将测试结果填入表1-2。判断测试是否正确。图中 Ai、B i 为加数，C i-1 为来自低位的进位；S i 为本位和， Ci 为向高位的进位信号。表 1-2输 入 输 出（逻辑电平）A B Y1 Y2 Y3 Y40 00 1 /1 01 1 /Ai 0 0 1 1 0 0 1 1Bi 0 1 0 1 0 1 0 1Ci-1 0 0 0 0 1 1 1 1Si*SiCi23.根据设计好的电动机报警信号电路用 74LS00 集成片按图接线，并经实验验证。将测试结果填入表 1-3。表 1-3四、简答题1 Y4 具有何种逻辑功能？2 在实际应用中若用 74LS20
4、来实现 Y= 时，多余的输入端应接高电平还是低电平？AB3 在全加器电路中，当 Ai=0，S i*=1，C i=1 时 Ci-1=？ABCY3数字电子技术实验报告开课实验室 指导教师 班级 学号 姓名 日期 实验项目 实验二 组合逻辑电路的设计 一、实验目的1掌握用 3 线- 8 线译码器 74LS138 设计组合逻辑电路。2掌握用 8 选 1 数据选择器 74LS151 设计组合逻辑电路。3掌握用 4 位并行加法器 74LS283 设计组合逻辑电路。二、预习内容 实验前设计好电路。 （写出输出的逻辑函数式，画出逻辑图及引脚分配） 1 用 3 线- 8 线译码器 74LS138 和门电路设计
5、1 位二进制全减器电路。设：被减数为 Ai，减数为 Bi，来自低位的借位 Ci-1；两数之差 Si，向高位的借位信号 Ci2用 8 选 1 数据选择器 74LS151 设计用 3 个开关控制一个电灯的逻辑电路。要求改变任何一个开关的状态都能控制电灯由亮变灭或由灭变亮。设：3 个开关的状态分别以 A、B、C 表示，取 1 代表开关闭合，取 0 代表开关断开。用Y 代表灯的状态，取 1 代表灯亮，取 0 代表灯灭。从 ABC=000 时 Y=000 这个状态开始。3用 4 位并行加法器 74LS283 设计一个将余 3 代码转换成 8421 的二十进制代码的电路。三、实验步骤1 按照设计好的全减器
6、电路接线，测试逻辑功能并将测试结果填入表 2-1。判断测试结果是否正确。表 2-1Ai 0 0 1 1 0 0 1 1Bi 0 1 0 1 0 1 0 1Ci-1 0 0 0 0 1 1 1 1SiCi2 按照设计好的开关控制电路接线，并经实验验证。将测试结果填入表 2-2。表 2-23按照设计好的二十进制代码的电路接线，并经实验验证。将测试结果填入表 2-3。表 2-3余 3 码 1100 1011 1010 1001 1000 0111 0110 0101 0100 00118421 码四、简答题 1 通过实验你觉得用小规模集成电路和中规模集成电路来设计组合逻辑电路哪个更方便些？2 能否以
7、一片 74LS151 为核心来设计全加器？3 以 74LS138 和门电路来设计全减器，选用 TTL 或 CMOS 门电路那种更合适？A 0B 0C 0Y 04数字电子技术实验报告开课实验室 指导教师 班级 学号 姓名 日期 实验项目 实验三 触发器的逻辑功能测试及移位寄存器 一、实验目的1 掌握 JK 和 D 触发器的逻辑功能2 掌握集成触发器的使用方法3 学习移位寄存器的构成方法二、预习内容1双 JK 触发器 74LS76 的逻辑功能的测试。2双 D 触发器 74LS74 的逻辑功能的测试。3 画出用 D 触发器构成的四位移位寄存器的逻辑图，并根据 74LS74 引脚排列标出引脚号。（参考
8、实验指导书）三、实验步骤1从 74LS76 中任选一个 JK 触发器，将其 、 、J、K 端接逻辑开关输出插口，CPDRS端接单次脉冲源，Q 端接至逻辑电平显示输入插口。按表 3-1 测试其逻辑功能并记录结果。2从 74LS74 中任选一个 D 触发器，按表 3-2 测试其逻辑功能并记录结果。方法同上。3用 74LS74 构成四位移位寄存器。按四位移位寄存器的逻辑图接线。 数据输入端接至逻辑开关输出插口，各触发器的输出端 Q 接至逻辑电平显示输入插口。工作之初请零，在数据输入端送入相应信号。使其经过 4 个移位脉冲后，输出为“1101”，将工作过程记录于表 3-3 中。表 3-1 表 3-2表
9、 3-3寄存器中的数码移位脉冲数Q3 Q2 Q1 Q00 0 0 0 01234四、简答题1在图 3-1 中经过一个 CP 脉冲后，JK 触发器为何种状态？2用 74LS76 的 JK 触发器转换成的 D 触发器与 74LS74 的D 触发器在工作中有什么不同之处？ 图 3-13移位寄存器如果采用串行输出方式应从哪里输出？需送几个脉冲才能把“1101”取出？CP J K Qn Qn+101 001 110 010 100 000 111 011 1CP D Qn Qn+10 00 11 01 1JKQ001QSDRD15数字电子技术实验报告开课实验室 指导教师 班级 学号 姓名 日期 实验项目
10、 实验四 计数器（1） 一、实验目的学会用触发器构成计数器的方法。二、预习内容1 用 74LS74 构成二进制加法计数器。画出用 D 触发器构成四位二进制异步加法计数器的电路图。 （参照实验指导书图 3-5-1。按 74LS74 引脚排列，标出引脚号。 ）图 4-12 图 4-2 是用 JK 发器构成的 N 制进制加法计数器，按 74LS76 引脚排列，标出引脚号。图 4-2三、 实验步骤1二制进制加法计数器用二片 74LS74 按图 4-1 接线，各触发器的 端接至逻辑开关输出插口， 端接高电平DRDS输出端 Q3、Q 2、Q 1、Q 0 接逻辑电平显示输入插口。清零后，逐个送入单次脉冲。把
11、 Q3Q 0 的状态填入表 4-1。表 4-12N 制进制加法计数器 用 74LS76 按图 4-2 接线。清零后，逐个送入单次脉冲，将 Q3Q 0 的状态填入表 4-2。表 4-2四、简答题1将图 4-1 作什么样的改变，即可构成四位异步二进制减法计数器？2图 4-2 中由 JK 触发器构成的计数器是几进制计数器？3 以 74LS74 为核心构成九进制计数器，至少要用几片 74LS74？CP 0 1 2 3 4 5 6 7 8 9 10 1112 13 14 15 16Q0 0Q1 0Q2 0Q3 0计数脉冲 Q1 Q00123Q1计 数 脉 冲 JKQJKQQ0清 零 QQ11RDC 11
12、6数字电子技术实验报告开课实验室 指导教师 班级 学号 姓名 日期 实验项目 实验五 计数器（2） 一、实验目的1 学习测试四位二进制计数器 74161 的逻辑功能。2 学会用 74161 构成 N 进制计数器。二、预习内容174161 逻辑功能的测试。2以 7490 为核心用置零法构成八进制计数器。3 以 74161 为核心辅以与非门用置数法构成七进制计数器。实验前设计好电路。 （画出电路图和状态转换图）置零法 状态转换图置数法 状态转换图三、实验步骤1. 74161 的逻辑功能测试将 74161 的 、 、EP、ET 、CP 及 、 D3、D 2、D 1、D 0 端分别接至逻辑开关输出插D
13、RL口，将 、 Q3、Q 2、Q 1、Q 0 端接至逻辑电平显示输入插口。按 74161 的功能表测试功能。把测试结果填入表 5-1 中。表 5-1CP DRLEP ET D3D2D1D0 Q3n+1Q2n+1Q1n+1Q0n+1 功能 0 置零 1 0 1110 置数 1 1 0 1 1001 保持 1 1 1 1 加 1 计数 计数3 按设计好的八进制计数器电路接线。并把 QD、Q C、Q B、Q A 分别接到逻辑电平显示输入插口和实验箱上的显示译码器的对应输入口 D、C、B、A。用实验验证，并把结果填入表 5-2。4 按设计好的七进制计数器电路接线。并把 Q3、Q 2、Q 1、Q 0 分别接到逻辑电平显示输入插口和实验箱上的显示译码器的对应输入口 D、C、B、A。用实验验证，并把结果填入表 5-2。表 5-2置零法(7490) 置数法(74161)计数脉冲 CPQDQCQBQA LED Q3Q2Q1Q0012345678四、简答题1异步置零和同步置零的区别在哪里？2用置数法构成七进制计数器时，若要用 74161 的进位输出端作为七进制计数器的进位端，则电路设计
