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1、数字逻辑与数字系统设计课程复习大纲一、课程性质、目的和任务数字逻辑与数字系统设计是计算机应用专业必修的技术基础课程,涵盖了数字电子技术基础和数字逻辑的全部内容。本课程的主要目的是使学生牢固建立数字逻辑电路的基本概念；系统地掌握逻辑电路的分析和设计方法；熟悉一些典型的、有代表性的线路及其应用特性；通过做课程实验，培养设计与调试数字电路的能力。为学好后续课作好准备。二、教学基本要求1熟练掌握数字逻辑电路的基本概念，布尔代数理论及布尔函数化简方法。2熟练掌握组合逻辑电路的分析方法和设计方法。3了解大规模集成电路在逻辑电路中的应用；4掌握各类集成门电路的工作原理及主要参数的测试方法；5掌握各类集成触发
2、器的工作原理及主要参数；6熟练掌握同步时序逻辑电路和异步时序逻辑电路的分析及设计方法；7掌握脉冲产生及整型电路；8掌握实验技能和调试方法，培养学生调试数字系统的能力。9了解 PAL、GAL、EDA 等数字电路发展的新技术；三、教学要求1绪论数字系统概述：掌握熟制转换方法、二进制机器数的转换及求真值。2数制和编码(1)字符编码；BCD 码转换真值表(2)可靠性编码：GRAY 码、奇偶校验码、Hamming 码、CRC 码的求取。思考可靠性编码的用途、数学基础。参见课本第一章练习题题型及计算机导论第一章定点数练习题题型。3布尔代数(1)“与“、 “或” 、 “非”逻辑运算的基本定义：掌握；(2)布
3、尔代数的基本定义与规则：理解掌握；(3)逻辑函数的代数化简法：熟练掌握方法；(4)逻辑函数的卡诺图化简法：熟练掌握方法；(5)补函数、对偶函数的求取，化简或与式的方法：卡诺图按 0 求取表达式化简，求取补函数、对偶函数后，按与或式化简，再恢复或与式。(6)逻辑函数标准式与真值表、卡诺图的关系：理解掌握、能够转换；(7)多输出函数的化简；要求全局最优。(8) 用两函数卡诺图之对应单元相加、乘的方法求两函数的布尔和 F1+F2 与 F1F2课本第二章练习题题型。4集成逻辑门电路(1)开关器件与开关信号：一般理解；(2) TTL 集成门电路：TTL“与非门”的工作原理与电路参数：一般理解；(3) T
4、TL 与非门的主要派生电路：与或非门、异或门、集电极开路门(OC)、三态门：一般理解；(4) MOS 集成开关电路、MOS 开关电路及其参数：了解。注重参数概念和原理。5组合逻辑电路分析(1)组合逻辑电路分析的一般方法：掌握；(2)组合逻辑电路的分析：掌握。6组合逻辑电路设计(1)组合逻辑电路设计的一般方法：掌握；(2)组合逻辑电路设计中几个实际问题的考虑：理解；(3)组合逻辑电路设计举例：通过举例熟练掌握三种设计方法，1）经典法：题意真值表卡诺图最简函数指定逻辑门逻辑电路的规范设计方法（ 如课本半加器的设计方法） ，适合变量少 ；2）功能表法：题意功能表逻辑函数逻辑电路的设计方法（如课本中表
5、 4-11 的方法） ，适合变量较多；3）题意逻辑函数逻辑电路的设计方法（如课本中原码变补码的方法） ，适合变量多。课本第四章例题及练习题题型。不要求掌握课本 125 页后降解的芯片，设计时允许根据需要灵活使用芯片。7集成触发器(1)理解时序逻辑电路概述：基本概念，状态图和状态表的初步概念；(2) 掌握 R-S、D、J-K、T 功能表，使用 R-S、D、J-K、T 激励表；(3)熟悉触发器概念和种类；(4)理解触发器的空翻现象及其解决方法；（5）触发器的转换及应用：R-S、D、J-K、T 间转换。习题：课本 1）5-1；2）5-5；3）将 R-S 触发器转换为 T 触发器。4）将 D 触发器转
6、换为 T 触发器。8掌握同步时序逻辑电路的分析方法。9掌握同步时序逻辑电路的设计方法。(1)形成原始状态表。MEALY 和 MOORE 型原始状态图/状态表的表示方法；(2)状态化简：隐含表化简。注意正确使用等效与相容概念化简方法；(3)观察法状态化简。(4)关于状态分配的讨论。(5) 利用合并图、最小比覆盖表状态化简与电路的设计。10异步时序逻辑电路的分析与设计(1)掌握脉冲异步时序逻辑电路的分析与设计；注意 CP 的设计；(2)掌握电平异步时序逻辑电路的分析与设计；波形图法与总态图法；(3)时序逻辑电路的竞争与险象，出现的原因及消除的方法。练习要求：1）课本例题题型及典型（计数器、序列检测器、码制转换等）题型、 ；2）计数器与分频器的关系，高模数计数器的设计（例 6-21） ；3）状态分配冗余码的处理；4）课本习题 6-1、6-3、6-5、6-6、6-7、6-11、7-5、7-9、7-10、7-11、7-12；5）竞争与险象电路的检测与防范。11脉冲产生与整形电路：一般理解。(1) 555 定时器；(2) 脉冲产生与整形电路及及其应用。12可编程逻辑器件：了解概念。(1)只读存贮器：ROM、EPROM。(2)可编程序逻辑阵列 PLA；(3)可编程序阵列逻辑 PAL。
