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1、课 程 设 计 报 告课程名称数字逻辑课程设计课题RS 触发器的设计专业计算机科学与技术班级0902学号21姓名田鹏指导教师刘洞波邓作杰陈多2011 年 01 月 09 日2课程设计任务书课程名称数字逻辑课程设计课题RS 触发器的设计专业班级计算机科学与技术学生姓名田鹏学号23指导老师刘洞波邓作杰陈多审批刘洞波任务书下达日期：2011 年 01 月 09 日任 务 完 成 日 期 ：2011 年 01 月 21 日4一 、 设 计 内 容 与 设 计 要 求1设计内容：本课程是一门专业实践课程，学生必修的课程。其目的和作用是使学生能将已学过的数字电子系统设计、VHDL 程序设计等知识综合运用于
2、电子系统的设计中，掌握运用 VHDL 或者 Verilog HDL设计电子系统的流程和方法，采用Quartus II 等工具独立应该完成1 个设计题目的设计、仿真与测试。加强和培养学生对电子系统的设计能力,培养学生理论联系实际的设计思想，训练学生综合运用数字逻辑课程的理论知识的能力，训练学生应用Quartus II 进行实际数字系统设计与验证工作的能力，同时训练学生进行芯片编程和硬件试验的能力。题目一4 线 -16 线译码器电路设计；题目二16 选 1 选择器电路设计；题目三4 位输入数据的一般数值比较器电路设计题目四10 线 -4 线优先编码器的设计题目五8 位全加器的设计题目六RS 触发器
3、的设计；题目七JK 触发器的设计；题目八D 触发器的设计；题目九十进制同步计数器的设计；题目十T 触发器的设计；每位同学根据自己学号除以10 所得的余数加一，选择相应题号的课题。参考书目1EDA技术与 VHDL程雷伏容 , 李俊 , 尹清华大学出版978-7-302-22416-7 2010 TP312VH/36序开发基础教程霞社2VHDL电路设计技术王道宪贺名臣国防工业出版7-118-03352-92004TN702/62刘伟社3VHDL实用技术潘松 , 王国栋7-810657-81065-290-72000TP312VH/14VHDL语言 100 例详北京理工大学7-9006257-900
4、625-02-X1999TP312VH/3解ASIC研究所5VHDL编程与仿真王毅平等人民邮电出版7-115-08641-9200073.9621/W38V社6VHDL程序设计教程邢建平曾繁泰清华大学出版7-302-11652-02005TP312VH/27/3社7VHDL电路设计雷伏容清华大学出版7-302-14226-22006TN702/185社52 设 计 要 求 ：课程设计报告规范课程设计报告应包含如下几个部分1) 功能描述说明设计器件的功能，包括真值表（功能表），函数表达式，逻辑电路图2) 详细设计按照 VHDL 语言开发流程写出整个开发过程，可以根据如下步骤适当导出程序，程序界面
5、截图到课程设计报告对应模块。3) 调试分析以及设计体会a.仿真或程序下载调试（附界面截图）。b.设计过程中遇到的问题以及解决问题的方法。c.课程设计过程经验教训、心得体会。4) 书写格式见附带说明。5) 附录a.参考书目b.源程序清单（带注释）考核方式指导老师负责验收程序的运行结果，并结合学生的工作态度、实际动手能力、创新精神和设计报告等进行综合考评，并按优秀、良好、中等、及格和不及格五个等级给出每位同学的课程设计成绩。具体考核标准包含以下几个部分：1) 平时出勤 （占 10%）2)系统需求分析、功能设计、数据结构设计及程序总体结构合理与否（占10%）3)程序能否完整、准确地运行，个人能否独立
6、、熟练地调试程序（占40%）64) 设计报告（占 30%）5) 注意：不得抄袭他人的报告（或给他人抄袭），一旦发现，成绩为零分。6) 独立完成情况（占 10%）。课程设计验收要求1) 运行所设计的系统。2) 回答有关问题。3) 提交课程设计报告纸质稿。4) 提交源程序、设计报告文档电子稿。5) 依内容的创新程度，完善程序情况及对程序讲解情况打分。二 、 进 度 安 排上机时间：十九周周二8:00-12:00十九周周三8:00-12:00二十周周一14:00-18:00附带说明：课程设计报告装订顺序：封面、任务书、目录、正文、评分、附件（程序清单）。正文的格式 :一级标题用3 号黑体 ,二级标题
7、用四号宋体加粗,正文用小四号宋体;行距为 22。正文的内容 :一、课题的主要功能；二、详细设计；三、程序调试；四、总结；五、附件（所有程序的原代码，要求对程序写出必要的注释） 。正文总字数要求在5000 字以上（不含程序原代码）。7目录1) 功能描述 72) 详细设计 83) 调试分析以及设计体会 144) 书写格式 195) 附录 198一、 功能描述1RS触发器有两个稳定状态 ,Qn 为触发器的原状态 ,Qn+1 为触发器的次态 ,R 为置 0 端,S为置 1 端 .2基本 RS触发器具有置位、复位和保持（记忆）的功能；3基本 RS触发器的触发信号是低电平有效，属于电平触发方式；4基本 RS触发器存在约束条件（ R+S=1），由于两个与非门的延迟时间无法确定；当 R=S=0时，将导致下一状态的不确定。5当输入信号发生变化时，输出即刻就会发生相应的变化，即抗干扰性能较差。同步 RS 触发器（时钟脉冲控制的RS 触发器）1) 、真值表2) 、函数表达式93) 、逻辑电路图它由两个与非门的输入输出交叉连接而成, 如下图 :二、详细设计1、打开 Quartus 软件，建立一个新的工程：1）单击菜单 Project Wizard.2) 输入工程的路径、工程名以及顶层实体名。3 ）单击 Next按钮，本实验没有包含已有文件，单击 Next
