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1、第4章 系统配置和中断模块 本章介绍LF240 x DSP的系统配置寄存器和中断模块。 系统配置：用来对DSP片内的功能模块进行用户配置，根据具体用途来进行模块定制。 中断模块：中断优先级和中断向量表、外设中断扩展控制器(PIE)、中断响应的流程、CPU中断寄存器、外设中断寄存器、复位、无效地址检测、外部中断控制寄存器。,4.1 系统配置寄存器 包括系统控制状态寄存器SCSR1、SCSR2和器件标示寄存器DINR。 LF2407与其他处理器一样，大多数控制功能和任务是通过对片内各种各样的控制寄存器的读和写完成的。 *事实上，对DSP的控制，主要体现在对这些控制寄存器的控制上。软件开发中的一个重
2、要工作是对控制寄存器的读写。 对于寄存器需要关注的： 1）寄存器功能，各位的含义； 2）寄存器的地址，LF2407的寄存器分布在数据空间7000h753Fh; 3）读写操作，R、W、RW等； 4）复位后状态，-0、-1；,电子工程师必备知识之二：寄存器,1系统控制和状态寄存器1（SCSR1） SCSR1映射到数据存储器空间的7018h，主要用于配置和时钟相关的模块。,位14： CLKSRC，为CLKOUT引脚输出时钟源的选择位 0CLKOUT引脚输出CPU时钟； 1CLKOUT引脚输出WDCLK时钟。,位13、12：LPM1，LPM0，低功耗模式选择，指明在执行IDLE 指令后进入哪一种低功耗
3、模式。 00进入IDLE1（LPM0）模式； 01进入IDLE2（LPM1）模式； 1x进入 HALT（LPM2）模式。,位119：CLK PS2-CLK PS0，PLL时钟预定标选择位，选择输入时钟频率fin的倍频系数，如教材的表4.1（P32）所示。,位7：ADC CLKEN,ADC模块时钟使能控制位 0-禁止ADC模块时钟（节能） 1-使能ADC模块时钟，且正常运行 位6-2：分别对应SCI、SPI、CAN、EVB、EVA的时钟使能控制位。 位0：ILLADR, 无效地址检测位 检测到无效地址时，该位置1。置1后需软件来清0，即向该位写0即可。复位时该位为0。,1系统控制和状态寄存器1（
4、SCSR1）-续 SCSR1映射到数据存储器空间的7018h，主要用于配置和时钟相关的模块。,2系统控制和状态寄存器2(SCSR2) SCSR2被映射到数据存储器空间7019h。,位6：I/P QUAL，时钟输入限定，限定CAP1-6、XINT1-2、ADCSOC、PDPINTA/B引脚上的信号被正确锁存时，所需要的最小脉冲宽度。脉冲宽度只有达到这个宽度之后，内部的输入状态才会改变。 0-锁存脉冲至少需要5个时钟周期； 1-锁存脉冲至少需要11个时钟周期。 位5：WD保护位，该位可用来防止WD被软件禁止。该位是个只能清除的位，复位后1。通过向该位写1对其清0。 0-保护WD，防止WD被软件禁止
5、。 1-复位时的默认值，此时可以设WDCR的WDDIS=1来禁止WD工作。,2系统控制和状态寄存器2(SCSR2)-续 SCSR2被映射到数据存储器空间7019h。,位4：XMIF HI-Z。该位控制外部存储器接口信号 (XMIF)。 0-所有XMIF信号为正常驱动模式(非高阻态)。 1-所有XMIF信号处于高阻态。 注意：该位仅对LF2407/ LF2407A型号有效，对其它型号为保留位 位3： BOOTEN*使能位。这位反映了BOOTEN*引脚在复位时的状态。 0-使能引导ROM。地址0000h-00FFh被片内引导ROM块占用。禁止用FLash存储器。 1-禁止引导ROM。LF2407片
6、内Flash程序存储器映射地址范围为0000h-7FFFh。,2系统控制和状态寄存器2(SCSR2)-续 SCSR2被映射到数据存储器空间7019h。,位2： MP/MC* (微处理器微控制器选择)。 0-微控制器方式，程序空间0000h-7FFFh被映射到片内程序存储器空间。 1-微处理器方式，程序空间0000h-7FFFh被映射到片外程序存储器空间(必须外扩外部程序存储器) 位1-0：SARAM的程序/数据空间选择 00-地址空间不被映射，该空间被分配到外部存储器 0l-SARAM 被映射到片内程序空间 10-SARAM 被映射到片内数据空间 11-SARAM 被映射到片内程序空间，又被映
7、射到片内数据空间,4.1.2器件标识号寄存器(DINR) 映射到数据存储器空间701Ch。各位意义： 位15-4：DIN15-DIN4。这些位包含了所用DSP的器件标识号（DIN）。 位3-0：DIN3-DIN0。这些位包含了所用DSP的器件的版本、给定值。不同型号的DSP所对应的DIN15-DIN0的值如下： 器件 版本 DIN15-DIN0 LF2407 1.0-1.5 0510h LF2407 1.6 0511h LF2407A 1.0 0520h LC2406A 1.0 0700h LC2402A 1.0 0610h,*中断的引出及相关概念 中断的概念：所谓中断是指CPU对系统中发生的
8、异步事件的响应，异步事件是指无一定时序关系的随机发生的事件。 通俗来讲，DSP工作在包含多个外部事件的环境中，当这些事件发生时DSP要执行规定的任务。中断就是要求DSP的CPU暂停当前工作，转而去处理这些外部事件，等处理完以后，再继续以前的工作。 中断源：一般把外部事件和请求CPU中断的设备称为中断源。 中断源分为：不可屏蔽中断和可屏蔽中断。 单片机(80C51)具有1个不可屏蔽中断和5个可屏蔽中断，每个中断源都对一个特定的入口地址（中断向量）。 LF2407需要处理的外部和片内外设产生的中断事件有38个之多，如何管理？ 解决之道，分层管理！,4.2中断优先级和中断向量表 LF2407 DSP
9、具有3个不可屏蔽中断和6个级别的可屏蔽中断（INT1-INT6）。 在每级可屏蔽中断（INT1-INT6）中又有多个中断源，有唯一的中断入口地址向量。,表4.1 不可屏蔽中断,表4.2 INT1中断,INT1中断，主要为高优先级的外设中断,表4.3 INT2中断,INT2中断，为事件管理器EVA、EVB的比较器和定时器中断,表4.4 INT3中断,INT3中断，为事件管理器EVA、EVB的定时器中断,表4.5 INT4中断,INT4中断，为事件管理器EVA、EVB的捕捉中断,表4.6 INT5中断,INT5中断，为低优先级的外设中断,表4.7 INT6中断,INT6中断，为低优先级的外设中断及
10、其它,4.3 外设中断扩展控制器PIE 用一个外设中断扩展（PIE）控制器专门来管理6个级别的多个中断源。 请求和应答都是两个层次： 低层次中断：从几个外设中断请求PIRQ产生一个INTn； 高层次中断：从INTn请求产生一个到CPU的中断请求。,图4.1为外设中断扩展模块图,4.3.2 中断向量 当CPU接受中断请求时，它并不知道是哪一外设事件引起的中断请求。 LF240 x有两个中断向量表, CPU向量表和外设向量表。 CPU向量与中断级别INTn相对应，响应中断时由硬件跳转完成； 外设向量在外设中断向量寄存器(PIVR)中读出，用于转向特定的中断服务子程序。,CPU中断向量，0004h,
11、PIVR，读取外设向量,通用中断服务子程序，GISR,特定中断服务子程序，SISR,1假中断向量 如果一个中断应答被响应，但没有获得相应的外设的中断请求，那么就产生假中断。 以下两种情况会产生假中断： (1) CPU执行一个软件中断指令INTR，用于请求服务6个可屏蔽中断（INT1-INT6）之一。 (2) 当外设发出中断请求，但是其INTn标志位却在CPU应答请求之前已经被清0。,假中断向量,假中断服务子程序,假中断向量可以保证中断系统的完整性，从而使中断系统 一直可靠安全地运行，而不会进入无法预料的中断死循环中。,4.3.3 全局中断使能 状态寄存器STO中有一个全局中断使能位INTM，在
12、初始化程序和主程序中，常常需要使用该位对DSP的全局中断进行打开和关闭操作。 在初始化过程中，需要关全局中断，而在主程序开始执行时，需要开全局中断。关全局中断和开全局中断的汇编语言指令如下： SETC INTM；把INTM位置1，关全局中断 CLRC INTM；把INTM位清0，开全局中断 执行完中断服务子程序后，一定要打开全局中断。 因为进入中断服务程序时，系统自动关中断。所以从中断返回时需要重新打开全局中断。(在汇编语言中) 注意：不允许中断嵌套。,4.4 中断响应的过程 下面介绍某一外设中断请求的响应过程。 （1）某一外设发出中断请求。 （2）如该外设的中断请求标志位（IF）为1，且该外
13、设的中断使能位（IE）为1，则产生一个到PIE控制器的中断请求； （3）如果不存在相同优先级（INTn）的中断请求，那么PIRQ会使PIE控制器产生一个到CPU的中断请求（INTn），为2个CPU时钟宽度的低电平脉冲。,外设级请求,核心级请求,（4）如果CPU中断已被使能，中断屏蔽寄存器（IMR）CPU会中止当前的任务，将INTM置1，以屏蔽所有可屏蔽的中断，保存上下文，并且开始为高优先级的中断（INTn）执行通用中断服务子程序（GISR）。CPU自动产生一个中断应答，并向与被响应的高优先级中断的相应程序地址总线（PAB）送一个中断向量值。例如，如果1NT2被响应了，它的中断向量0004h被装
14、入PAB。 （5）外设中断扩展（PIE）控制器会对PAB的值进行译码，并产生一个外设响应应答，清除与被应答的CPU中断相关的PIRQ位。外设中断扩展控制器然后将相应的中断向量（或假中断向量）载入外设中断向量寄存器（PIVR）。当GISR已经完成了现场保护，然后就可读入PIVR，使程序转入到SISR的入口处去执行。,核心级响应,外设级响应,4.5 中断响应的等待时间 中断响应的等待时间包括：外设同步接口时间、CPU响应时间、ISR转移时间。 (1)外设同步接口时间是指PIE识别出外设发来的中断请求，经判断优先级、转换后将中断请求发送至CPU的时间。 (2）CPU的响应时间指的是CPU识别出已经被
15、使能的中断请求、响应中断、清除流水线、并且开始捕获来自CPU中断向量的第一条指令所花费的时间。最小的CPU的响应时间是4个CPU指令周期。 (3)ISR转移时间是指为了转移ISR中特定部分而必须执行一些转移所花费的时间。该时间长短根据用户所实现的ISR的不同而有所变化。,4.6 CPU的中断寄存器 跟中断相关的寄存器包括：ST0(INTM)、CPU中断寄存器、外设相关的寄存器（IMR,IMR,CR等，在外设章节叙述）。 CPU中断寄存器包括：(1)中断标志寄存器(IFR);(2)中断屏蔽寄存器(IMR)。 4.6.1 CPU中断标志寄存器(IFR) IFR用于识别和清除INT1-6引起的中断。
16、IFR映射到数据存储器空间为0006h。 位5-0：分别为INT6-INT1的中断标志位。 0无INTn（n1-6）的中断挂起， 1表示有INTn（n1-6）的中断挂起。,读取IFR可以识别挂起的中断。 CPU响应中断或复位都能将IFR标志清除。 在对IFR操作时应注意以下几点： （1）要想清除某一IFR位，必须向该位写1，而不是0； （2）当一个可屏蔽中断被响应时，只有IFR位被清除，而相应的外设控制寄存器中的中断请求标志位不会被清除。如果需要清除这些标志位，应该使用软件来清除。 （3）当通过INTR指令来请求中断，且相应的IFR位被置1时，CPU不会自动清除该位，该位必须由软件来清除。 （4）IFR和IMR控制的是核心级的中断，所有外设在它们各自的配置/控制寄存器都有相应的中断屏蔽和标志位。,4.6.2 CPU中断屏蔽寄存器(IMR) IMR用于屏蔽中断或使能中断，读IMR可以识别出已屏蔽或使能的中断级。映射在数据存储器空间中的地址为0004h。,
