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1、2,C H A P T E R,嵌入式硬件基础,本节提要,1,3,2,4,嵌入式系统硬件基础,嵌入式系统开发环境,嵌入式系统硬件开发流程,芯片封装知识简介,嵌入式系统硬件部分,嵌入式系统软件部分,如人的大脑，决定了硬件的操作模式。通过良好的操作系统以及应用程序，把硬件功能发挥到极至。,如人的手、脚、神经等部位，决定了嵌入式系统的先天功能。如运算能力和I/O接口等。,RISC和CISC 冯诺依曼体系结构和哈佛体系结构 流水线 嵌入式微处理器体系结果 总线 高速输入输出接口 输入输出设备 存储器,嵌入式系统硬件基础,CISC和RISC,CISC：复杂指令集（Complex Instruction
2、Set Computer） 具有大量的指令和寻址方式，指令长度可变 8/2原则：80%的程序只使用20%的指令 大多数程序只使用少量的指令就能够运行。,RISC：精简指令集（Reduced Instruction Set Computer) 只包含最有用的指令，指令长度固定 确保数据通道快速执行每一条指令 使CPU硬件结构设计变得更为简单,CISC与RISC的数据通道,IF,ID,REG,ALU,MEM,开始,退出,IF,ID,ALU,MEM,REG,微操作通道,开始,退出,单通数据通道,RISC：Load/Store结构,CISC：寻址方式复杂,CISC的背景和特点,背景: 存储资源紧缺,
3、强调编译优化 增强指令功能，设置一些功能复杂的指令，把一些原来由软件实现的、常用的功能改用硬件的（微程序）指令系统来实现 为节省存储空间，强调高代码密度，指令格式不固定，指令可长可短，操作数可多可少 寻址方式复杂多样，操作数可来自寄存器，也可来自存储器 采用微程序控制，执行每条指令均需完成一个微指令序列 CPI ，指令越复杂，CPI越大。,CISC的主要缺点,指令使用频度不均衡。 高频度使用的指令占据了绝大部分的执行时间，扩充的复杂指令往往是低频度指令。 大量复杂指令的控制逻辑不规整，不适于VLSI工艺 VLSI的出现，使单芯片处理机希望采用规整的硬联逻辑实现，而不希望用微程序，因为微程序的使
4、用反而制约了速度提高。(微码的存控速度比CPU慢5-10倍)。 软硬功能分配 复杂指令增加硬件的复杂度，使指令执行周期大大加长，直接访存次数增多，数据重复利用率低。 不利于先进指令级并行技术的采用 流水线技术,RISC基本设计思想,减小CPI: CPUtime=Instr_Count * CPI * Clock_cycle 精简指令集：保留最基本的,去掉复杂、使用频度不高的指令 采用Load/Store结构，有助于减少指令格式，统一存储器访问方式 采用硬接线控制代替微程序控制,RISC:减少指令平均执行周期数,CPUtime= Instr_Count *CPI * Clock_cycle IC
5、RISC IC CISC, 30%-40% CCRISC CCCISC CPIRISC CPICISC ， 20% 超标量、超流水线、VLIW等系统结构， 目标在于减小CPI， 可使CPI1,RISC的提出与发展,Load/Store结构提出： CDC6600(1963)-CRAY1(1976) RISC思想最早在IBM公司提出，但不叫RISC，IBM801处理器是公认体现RISC思想的机器。 1980年，Berkeley的Patterson和Dizel提出RISC名词，并研制了RISC-,实验样机。 1981年Stenford的Hennessy研制MIPS芯片。 85年后推出商品化RISC:
6、 MIPS1(1986)和SPARC V1(1987),典型的高性能RISC处理器,SUN公司的SPARC(1987) MIPS公司的SGI:MIPS(1986) HP公司的PA-RISC, IBM, Motorola公司的PowerPC DEC、Compac公司的Alpha AXP IBM的RS6000(1990)第一台Superscalar RISC机,CISC与RISC的对比,冯诺依曼体系结构,冯诺依曼体系结构,指令寄存器,控制器,数据通道,输入,输出,中央处理器,存储器,程序,指令0,指令1,指令2,指令3,指令4,数据,数据0,数据1,数据2,哈佛体系结构,指令寄存器,控制器,数据通
7、道,输入,输出,CPU,程序存储器,指令0,指令1,指令2,数据存储器,数据0,数据1,数据2,地址,指令,地址,数据,流水线技术,流水线(Pipeline)技术：几个指令可以并行执行 提高了CPU的运行效率 内部信息流要求通畅流动,译码,取指,执行add,译码,取指,执行sub,译码,取指,执行cmp,时间,Add,Sub,Cmp,指令流水线以ARM为例,为增加处理器指令流的速度，ARM7 系列使用3级流水线. 允许多个操作同时处理，比逐条指令执行要快。 PC指向正被取指的指令，而非正在执行的指令,Fetch,Decode,Execute,从存储器中读取指令,解码指令,寄存器读（从寄存器Ba
8、nk） 移位及ALU操作 寄存器写（到寄存器Bank ）,PC PC,PC - 4 PC-2,PC - 8 PC - 4,ARM Thumb,最佳流水线,该例中用6个时钟周期执行了6条指令 所有的操作都在寄存器中（单周期执行） 指令周期数 (CPI) = 1,操作,周期,1 2 3 4 5 6,Fetch,Decode,Execute,Fetch,Decode,Execute,Fetch,Decode,Execute,Fetch,Decode,Execute,Fetch,Decode,Execute,Decode,Execute,Fetch,Decode,Fetch,Fetch,LDR 流水线
9、举例,该例中，用6周期执行了4条指令 指令周期数 (CPI) = 1.5,周期,操作,1 2 3 4 5 6,Fetch,Decode,Execute,Fetch,Decode,Execute,Fetch,Decode,Execute,Data,Writeback,Fetch,Decode,Execute,Fetch,Decode,Fetch,分支流水线举例,流水线被阻断 注意:内核运行在ARM状态,周期,1 2 3 4 5,地址 操作,Fetch,Decode,Execute,Fetch,Decode,Execute,Fetch,Decode,Fetch,Fetch,Decode,Execu
10、te,Linkret,Adjust,Fetch,Decode,Fetch,超标量执行,超标量(Superscalar)执行：超标量CPU采用多条流水线结构,执行1,取指,指令,译码2,译码1,执行2,执行1,取指,译码2,译码1,执行2,流水线1,流水线2,数据回写,高速缓存（CACHE）,1、为什么采用高速缓存 微处理器的时钟频率比内存速度提高快得多，高速缓存可以提高内存的平均性能。 2、高速缓存的工作原理 高速缓存是一种小型、快速的存储器，它保存部分主存内容的拷贝。,CPU,高速缓存控制器,CACHE,主存,数据,数据,地址,总线和总线桥,ARM公司提出的AMBA总线标准,嵌入式处理器体系
11、结构,按体系结构的不同可分为五大类 ARM MIPS POWER PC X86 SH系列,ARM 公司的ARM RISC处理器 ARM 7 Thumb 家族 ARM 9 Thumb 家族 ARM 10 Thumb 家族 ARM 11 Thumb 家族,Intel StrongARM,StrongARM 110 StrongARM 1100 StrongARM 1110 StrongARM 1111,INTEL的Xscale架构处理器,基于ARM V5TE体系结构 兼容ARM V5TE ISA指令集（不支持浮点指令集） 在处理器内核周围提供了 指令和数据存储器管理单元 指令、数据和微小数据缓存
12、写缓冲、挂起缓冲和分支目标缓冲器 电源管理 性能监控 调试 JTAG单元以及协处理器接口 MAC协处理器 内核存储总线,MIPS,从1986年推出R2000处理器以来，MIPS陆续推出R3000、R4000、R8000等。 之后,MIPS公司的战略发生变化，把重点放在嵌入式系统。 1999年，MIPS公司发布了MIPS32和MIPS64体系结构标准，集成了原来所有的MIPS指令集，并且增加了许多更强大的功能。 此后MIPS公司又陆续开发了高性能、低功耗的32位和64位处理器内核。,MIPS RISC,MIPS,在MIPS的32位内核中 4K系列对应于SOC应用设计； M4K系列内核是为在下一代
13、消费电子、网络、宽带应用中越来越受欢迎的多CPU SOC所设计； 4KE系列具有目前32位通用嵌入式处理器中最高的DMIPS/MHz性能指标； 4KS系列由于采用了特殊的SmartMIPS体系结构，特别适用于需要安全数据传输的领域，比如网络、智能卡等； 5K和20Kc系列属于MIPS的64位内核 5K能提供1.4DMIPS/MHz的性能以及最低350MHz的运行速率。 20Kc是当今最快的可授权嵌入式处理器内核。一般运行在600MHz，具有7段流水线的20Kc内核，能提供1.2GFLOPS的峰值浮点运算能力。,MIPS,在嵌入式处理器市场中，基于MIPS内核的处理器占据了相当大的数量 2002
14、年，一共付运了8700万片采用MIPS内核的嵌入式处理器，份额仅次于ARM位居全球第二。 在目前快速增长的比如Cable Modem、DSL Modem、DVD录像机等领域内，MIPS的市场份额位居第一。 MIPS的合作伙伴包括了AMD，IDT，NEC，TI，SONY等众多厂商,PowerPC体系结构,Motorola半导体（现Freescale半导体）联合IBM以及苹果电脑 IBM PowerPC750 PowerPCG3 Motorola MPC MC,X86体系结构,Intel X86体系结构 AMD最新的X86体系结构嵌入式处理器产品为Geode 系列处理器 CISC指令集,SH体系结
15、构,SH(SuperH)系列是由前日立半导体公司（现Renesas公司）推出的嵌入式处理器 SH系列的CPU指令格式是固定的，只有一个字长，绝大多数指令是单周期完成的，即使是复杂的乘加指令也仅需2个时钟周期 为了克服内存访问的瓶颈，SH的CPU简化寻址方式，采用Load/Store(装载/存储)结构，并且在片内设置高速缓存，以减少访问内存的时间,1999年底，SH系列累计生产达1.18亿片。 SH系列投入市场后，用量最多的是工业，占总量的36%，第二位是办公自动化，占总量的26%；第三位是消费领域；再其次的是通信领域。 此外，汽车导航、定位、控制系统，也是SH系列不小的一个市场。 在美国，SH系列占有较大的市场份额 型号 SH1-4（32位） SH5(64位),总线,总线的主要参数有 总线的带宽 总线的位宽 总线的工作时钟频率,总线机制,微处理器（CPU）是嵌入式系统硬件平台的核心构件，但不是全部。按照冯诺依曼体系结构思想，计算机的硬件是由CPU、存储器和I/O设备三部分组成的。总线是把CPU与存储器、I/O设备相连接的信息通道，但总线并不仅仅指的是一束信号线，而应包含相应的通信协议。按照使用场合的不同，总线分成芯片
