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1、第4章,时序仿真与硬件实现,4.1 VHDL程序输入与仿真测试,4.1.1 编辑和输入设计文件, 新建一个文件夹。, 输入源程序。, 文件存盘。,4.1 VHDL程序输入与仿真测试,4.1.2 创建工程, 打开并建立新工程管理窗口。, 将设计文件加入工程中。, 选择目标芯片。, 工具设置。, 结束设置。,4.1 VHDL程序输入与仿真测试,4.1.3 全程编译前约束项目设置, 选择FPGA目标芯片。, 选择配置器件的工作方式。, 选择配置器件和编程方式。, 选择目标器件引脚端口状态。, 对双功能引脚进行设置。,4.1 VHDL程序输入与仿真测试,4.1.4 全程综合与编译,4.1 VHDL程序
2、输入与仿真测试,4.1.5 仿真测试, 打开波形编辑器。,4.1 VHDL程序输入与仿真测试,4.1.5 仿真测试, 设置仿真时间区域。, 波形文件存盘。,4.1 VHDL程序输入与仿真测试,4.1.5 仿真测试, 将工程CNT10的端口信号节点选入波形编辑器中。,4.1 VHDL程序输入与仿真测试,4.1.5 仿真测试, 设置激励信号波形。,4.1 VHDL程序输入与仿真测试,4.1.5 仿真测试, 图4-13是最后设置好的vwf仿真激励波形文件图。, 仿真器参数设置。, 启动仿真器。, 观察仿真结果。,4.1 VHDL程序输入与仿真测试,4.1.6 RTL图观察器应用,4.2 引脚锁定与硬
3、件测试,4.2.1 引脚锁定,4.2 引脚锁定与硬件测试,4.2.1 引脚锁定, 假设现在已打开了CNT10工程。, 选择Assignments Assignment Editor命令,4.2 引脚锁定与硬件测试,4.2.1 引脚锁定, 双击TO栏的new, 注意在键入所希望的引脚编号,4.2 引脚锁定与硬件测试,4.2.2 编译文件下载,（1）打开编程窗和配置文件。,（2）设置编程器。,（3）硬件测试。,4.2 引脚锁定与硬件测试,4.2.3 JTAG间接编程模式,1. 将SOF文件转化为JTAG间接配置文件。,4.2 引脚锁定与硬件测试,4.2.3 JTAG间接编程模式,1. 将SOF文件
4、转化为JTAG间接配置文件。,4.2 引脚锁定与硬件测试,4.2.3 JTAG间接编程模式,2. 下载JTAG间接配置文件。,4.2 引脚锁定与硬件测试,4.2.4 USB-Blaster驱动程序安装方法,4.3 电路原理图设计流程,4.3.1 用原理图输入方式设计半加器,4.3 电路原理图设计流程,4.3.1 用原理图输入方式设计半加器,（1）打开原理图编辑窗。,（2）建立一个初始原理图。,4.3 电路原理图设计流程,4.3.1 用原理图输入方式设计半加器,（3）原理图文件存盘。,4.3 电路原理图设计流程,4.3.1 用原理图输入方式设计半加器,（4）创建原理图文件为顶层设计的工程。,（5
5、）绘制半加器原理图。,（6）测试半加器。,4.3 电路原理图设计流程,4.3.2 完成全加器顶层设计,4.3 电路原理图设计流程,4.3.3 对全加器进行时序仿真和硬件测试,4.4 利用属性表述实现引脚锁定,4.5 宏模块逻辑功能查询,4.6 SignalTap II的使用方法,4.6 SignalTap II的使用方法,1打开SignalTap II编辑窗口,2调入待测信号,4.6 SignalTap II的使用方法,3SignalTap II参数设置,4.6 SignalTap II的使用方法,4文件存盘,5编译下载,4.6 SignalTap II的使用方法,6启动SignalTap I
6、I进行采样与分析,4.6 SignalTap II的使用方法,7SignalTap II的其他设置和控制方法,4.7 编辑SignalTap II的触发信号,实 验,4-1多路选择器设计实验,4-2十六进制7段数码显示译码器设计,实 验,4-1多路选择器设计实验,4-2十六进制7段数码显示译码器设计,实 验,4-3计数器设计实验,4-4硬件消抖动电路设计,实 验,4-3计数器设计实验,4-4硬件消抖动电路设计,实 验,4-5应用宏模块设计数字频率计,实 验,4-5应用宏模块设计数字频率计,实 验,4-5应用宏模块设计数字频率计,实 验,4-5应用宏模块设计数字频率计,实 验,4-5应用宏模块设计数字频率计,实 验,4-5应用宏模块设计数字频率计,实 验,4-6 数码扫描显示电路设计,实 验,4-7 串行静态显示控制电路设计,4-8 不同类型的移位寄存器设计实验,
