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1、试卷第 1 页 共 12 页一 、选择题题号 1 2 3 4 5 6 7 8 9 10答案 A B B A A C C C B D1、图 1 所示逻辑电路为( )。A、 “与非”门 B、 “与”门 C、 “或”门 D、 “或非”门UUCUBRKRBCF2、场效应管门电路如图 2 所示，该电路为( )。A、 “与非”门 B、 “非”门 C、 “或”门DF3、逻辑图和输入 A，B 的波形如图 3 所示，分析在 t1 时刻输出 F 为( )。A、 “1” B、 “0” C、任意 t1=1 FBB4、半加器的逻辑图如图 4 所示，指出它的逻辑式为( )。A、 A B C=AB B、 B+A C= C、
2、 A B C=SSABS图 1图 2图 3试卷第 2 页 共 12 页&=1ABCS5、逻辑电路如图 5 所示，当 A=“0”，B=“1”时， 脉冲来到后 触发器( )。DA、具有计数功能 B、保持原状态 C、置“0” D、置“1”Q=1 AB16、某数/模转换器的输入为 8 位二进制数字信号（D 7D0)，输出为 025.5V 的模拟电压。若数字信号的最低位是“1”其余各位是“0” ，则输出的模拟电压为( )。A、0.1V B、0.01V C、0.001V D.1V7、逻辑式 BC+ABC+ C，化简后为( )。FAA、 B+ C B、 C+AB C、 C+BCFFA8、如图 6，二位二进制
3、译码器的逻辑式为 Y0= 、Y 1= A、 Y2=B 、Y 3=BA，由逻辑式画出的逻辑电路为( )。& & & & BA& & & & BA& & & & AY231Y0Y0123012Y3()b11BB()a1 1B11 (c)9、引起组合电路中竞争与冒险的原因是（ ）图 4图 5图 6试卷第 3 页 共 12 页A、逻辑关系错 B、电路延时 C、干扰信号 D、电源不稳定10、欲将正弦波信号转换成与之频率相同的脉冲信号，应用（ ）A、移位寄存器 B、A/D 转换器 C、T 触发器 D、施密特触发器A C A B D1. F=A 的值是_ 。)(A. B B. A C. D. BA2. 异或
4、门实现六位码 a1、a 2、a 3、a 4、a 5、a 6的奇校验电路，要求当奇数个 1 时，输出为 y=1，否则 y=0，则其逻辑表达式 y=_。A. a1a2a3a4a5a6 B. a1+a2+a3+a4+a5+a6C. a1 a2 a3 a4 a5 a6 D. a1a 2a 3a 4a 5a 6 3时序电路中必须包含_。A. 触发器B. 组合逻辑电路C. 移位寄存器. 译码器4采用共阳极数码管的译码显示电路如图所示，若显示码数是 5， 译码器输出端应为_ 。A. b=e=“0”,a=c=d=f =g=“1” B. b=e=“1”,a=c=d=f =g=“0”C. a=b=c=“0”,b=
5、e=f =g=“1” D. 都不是ABCDRUacdeg5Vfb583 线优先编码器（74LS148）中，输入线 同时有效时，优先级最高为4I7I7 线，则 输出线的性质是_ 。012YA. 000 B. 010 C. 101 D. 111二、填空题。1. 的反函数= 。)(DCF2. 组合逻辑电路的特点是 记忆功能。3. 编码器有 10 个输入，则输出应有 位。4. 数据分配器一般用 器实现其功能。试卷第 4 页 共 12 页5. 不需要时钟脉冲 CP 的清零方式称为 清零。6. 对于 JK 触发器，当 J=K 时，则可完成 触发器的功能，若 K= ，则可完成 触发J器的功能。7. 欲将一个
6、存放在移位寄存器中的四位二进制数从串行输出端取出，需要 个移位脉冲。8. 欲将 1kH 的脉冲信号分频为 100 H ，应选用 进制计数器。ZZ9. 74160 采用的是异步清零法，则下图是一个 进制计数器。3Q 2QETCP0D1D2D3DRCO1Q 0Q74160(1)EPRD DLD13 D D3D CPQ Q0 0RCO 74160(2)L21ETQDQR 2DEP1计 数 脉 冲&1 11. 2. 没有 3. 4 4. 译码 )(BAF5. 异步 6. T D 7. 4 8. 10 9. 48 1、如果对 160 个符号进行二进制编码，则至少需要 位二进制数。2、A/D 转换输出的二
7、进制代码位数越多，则量化误差 转换精度 。3、二进制码 11101101 表示的十进制为 ，相应的 8421BCD 码为 。4、5 个变量可构成 个最小项，每个变量取值均为 1 可使 个最小项的值为 1。5、构造一个模 6 计数器需要 个状态， 个触发器。6、(DC) H=( )B=( )O=( )D7、已知三个电路的输入信号均为 Ui，且 Ui 与各电路输出电压 U01、U 02、U 03 的波形关系如图 7 所示。请将各电路名称填在下列空格中：电路 1为 ；电路 2 为 ；电路 3 为 。8、CMOS 电路的结构特点是以 MOS 管作驱动管，以 MOS 管作负载管，以 极作为输入端，以 极
8、作为输出端。9、一个 5 位地址码，8 位输出的 ROM，其存贮矩阵的容量为 。1、8 2、越小 ，越高 3、237 10001101114、64 ，1 5、6 ，3 6、11011100 ，334 ，22 7、反相器 ，分频器 ，传输门 8、N ，P ，栅 ，漏 9、256三、逻辑电路如图所示，试写出逻辑式，并化简之。图 7试卷第 5 页 共 12 页1&ABF1&C解： FABCABCABAC三、化简下列函数为最简函数（每小题 5 分，共 15 分）12. D3. （ 120981436),( dmCBAF1解： ACB2解： D)(3. 解：卡洛图如下：ABCD0001111000 01
9、 11 101 1 1 1 11则： DBCAF四、用卡诺图化简逻辑函数 )15,73,()1,9642,0(),( dm解. （6 分）试卷第 6 页 共 12 页由卡诺图得最简逻辑表达式为: （6 分）DAF五、已知右下图 4 选 1 数据选择器的功能如右下表，试用其实现逻辑函数 。 （画出接YAB线图）选择器功能表:STA 1A0Y D0D3D2D1解. (1) 把所要实现的逻辑函数与数据选择器的输出作比较，令 ，且 Y=Y，10, AB则有：D 0=D3=1，D 1=D2=0。(2) 画出逻辑图如下： STA1A0Y D0D3D2D1AB01Y六、已知逻辑图和输入 A，B，C 的波形如
10、图所示，试画出输出 和 的波形。F12地址输入 使能 输出A1 A0 STY 1 00 0 0 D00 1 0 D11 0 0 D21 1 0 D3试卷第 7 页 共 12 页解：七、某产品有 A、B、C、D 四项质量指标。规定： A 必须满足要求，其它三项中只要有任意两项满足要求，产品就算合格。试设计一个检验产品合格的逻辑电路，用与非实现。解：1、真值表 2、由真值表写出输出方程 ACDBBF八、分析与设计1. 分析下图所示同步计数电路，作出状态转换表和状态转换图，并检查能否自启动？ A B C D F0 0 0 0 00 0 0 1 00 0 1 0 00 0 1 1 00 1 0 0 0
11、0 1 0 1 00 1 1 0 00 1 1 1 01 0 0 0 01 0 0 1 01 0 1 0 01 0 1 1 11 1 0 0 01 1 0 1 11 1 1 0 11 1 1 1 1ABCF1F2ENENENENABCF1F2DABCF电路图7 分试卷第 8 页 共 12 页2 74290 为异步二-五-十进制集成计数器（如下图所示） ，试用其异步清零端构成 6 进制计数器。Q0Q1Q2Q3R0A R0B S9A S9BCP1CP03 现有三台用电设备 A1、A 2、A 3，每台用电设备均为 10kW。由两台发电机组供电，Y 1发电机组的的功率为 20kW，Y 2发电机组的功率
12、为 10kW。设计一个供电控制系统，当三台用电设备同时工作时，Y 1 、Y 2均启动；两台用电设备工作时，Y1启动；一台用电设备工做时，Y 2启动。试分别用与非门和 3 线-8 线译码器74138（如下图所示）实现之。3-8线译码器A1A2A3Y1Y2Y3Y4Y5Y6Y7Y81解： nnnnn QQKJ232323313 CPQ3试卷第 9 页 共 12 页nQ12 nnnQQ13121Q3nQ2nQ1nQ3n+1Q2n+1Q1n+10 0 0 0 0 10 0 1 0 1 10 1 1 1 1 11 1 1 1 1 01 1 0 1 0 01 0 0 0 0 10 1 0 1 0 01 0
13、1 0 1 0Q3Q2Q1000 001 011 111110100010101由状态图可知：为 5 进制计数器 可以自启动。 2解： 得： ，016S120QRQ0Q1Q2Q3R0A R0B S9A S9BCP1CP03解：设设备工作为“1” ，电机启动为“1” 试卷第 10 页 共 12 页则有：A1A2A3Y1Y20 0 0 0 00 0 1 0 10 1 0 0 10 1 1 1 01 0 0 0 11 0 1 1 01 1 0 1 01 1 1 1 1得： 321217653AAY),(42用与非门实现：试卷第 11 页 共 12 页A313A2A31Y&A1A1A2212A31231A2 2Y& &用 3-8 线译码器实现：3-8线译码器A1A2A3Y1Y2Y3Y4Y5Y6Y7Y8& 1Y& 2Y例 4 试用代数法证明： )()()( CABCAB试卷第 12 页 共 12 页例 5.设逻辑函数 ，证明其对偶函数 ,且 是以个自对偶函数。CBAYAYBCY
